[发明专利]记忆体控制器有效
申请号: | 201711104211.X | 申请日: | 2017-11-10 |
公开(公告)号: | CN109785872B | 公开(公告)日: | 2020-10-09 |
发明(设计)人: | 王世宏;黄胜国;周格至;王文山 | 申请(专利权)人: | 瑞昱半导体股份有限公司 |
主分类号: | G11C5/02 | 分类号: | G11C5/02 |
代理公司: | 北京德恒律治知识产权代理有限公司 11409 | 代理人: | 章社杲;李伟 |
地址: | 中国台湾新竹*** | 国省代码: | 台湾;71 |
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摘要: | 一种记忆体控制器,用来调整一输出端的阻抗匹配,并透过该输出端输出控制一记忆体的一控制讯号。该记忆体控制器包含一第一驱动及阻抗匹配电路、一第二驱动及阻抗匹配电路以及一逻辑电路。该逻辑电路耦接于该第一驱动及阻抗匹配电路及该第二驱动及阻抗匹配电路,用来设定该第一驱动及阻抗匹配电路的一第一阻抗及一第一驱动能力、设定该第二驱动及阻抗匹配电路的一第二阻抗及一第二驱动能力,以及致能该第一驱动及阻抗匹配电路以使该控制讯号具有一第一准位或致能该第二驱动及阻抗匹配电路以使该控制讯号具有不同于该第一准位的一第二准位。 | ||
搜索关键词: | 记忆体 控制器 | ||
【主权项】:
1.一种记忆体控制器,用来调整一输出端的阻抗匹配,并透过该输出端输出控制一记忆体的一控制讯号,该记忆体控制器包含:一第一驱动及阻抗匹配电路,耦接于一第一电压与该输出端之间;一第二驱动及阻抗匹配电路,耦接于一第二电压与该输出端之间,其中,该第二电压不等于该第一电压;以及一逻辑电路,耦接于该第一驱动及阻抗匹配电路及该第二驱动及阻抗匹配电路,用来设定该第一驱动及阻抗匹配电路的一第一阻抗及一第一驱动能力、设定该第二驱动及阻抗匹配电路的一第二阻抗及一第二驱动能力,以及致能该第一驱动及阻抗匹配电路以使该控制讯号具有一第一准位或致能该第二驱动及阻抗匹配电路以使该控制讯号具有不同于该第一准位的一第二准位。
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