[发明专利]一种分裂栅的栅极形成方法有效
申请号: | 201710884971.0 | 申请日: | 2017-09-26 |
公开(公告)号: | CN107768375B | 公开(公告)日: | 2020-02-21 |
发明(设计)人: | 许鹏凯;习艳军;杨渝书 | 申请(专利权)人: | 上海华力微电子有限公司 |
主分类号: | H01L27/11531 | 分类号: | H01L27/11531;H01L27/11568;H01L27/11573;H01L21/28 |
代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 智云 |
地址: | 201203 上海市*** | 国省代码: | 上海;31 |
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摘要: | 本发明提出一种分裂栅的栅极形成方法,改善了分裂栅的栅极形成工艺,在分裂栅结构下同时获得了垂直形貌的选择栅极和控制栅极。相对于现有工艺中采用多晶硅侧墙刻蚀来形成控制栅极的方法来说,本发明采用两次成型以及自对准的方法,使得在分裂栅结构下能够较为容易的获得同时满足尺寸和形貌工艺要求的控制栅极。这种工艺流程降低了原有工艺流程中栅极刻蚀的难度,同时也使得工艺开发中诸如膜层生长厚度等条件也变得更加容易确定。 | ||
搜索关键词: | 一种 分裂 栅极 形成 方法 | ||
【主权项】:
一种分裂栅的栅极形成方法,其特征在于,包括下列步骤:根据后成型的栅极膜层结构,形成初始膜层,所述初始膜层包括从下至上依次设置于衬底层上的栅极氧化层,多晶硅层,氧化硅层,以及氮化硅层;对所述初始膜层进行曝光、刻蚀处理,形成多个沟槽结构;在上述结构上生长存储介质层;在上述结构上生长多晶硅膜层,进行化学机械研磨,并在研磨至存储介质层时停止,使得沟槽中填满多晶硅;对暴露在外的存储介质层进行刻蚀,使得这一刻蚀过程停在氮化硅层上;对暴露在外的多晶硅进行刻蚀,调整其在沟槽中的高度;进行氧化硅膜层生长,随之进行化学机械研磨,并在这一研磨过程到达氮化硅层时停止,使得沟槽中多晶硅上部填满氧化硅膜层;以暴露出来的氧化硅膜层为掩模版,将氮化硅层调整至所需要的厚度;在上述结构表面涂布光刻胶,进行曝光以显开控制栅极曝开区域,并在此基础上通过湿法刻蚀,将曝开区域的氮化硅层移除,继而通过干法刻蚀的方法,将曝开区域中心栅结构剩余的氧化硅膜层以及多晶硅膜层移除;移除光刻胶,并采用各向同性刻蚀,将暴露在外的存储介质层移除;采用湿法刻蚀的方法,将控制栅极顶部的氧化硅膜层全部移除,即可形成控制栅极;在上述结构表面涂布光刻胶,继而曝光选择栅极曝开区域,然后以此为掩模版进行干法刻蚀,将刻蚀过程停在氧化硅层上;在将光刻胶移除以后,对选择栅极曝开区域再一次进行涂胶,曝光以及刻蚀处理,该次刻蚀过程将曝开区域的剩余氧化硅层以及多晶硅层移除,并将刻蚀过程停在栅极氧化层上,最后将光刻胶全部移除后,即可获得选择栅极,以及分裂栅所有栅极结构。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
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