[发明专利]浅沟道隔离结构的制作方法和半导体器件的制作方法有效
申请号: | 201710770747.9 | 申请日: | 2017-08-31 |
公开(公告)号: | CN107579035B | 公开(公告)日: | 2019-04-30 |
发明(设计)人: | 宋冬门;蒋阳波;张静平;吴关平;游晓英 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L21/762 | 分类号: | H01L21/762 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 王宝筠 |
地址: | 430074 湖北省武汉市东湖*** | 国省代码: | 湖北;42 |
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摘要: | 本发明公开了一种浅沟道隔离结构的制作方法和半导体器件的制作方法,包括:提供一衬底结构,所述衬底结构依次包括半导体衬底、氧化物层和阻挡层,所述半导体衬底包括相邻设置的N型掺杂区和P型掺杂区,且所述氧化物层与所述阻挡层之间的预设区域设置有牺牲层;对所述衬底结构具有所述阻挡层一侧刻蚀沟道,且所述沟道将所述N型掺杂区和P型掺杂区隔离;在所述沟道内填充绝缘材料以形成隔离结构;依次去除所述阻挡层和所述牺牲层。由上述内容可知,本发明提供的技术方案,通过在氧化物层和阻挡层之间的预设区域设置牺牲层,进而在去除阻挡层时通过牺牲层保护氧化物层的预设区域不被影响,改善氧化物层表面出现锐形缺陷的情况,提高产品的良率。 | ||
搜索关键词: | 沟道 隔离 结构 及其 制作方法 半导体器件 | ||
【主权项】:
1.一种浅沟道隔离结构的制作方法,其特征在于,包括:提供一衬底结构,其中,所述衬底结构依次包括半导体衬底、氧化物层和阻挡层,所述半导体衬底包括相邻设置的N型掺杂区和P型掺杂区,且所述氧化物层与所述阻挡层之间的预设区域设置有牺牲层,其中,所述牺牲层的厚度范围为20埃‑60埃,包括端点值;所述阻挡层的厚度范围为350埃‑450埃,包括端点值;对所述衬底结构具有所述阻挡层一侧刻蚀沟道,且所述沟道将所述N型掺杂区和P型掺杂区隔离;在所述沟道内填充绝缘材料以形成隔离结构;依次去除所述阻挡层和所述牺牲层,且在去除所述阻挡层时通过所述牺牲层保护所述预设区域;其中,所述依次去除所述阻挡层和所述牺牲层包括:采用第一刻蚀溶液去除所述阻挡层,且所述第一刻蚀溶液对所述阻挡层的材质的刻蚀速率,大于对所述氧化物层的材质和所述牺牲层的材质的刻蚀速率;采用第二刻蚀溶液去除所述牺牲层,且所述第二刻蚀溶液对所述牺牲层的材质的刻蚀速率,不小于对所述氧化物层的材质的刻蚀速率。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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