[发明专利]一种改善接触孔插塞氧化物凹陷的工艺方法有效
申请号: | 201710733200.1 | 申请日: | 2017-08-24 |
公开(公告)号: | CN107731741B | 公开(公告)日: | 2019-01-29 |
发明(设计)人: | 何佳;刘藩东;张若芳;王鹏;吴林春;夏志良;霍宗亮 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L27/11568;H01L27/11578 |
代理公司: | 北京辰权知识产权代理有限公司 11619 | 代理人: | 董李欣 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 本发明提供了一种改善接触孔插塞氧化物凹陷的工艺方法,通过将预清洗工艺中湿法刻蚀(DHF+SC1)替换为等离子体干法刻蚀,从而能够避免由于ALD氧化物和PECVD氧化物湿法刻蚀速率不同而产生的原子层沉积工艺(ALD)沉积的氧化物层的过快刻蚀而导致的接触孔(Channel Hole)的弯曲状(Bowing Profile)形貌的加剧的情况;同时由于等离子体干法刻蚀的各向异性特点,能够有效控制预清洗工艺主要针对硅槽底部表面,而对于接触孔侧壁的刻蚀较少,从而避免了接触孔(Channel Hole)的弯曲状(Bowing Profile)形貌的加剧,从而提高了3D NAND闪存的整体性能,从而提高了3D NAND闪存的整体性能。 | ||
搜索关键词: | 一种 改善 接触 孔插塞 氧化物 凹陷 工艺 方法 | ||
【主权项】:
1.一种改善接触孔插塞氧化物凹陷的工艺方法,包括以下步骤:形成多层堆叠结构,首先,提供衬底,所述衬底表面形成有多层交错堆叠的层间介质层及牺牲介质层,所述牺牲介质层形成于相邻的层间介质层之间;然后,采用化学机械研磨工艺获得顶层层间介质层光滑平整的表面;为形成顶层选择栅切线(Top Select Gate Cut)进行刻蚀,采用常规的刻蚀工艺形成顶层选择栅切线(Top Select Gate Cut)的沟道;对顶层选择栅切线(Top Select Gate Cut)沟道进行填充,具体为,采用原子层沉积工艺,在所述沟道中沉积填充顶层选择栅切线氧化物材料;沉积插塞氧化物,具体为,采用等离子体增强化学气相沉积法,在顶层选择栅切线氧化物材料的表面沉积插塞氧化物;在插塞氧化物表面形成氮化硅层;为形成接触孔(Channel Hole)进行刻蚀,采用常规的刻蚀工艺形成接触孔(Channel Hole),所述接触孔通至所述衬底并形成一定深度的硅槽;对所述硅槽进行预清洗处理,所述预清洗为等离子体干法刻蚀工艺;在所述硅槽中进行硅的外延生长形成硅外延层(SEG)。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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