[发明专利]半导体存储装置的形成方法在审
申请号: | 201710549871.2 | 申请日: | 2017-07-07 |
公开(公告)号: | CN109216383A | 公开(公告)日: | 2019-01-15 |
发明(设计)人: | 张翊菁;张峰溢;李甫哲;陈界得 | 申请(专利权)人: | 联华电子股份有限公司;福建省晋华集成电路有限公司 |
主分类号: | H01L27/146 | 分类号: | H01L27/146 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 陈小雯 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | 本发明公开一种半导体存储装置的形成方法,其包含以下步骤。首先,提供基底,其具有存储区,并且,在基底的存储区内形成朝向第一方向延伸的多条位线,各位线的两侧包含三层的侧壁结构。接着,在基底的存储区内形成多个第一插塞,第一插塞位于各位线的两侧,并且,形成分别对位并接触第一插塞的多个导电图案。然后,在形成导电图案后,进行一化学反应制作工艺,改质三层的侧壁结构中的第二层。最后,进行一热处理制作工艺,完全移除第二层,以在三层的侧壁结构中形成空隙层。 | ||
搜索关键词: | 侧壁结构 插塞 基底 三层 半导体存储装置 导电图案 存储 热处理制作工艺 化学反应 方向延伸 制作工艺 空隙层 对位 改质 位线 移除 | ||
【主权项】:
1.一种半导体存储装置的形成方法,其特征在于包含:提供一基底,该基底包含周边区与存储区;在该基底的该存储区形成朝向一第一方向延伸的多条位线,各该位线的两侧包含一侧壁结构,且该侧壁结构具有三层结构;在该基底的该存储区形成多个第一插塞,该些第一插塞位于各该位线两侧;形成多个导电图案,该些导电图案分别对位并接触该些第一插塞;在形成该些导电图案后,进行一化学反应制作工艺,改质该侧壁结构的该三层结构中的一第二层间隙壁;以及进行一热处理制作工艺,移除改质后的该第二层间隙壁,以在该侧壁结构中形成一空隙层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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