[发明专利]支持端序不可知SIMD指令的处理器和方法在审
| 申请号： | 201610959252.6 | 申请日： | 2016-11-03 |
| 公开（公告）号： | CN107038020A | 公开（公告）日： | 2017-08-11 |
| 发明（设计）人： | R·J·罗扎里奥;S·兰加纳坦 | 申请（专利权）人： | 想象技术有限公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38;G06F9/30;G06F15/80 |
| 代理公司： | 北京三友知识产权代理有限公司11127 | 代理人： | 李辉,吕俊刚 |
| 地址： | 英国赫*** | 国省代码： | 暂无信息 |
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| 摘要： | 支持端序不可知SIMD指令的处理器和方法。一种处理器，包括寄存器和加载存储单元(LSU)。LSU将数据从存储器加载到寄存器中。当在小端序模式下，来自依次增大的存储器地址的字节从寄存器的第一端(右端)到寄存器的第二端(左端)以对应的依次增大的字节存储器地址的顺序加载。当在大端序模式下，来自依次增大的存储器地址的字节从寄存器的第二端(左端)到寄存器的第一端(右)以对应的依次增大的存储器地址的顺序加载。因此，与以小端序模式还是以大端序模式操作无关，寄存器中的数据在其左侧具有最高有效字节，而在其右侧具有最低有效字节，这简化了SIMD指令的执行，这是因为数据对于这两种端序模式被相同地对齐。 | ||
| 搜索关键词： | 支持 不可知 simd 指令 处理器 方法 | ||
【主权项】：
一种处理器系统，该处理器系统包括：寄存器；以及加载存储单元LSU，该LSU被配置成将数据从存储器加载到所述寄存器中，其中，当在小端序模式下，来自依次增大的存储器地址的字节从所述寄存器的第一端到所述寄存器的第二端以对应的依次增大的字节存储器地址的顺序加载，并且其中，当在大端序模式下，来自依次增大的存储器地址的字节从所述寄存器的所述第二端到所述寄存器的所述第一端以对应的依次增大的存储器地址的顺序加载。
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