[发明专利]具有MUX模式的LUT结构及与其相配套的EDA优化方法有效
| 申请号： | 201310122737.6 | 申请日： | 2013-04-10 |
| 公开（公告）号： | CN103236836A | 公开（公告）日： | 2013-08-07 |
| 发明（设计）人： | 郭旭峰;李明;于芳 | 申请（专利权）人： | 中国科学院微电子研究所 |
| 主分类号： | H03K19/173 | 分类号： | H03K19/173;H03K19/177 |
| 代理公司： | 中科专利商标代理有限责任公司 11021 | 代理人： | 任岩 |
| 地址： | 100083 *** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种具有多路选择器模式的查找表结构结构及与其相配套的EDA优化方法。本发明是在传统LUT结构的基础上经过微小改动，复用传统LUT结构中天然存在的4选1MUX来提高实现MUX的逻辑利用率并减小电路延迟。本发明中与MLUT相配套的EDA优化方法采用MUX优化先于逻辑优化进行的新策略，优化方法基于MUX树进行，分为MUX分组、MUX树同构化、MUX树重构与映射三个步骤。优化方法最大限度的将MUX树映射至MLUT结构，以保证MLUT的使用效率。对比实验证实本发明可以大幅降低逻辑资源占用并提高电路时钟频率，同时兼具运行时间短，内存需求小的优点。 | ||
| 搜索关键词： | 具有 mux 模式 lut 结构 与其 相配 eda 优化 方法 | ||
【主权项】：
一种具有多路选择器模式的查找表结构，其特征在于，该具有多路选择器模式的查找表结构是在传统查找表结构的基础上新增一个模式配置单元(MODE)、由模式配置单元(MODE)控制的第一及第二N型管开关(SW1，SW2)、以及第二及第三信号输入端(D2，D3)，其中：模式配置单元(MODE)连接于第一及第二N型管开关(SW1，SW2)的栅极之间；第一N型管开关(SW1)的漏极连接于传统查找表结构的第二4选1MUX(M2)的输出端，第一N型管开关(SW1)的源极连接于第二信号输入端(D2)及传统查找表结构的第四4选1MUX(M4)的第三输入端(10)；第二N型管开关(SW2)的漏极连接于传统LUT结构的第三4选1MUX(M3)的输出端，第二N型管开关(SW2)的源极连接于第三信号输入端(D3)及传统LUT结构的第四4选1MUX(M4)的第四输入端(11)；该具有多路选择器模式的查找表结构是基于复用传统查找表结构中的第四4选1MUX(M4)的方式来实现的，通过配置该模式配置单元(MODE)的值来决定该具有多路选择器模式的查找表结构的工作模式。
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