[发明专利]基于多体并行缓存结构的数据访问方法有效
申请号: | 201310069865.9 | 申请日: | 2013-03-05 |
公开(公告)号: | CN103116555A | 公开(公告)日: | 2013-05-22 |
发明(设计)人: | 徐金波;董德尊;赖明澈;陆平静;王绍刚;徐炜遐;肖立权;庞征斌;王克非;夏军;童元满;陈虎;张峻;齐星云;王桂彬;常俊胜;张建民;罗章 | 申请(专利权)人: | 中国人民解放军国防科学技术大学 |
主分类号: | G06F12/10 | 分类号: | G06F12/10 |
代理公司: | 湖南兆弘专利事务所 43008 | 代理人: | 赵洪;周长清 |
地址: | 410073 湖南省长沙市砚瓦池正*** | 国省代码: | 湖南;43 |
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摘要: | 一种基于多体并行缓存结构的数据访问方法,步骤为:(1)、将数据存入主存储器M;二维Cache阵列C以二维矩阵形式组织,记Cache体的个数为a×b个;(2)、处理部件P将所需a×b数据块的虚拟地址发送到地址映射表AT,地址映射表AT将虚拟地址转换为a×b数据块中每个数据在二维Cache阵列C的相应体中的物理地址;(3)、将步骤(2)得到的物理地址并行发送到二维Cache阵列C中的a×b个体,将a×b数据块的所有数据从二维Cache阵列C中并行读出,送入处理部件P;(4)、地址映射表更新部件ATU负责对地址映射表AT的表项进行更新。本发明可保证访存地址灵活性和高带宽,提高数据存取效率,降低存储层次间的数据传输次数和传输延迟。 | ||
搜索关键词: | 基于 并行 缓存 结构 数据 访问 方法 | ||
【主权项】:
一种基于多体并行缓存结构的数据访问方法,当处理某个数据W(t,Δ)时,该数据将以每次访存W字节的传输速度从主存储器M读出并写入二维Cache阵列C,其特征在于,步骤为:(1)、将数据存入主存储器M;所述二维Cache阵列C以二维矩阵形式组织,记Cache体的个数为a×b个,二维Cache阵列C位于主存储器M和处理部件P之间,记二维Cache阵列C和主存储器M之间的带宽为W字节,二维Cache阵列C和处理部件P之间的带宽为a×b字节;(2)、处理部件P将所需a×b数据块的虚拟地址发送到地址映射表AT,地址映射表AT将虚拟地址转换为a×b数据块中每个数据在二维Cache阵列C的相应体中的物理地址;(3)、将步骤(2)得到的物理地址并行发送到二维Cache阵列C中的a×b个体,从而将a×b数据块的所有数据从二维Cache阵列C中并行读出,送入处理部件P;(4)、在将数据由主存储器M向二维Cache阵列C传送时,地址映射表更新部件ATU对地址映射表AT的表项进行更新。
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- 本发明公开了一种缓存数据访问方法及数据缓存系统。其中,方法包括:接收用户的访问请求,访问请求中携带有键信息;根据键信息,查找哈希表得到对应的第一内存块;当访问请求为写数据请求,将第一内存块转移至全局LRU以及对应用户的用户LRU中与写后数据大小级别相同的第一链表头部,其中,用户LRU中预置有所有用户所属的内存块链表;如果用户占用内存达到内存限额,当第一链表不为空时,则取处于第一链表尾部的内存块保存写后数据;否则,当第一链表为空时,获取全局LRU中与写后数据大小级别相同的第二链表,取处于第二链表尾部的内存块保存写后数据;将保存写后数据的内存块转移至第一和第二链表的头部。
- IOMMU架构的TLB支持-201180009059.1
- 安德鲁·克格尔;马克·赫梅尔;埃里克·博林 - 超威半导体公司
- 2011-02-16 - 2013-04-03 - G06F12/10
- 本实施例容许具有独立于页表结构和格式的改进转换性能的输入/输出内存管理单元(IOMMU)的较小的、较简单的硬件实现。实施例还提供了实现的设备无关的结构和方法,使得软件的通用性更强(较少的特定软件版本,进而降低了开发成本)。
- 专利分类
- 数据显示系统、数据中继设备、数据中继方法、数据系统、接收设备和数据读取方法
- 数据记录方法、数据记录装置、数据记录媒体、数据重播方法和数据重播装置
- 数据发送方法、数据发送系统、数据发送装置以及数据结构
- 数据显示系统、数据中继设备、数据中继方法及数据系统
- 数据嵌入装置、数据嵌入方法、数据提取装置及数据提取方法
- 数据管理装置、数据编辑装置、数据阅览装置、数据管理方法、数据编辑方法以及数据阅览方法
- 数据发送和数据接收设备、数据发送和数据接收方法
- 数据发送装置、数据接收装置、数据收发系统、数据发送方法、数据接收方法和数据收发方法
- 数据发送方法、数据再现方法、数据发送装置及数据再现装置
- 数据发送方法、数据再现方法、数据发送装置及数据再现装置