[发明专利]用单个处理支持高性能逻辑和模拟电路的处理/设计方法有效

专利信息
申请号: 200980138653.3 申请日: 2009-09-17
公开(公告)号: CN102318062A 公开(公告)日: 2012-01-11
发明(设计)人: Q·向;A·拉特纳古玛尔;J·X·唐;W·丁 申请(专利权)人: 阿尔特拉公司
主分类号: H01L27/088 分类号: H01L27/088;H01L21/265
代理公司: 北京纪凯知识产权代理有限公司 11245 代理人: 赵蓉民
地址: 美国加利*** 国省代码: 美国;US
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摘要: 发明提供使用正向偏置和修改的混合信号处理的电路设计改善模拟电路的性能的方法。由多个晶体管组成的电路被定义。NMOS晶体管的主体端子被耦合到第一电压源,并且PMOS晶体管的主体端子被耦合到第二电压源。通过施加第一电压源到所选择的每个NMOS晶体管的主体端子和施加第二电压源到所选择的每个PMOS晶体管的主体端子选择性地偏置PMOS晶体管,电路中的晶体管被选择性地偏置。在一个实施方式中,第一电压源和第二电压源可修改以向晶体管的主体端子提供正向和反向偏置。
搜索关键词: 单个 处理 支持 性能 逻辑 模拟 电路 设计 方法
【主权项】:
一种增加模拟电路的栅极过驱动余量的方法,包括:从多个晶体管定义电路,所述多个晶体管由NMOS晶体管的集合和PMOS晶体管的集合组成;将所述NMOS晶体管的集合耦合到第一电压源;将所述PMOS晶体管的集合耦合到第二电压源;以及通过施加所述第一电压源到所选择的每个所述NMOS晶体管的主体端子选择性地偏置所述NMOS晶体管的集合并且通过施加所述第二电压源到所选择的每个所述PMOS晶体管的主体端子选择性地偏置所述PMOS晶体管的集合。
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