[发明专利]相位检测器、相位比较器、以及时钟同步设备无效
| 申请号： | 200910004638.1 | 申请日： | 2009-03-02 |
| 公开（公告）号： | CN101521499A | 公开（公告）日： | 2009-09-02 |
| 发明（设计）人： | 水桥比吕志;千田满;小出元 | 申请（专利权）人： | 索尼株式会社 |
| 主分类号： | H03K3/356 | 分类号： | H03K3/356;H03L7/085 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 黄小临 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本申请公开了一种相位检测器、一种相位比较器、以及一种时钟同步设备。一种触发器电路包括：第一锁存器电路，其接收数据信号和上升延迟时钟信号的输入，根据上升延迟时钟信号的下降而升高第一节点的信号，并且根据上升延迟时钟信号的上升而降低第一节点的信号；第二锁存器电路，其接收第一节点的信号和时钟信号的输入，并且在时钟信号下降的定时降低第二节点的信号；第三锁存器电路，其接收第二节点的信号和时钟信号的输入，并且生成用于维持数据信号的输出信号；以及下拉电路，其利用上升延迟时钟信号下拉第一节点的信号。 | ||
| 搜索关键词： | 相位 检测器 比较 以及 时钟 同步 设备 | ||
【主权项】：
1. 一种触发器电路，包括：第一锁存器电路，其接收数据信号和通过仅延迟时钟信号的上升而获得的上升延迟时钟信号的输入，在数据信号下降的状态下根据上升延迟时钟信号的下降而升高第一节点的信号，并且根据上升延迟时钟信号的上升而降低第一节点的信号；第二锁存器电路，其接收第一节点的信号和时钟信号的输入，并且在第一节点的信号上升的状态下在时钟信号下降的定时降低第二节点的信号；第三锁存器电路，其接收第二节点的信号和时钟信号的输入，并且在时钟信号上升的状态下生成用于维持数据信号的输出信号；以及下拉电路，其利用上升延迟时钟信号下拉第一节点的信号。
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