[发明专利]一种含有光敏三极管器件的CMOS电路制造方法有效

专利信息
申请号: 200710173867.7 申请日: 2007-12-29
公开(公告)号: CN101471294A 公开(公告)日: 2009-07-01
发明(设计)人: 陈康民 申请(专利权)人: 上海贝岭股份有限公司
主分类号: H01L21/822 分类号: H01L21/822;H01L21/265;H01L31/18;H01L27/144
代理公司: 北京金信立方知识产权代理有限公司 代理人: 黄 威;徐金伟
地址: 20023*** 国省代码: 上海;31
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摘要: 一种含有光敏三极管器件的CMOS电路制造方法,其特征在于,在常规的CMOS电路制造基础上,采用硼双电荷注入技术形成所述光敏三极管的基区,并且使所述光敏三极管的发射极和集电极(16’)与CMOS工艺的N+源漏区(16)兼容,使所述光敏三极管的基区接头(17’)与CMOS工艺的P+源漏区(17)兼容,且所述光敏三极管的集电区制作在CMOS的N阱上;所述硼双电荷注入,是向硅片内注入带有两个电荷的硼原子量为5.5的离子,即5.5B+。利用本发明可以实现光敏三极管与一般CMOS集成电路的一体化,既缩小了面积又提高了可靠性。本发明可以应用于含有光敏三极管器件的CMOS工艺制造中。
搜索关键词: 一种 含有 光敏 三极管 器件 cmos 电路 制造 方法
【主权项】:
1、一种含有光敏三极管器件的CMOS电路制造方法,其特征在于,在常规的CMOS电路制造基础上,采用硼双电荷注入技术形成所述光敏三极管的基区,并且使所述光敏三极管的发射极和集电极(16’)与CMOS工艺的N+源漏区(16)兼容,使所述光敏三极管的基区接头(17’)与CMOS工艺的P+源漏区(17)兼容,且所述光敏三极管的集电区制作在CMOS的N阱上;所述硼双电荷注入,是向硅片内注入带有两个电荷的硼原子量为5.5的离子,即5.5B+。
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