[发明专利]采用选择再生长的AlGaN/GaN-HEMT的制造方法无效
申请号: | 200710163361.8 | 申请日: | 2007-10-19 |
公开(公告)号: | CN101183647A | 公开(公告)日: | 2008-05-21 |
发明(设计)人: | 见田充郎;户田典彦;丸井俊治 | 申请(专利权)人: | 冲电气工业株式会社 |
主分类号: | H01L21/335 | 分类号: | H01L21/335 |
代理公司: | 北京集佳知识产权代理有限公司 | 代理人: | 雒运朴;李伟 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | 本发明提供一种采用选择再生长的AlGaN/GaN-HEMT的制造方法。在该制造方法中,首先,准备具有叠层构造的半导体主体(110),该叠层构造是在衬底(100)上层叠缓冲层(102)、在缓冲层上层叠UID-GaN层、在该UID-GaN层上层叠UID-AlGaN层而形成的。然后,在该半导体主体的作为UID-AlGaN层的表面的第1主面(111)上,形成绝缘膜(112)的图案,以形成了图案的绝缘膜(112′)为掩模,不对半导体主体表面进行蚀刻处理,而在绝缘膜的区域以外的半导体主体表面的区域上,直接选择再生长n+-GaN层。之后,在进行了选择再生长后的该n+-GaN层的区域,划分欧姆电极形成预定区域(117),并形成欧姆电极(122)。接下来,在绝缘膜的区域内,划分栅电极形成预定区域(123)并形成开口,并且形成栅电极(124)。 | ||
搜索关键词: | 采用 选择 再生 algan gan hemt 制造 方法 | ||
【主权项】:
1.一种AlGaN/GaN-HEMT的制造方法,其特征在于,包括以下工序:第1工序,准备具有叠层构造的半导体主体,该叠层构造是在衬底上层叠缓冲层、在该缓冲层上层叠UID-GaN层、在该UID-GaN层上层叠UID-AlGaN层而形成的;第2工序,在上述半导体主体的作为UID-AlGaN层的表面的第1主面上,形成绝缘膜的图案;第3工序,将上述绝缘膜用作掩模,不对上述半导体主体表面进行蚀刻处理,而在上述绝缘膜的区域以外的上述半导体主体表面的区域上,直接选择再生长n+-GaN层;第4工序,在进行选择再生长而形成的上述n+-GaN层的区域,设定欧姆电极形成预定区域,并在该欧姆电极形成预定区域上形成欧姆电极;以及第5工序,在上述绝缘膜的区域内,使栅电极形成预定区域形成开口,并在从该开口露出的该栅电极形成预定区域上形成栅电极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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