[发明专利]半导体集成电路无效
| 申请号： | 200610141812.3 | 申请日： | 2006-09-29 |
| 公开（公告）号： | CN1941631A | 公开（公告）日： | 2007-04-04 |
| 发明（设计）人： | 增尾昭;角谷范彦 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | H03K19/096 | 分类号： | H03K19/096;G11C11/413 |
| 代理公司： | 北京市金杜律师事务所 | 代理人： | 季向冈 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种半导体集成电路，在低电压动作时，既能使动态电路高速化又能防止误动作。该半导体集成电路包括：第1导电型的第1晶体管，连接在第1电源和输出节点之间，依照第1时钟脉冲而导通，使上述输出节点为第1逻辑电平；第2导电型的第2晶体管，依照输入信号而导通；第2导电型的第3晶体管，与上述第2晶体管串联连接，依照第2时钟脉冲而导通；第1导电型的第4晶体管，连接在上述第1电源和上述输出节点之间，依照反馈信号而导通。上述第2晶体管和上述第3晶体管，连接在上述输出节点和第2电源之间。上述第4晶体管，在上述第2晶体管和上述第3晶体管都导通之后，从导通状态变为非导通状态。 | ||
| 搜索关键词： | 半导体 集成电路 | ||
【主权项】：
1.一种半导体集成电路，包括：第1导电型的第1晶体管，连接在第1电源和输出节点之间，依照第1时钟脉冲而导通，使上述输出节点为第1逻辑电平；第2导电型的第2晶体管，依照输入信号而导通；第2导电型的第3晶体管，与上述第2晶体管串联连接，依照第2时钟脉冲而导通；第1导电型的第4晶体管，连接在上述第1电源和上述输出节点之间，依照反馈信号而导通；反相器，输出将上述输出节点的逻辑电平反转后的信号；以及第1导电型的第5晶体管，连接在上述第1电源和上述输出节点之间，依照上述反相器的输出而导通，上述第2晶体管和上述第3晶体管，连接在上述输出节点和第2电源之间，上述第4晶体管，在上述第2晶体管和上述第3晶体管都导通之后，从导通状态变为非导通状态。
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