[发明专利]半导体集成电路装置无效
| 申请号： | 200610103059.9 | 申请日： | 2006-07-11 |
| 公开（公告）号： | CN1896905A | 公开（公告）日： | 2007-01-17 |
| 发明（设计）人： | 西川亮太 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | G06F1/10 | 分类号： | G06F1/10;H01L27/02 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 陶凤波;侯宇 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供了一种半导体集成电路装置，包括多个栅格状引线结构(150)，设置为整个电路区的单元区，并具有分别与时钟引线结构相同的形状；第一引线结构，其中从单个时钟输入(110)到各个栅格状引线结构(150)的引线路径以基本相同的长度连接，且公共缓冲电路(120)或相同类型及相同级数的缓冲电路和时钟选通电路(140)以相同顺序插入在各个引线路径中；和第二引线结构，以在每个单元区域中最短的长度将时钟同步电路连接到栅格状引线结构。该时钟由独立提供到时钟选通电路的时钟控制信号门控。 | ||
| 搜索关键词： | 半导体 集成电路 装置 | ||
【主权项】：
1、一种半导体集成电路装置，包括：多个栅格状引线结构，设置为整个电路区中的单元区，并具有分别与时钟引线结构相同的形状；第一引线结构，其中从单个时钟输入到各个栅格状引线结构的引线路径以基本相同的长度连接，且公共电路或具有相同类型及相同级数的电路以相同顺序插入在各个引线路径中；和第二引线结构，以在每个单元区域中最短的长度将时钟同步电路例如触发器连接到所述栅格状引线结构，其中插入所述第一引线结构的电路包括至少一级缓冲电路和至少一级时钟选通电路，该时钟选通电路的时钟由时钟控制信号进行门控。
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