[其他]指令处理器在审
| 申请号： | 101985000002313 | 申请日： | 1985-04-01 |
| 公开（公告）号： | CN85102313B | 公开（公告）日： | 1988-05-04 |
| 发明（设计）人： | 栗山和则;和田健一;小岡彰 | 申请（专利权）人： | 株式会社日立制作所 |
| 主分类号： | 分类号： | ||
| 代理公司： | 中国专利代理有限公司 | 代理人： | 李先春 |
| 地址： | 日本东京都千*** | 国省代码： | 暂无信息 |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | 给要求两个或者更多操数的指令的每个操作数，分别提供地址计算加法器和缓冲存贮器。在翻译指令的处理中，地址计算和对第一个、第二个操作数的取操作，实质上是异步送行的。因而每几个第二个操作数的每次取操作数所化的额外化费可以采用一组地址加法器独立或同步完成地址计算和取数操作的方法来扣掉，而且，采用一个操作步骤能够省掉用来从操作数缓冲四分离并得到一个字节的线路，在该操作步骤中，第一个操作数的一个字节取出并存入暂存存贮器中，这存贮器提供其中存贮的数据给地址加法器。 | ||
| 搜索关键词： | 指令 处理器 | ||
【主权项】：
暂无信息
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