[其他]指令处理器在审
| 申请号: | 101985000002313 | 申请日: | 1985-04-01 |
| 公开(公告)号: | CN85102313B | 公开(公告)日: | 1988-05-04 |
| 发明(设计)人: | 栗山和则;和田健一;小岡彰 | 申请(专利权)人: | 株式会社日立制作所 |
| 主分类号: | 分类号: | ||
| 代理公司: | 中国专利代理有限公司 | 代理人: | 李先春 |
| 地址: | 日本东京都千*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 指令 处理器 | ||
1、一种流水线指令处理器,其特征在于它包括:
各自作为保持操作数数据项用的第一和第二缓冲存储器;
连到所说第一缓冲存储器的第一地址装置,在响应所加的第一或第二类指令时,顺序地产生和提供应第一或第二类指令请求的第一数据项的地址,以便从所说第一存储器顺序地读出第一操作数数据项;
可与所说第一地址装置同时操作并连到所说第一和第二缓冲存储器的第二地址装置,在响应要加到所说第一地址装置的第一类指令时,为所说第二缓冲存储器顺序地产生和提供应第一类指令请求的第二操作数数据项地址,而每次都同步产生相应于第一操作数数据项的地址,使得第二操作数数据项顺序地从所说第二缓冲存储器读出,而每次都与从所说第一缓冲存储器读出一个相应的第一操作数数据项同步,在响应要被加到第一地址装置的第二类指令时,从所说第一缓冲存储器读出第一操作数数据项中的每一项,为所说第二存储器顺序地产生和提供应第二类指令请求的第二操作数数据项的地址,每次都与相应读出第一操作数数据项有关,使得第二操作数数据项顺序地从所所说第二缓冲存储器读出,具每次在响应时,都从所说第一缓冲存储器读出一个相应的第一操作数数据项;
连到第一和第二缓冲存储器的操作装置,在响应要加到所说第一地址装置的第一类指令时,顺序地进行应第一类指令请求、从所说第一缓冲存储器读出的一对第一操作数数据项以及从所说第二缓冲存储器同步读出的一个相应的第二操作数数据项的操作,使得相应于操作结果的第三操作数数据项顺序地提供给所说第一缓冲存储器,在响应加到所说第一地址装置的第二类指令时,顺序地将从所说第二缓冲存储器读出的第二操作数数据项传送到所说第一缓冲存储器;以及
连到所说第一地址装置和所说第一缓冲存储器的传送装置,在响应要加到所说第一地址装置的第一类指令时,顺序地将应第一类指令请求所产生的第一操作数数据项地址作为其写入地址传送到所说第一缓冲存储器,每次都和到所说第一缓冲存储器的各个第三操作数数据项的传送同步,而在响应要加到所说第一地址装置的第二类指令时,顺序地将应第二类指令请求所产生的第二操作数数据项地址作为其写入地址传送到所说第一缓冲存储器,每次都和到所说第一缓冲存储器的第二操作数数据项其中一项的传送同步。
2、根据权利要求1的一种流水线指令处理器,
其特征在于所说第一地址装置包括:
各由一个指令指定的多个寄存器;
顺序地产生地址数据项的第一增量器;以及
连到所说多个寄存器和所说第一增量器的第一加法器,通过将所说第一增量器所产生的各个地址数据项加到从该指令指定的其中一个寄存器读出的一个数据项,产生应所加第一类或第二类指令请求的第一操作数数据项的地址;而且
其特征还在于所说第二地址装置包括:
顺序地产生地址数据项的第二增量器;
连到所说第一缓冲存储器和所说增量器的选择器,当加到所说第一地址装置的指令是第一类或第二类指令时,分别将所说第二增量器产生的地址数据项或者读出的第一操作数数据项传送到所说第二加法器。
3、一种流水线指令处理器,其特征在于它包括:
各自能保持操作数数据项的第一和第二缓冲存储器;
连到所说第一缓冲存储装置的第一地置装置,在响应一个所加指令时,顺序地产生应指令请求的第一操作数数据项的地址;
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