[发明专利]半导体集成电路无效

专利信息
申请号: 01132925.4 申请日: 2001-09-11
公开(公告)号: CN1347197A 公开(公告)日: 2002-05-01
发明(设计)人: 古泽敏行;薗田大资;宇佐美公良;河邉直之;小泉正幸;座间英匡;金泽正博 申请(专利权)人: 株式会社东芝
主分类号: H03K19/20 分类号: H03K19/20;H04B1/38
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 王永刚
地址: 日本*** 国省代码: 暂无信息
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摘要: 低泄漏组合电路11、12由用低阈值电压的晶体管构成的逻辑电路和在该逻辑电路中根据控制信号导通、截止的晶体管构成。根据控制信号EN1、EN2只在被连接在低泄漏组合电路11、12的输出端上的触发电路13、14取入数据时,根据控制信号EN1、EN2把低泄漏组合电路11、12激活。因而,因为低泄漏组合电路11、12只在输出数据时被提供电源,在其它时间不被提供电源,所以可以削减泄漏电流。
搜索关键词: 半导体 集成电路
【主权项】:
1.一种半导体集成电路,其特征在于具有:可以根据控制信号切换提供电源的动作状态和切断电源的泄漏减低状态的组合电路;被连接在上述组合电路的输出端,根据上述控制信号存储上述组合电路的输出信号的触发电路,上述组合电路,在上述触发电路根据上述控制信号动作时,根据上述控制信号设定在动作状态。
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