专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]使用网络设备的内容注入-CN202211013184.6在审
  • A·巴赫穆特斯凯;F·吉贝尔纳特;K·库马尔 - 英特尔公司
  • 2022-08-23 - 2023-03-28 - H04L49/111
  • 一种网络设备包括服务质量电路系统以监测网络设备的操作环境;以及注入电路系统,以:识别流中的内容插入时隙;从规则数据库获得规则;与分析电路系统接合以基于流的上下文确定规则的输入;与规则执行电路系统接合以用规则的输入执行规则,其中执行规则导致确定将内容插入流中;以及响应于确定将内容插入流中:与服务质量电路系统接合以确定要插入流中的可插入内容;以及通过网络设备的出口端口,将内容插入时隙中的可插入内容发送到使用流的设备,同时在网络设备的存储器装置中缓冲流。
  • 使用网络设备内容注入
  • [实用新型]集成电路-CN202221572210.4有效
  • K·库马尔;M·库马尔 - 意法半导体国际有限公司
  • 2022-06-22 - 2023-01-13 - H03K3/3565
  • 本公开的实施例涉及一种集成电路。一种集成电路包括输入焊盘和施密特触发器。施密特触发器包括:耦接到输入焊盘的输入;第一主晶体管支路,耦接在高电源电压与中间节点之间;充电辅助电路,包括耦接在高电源电压与中间节点之间的第一导电类型的并联晶体管支路;以及第二主晶体管支路,耦接在中间节点与地之间。
  • 集成电路
  • [发明专利]存储器池数据放置技术-CN202111419770.6在审
  • F·甘博纳特;K·库马尔 - 英特尔公司
  • 2021-11-26 - 2022-07-01 - G06F9/48
  • 本文描述的示例涉及一种网络接口设备,当在操作时,该网络接口设备被配置为:选择可寻址存储器地址的区域的数据以从第一存储器池迁移到第二存储器池,以降低可寻址存储器地址的区域的数据到计算平台的传输时间。在一些示例中,至少部分地基于以下各项中的一个或多个来选择可寻址存储器地址的区域的数据以从第一存储器池迁移到第二存储器池:(a)用于访问数据的存储器带宽;(b)由计算平台从第一存储器池访问数据的时延;(c)由计算平台在时间窗内访问数据的次数;(d)在时间窗内由其他计算平台在时间窗内访问数据的次数;(e)去往和/或来自计算平台能够访问的一个或多个存储器池的历史拥塞;和/或(f)访问数据的不同计算平台的数量。
  • 存储器数据放置技术
  • [发明专利]对池化存储器的软件定义的一致性高速缓存-CN202111175653.X在审
  • F·甘博纳特;K·库马尔;A·巴赫姆斯基;卢中延;T·维尔哈姆 - 英特尔公司
  • 2021-10-09 - 2022-05-10 - G06F12/0871
  • 用于池化存储器的软件定义的一致高速缓存的方法和装置。池化存储器在具有解聚架构的环境中实现,其中计算资源(例如计算平台)经由网络或结构连接到解聚存储器。软件定义的高速缓存策略在处理器SoC或分立设备(例如网络接口控制器(NIC))中的硬件中通过SoC或分立设备上的FPGA或加速器中的编程逻辑实现。编程逻辑被配置为在硬件中实现软件定义的高速缓存策略,以在为解聚存储器中的软件应用分配的地址空间的至少一部分的相关联的DM高速缓存中实现解聚存储器(DM)高速缓存。与DM高速缓存操作相关,例如从CPU逐出高速缓存行,在硬件中实现的逻辑确定是否要逐出DM高速缓存中的高速缓存行,并实现针对DM高速缓存的软件定义的高速缓存策略,包括相关联的存储器一致性操作。
  • 存储器软件定义一致性高速缓存

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