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[发明专利]一种以太网链路级可靠传输的装置和方法-CN202310503227.7在审
发明人：陈艇;吕平;沈剑良;张文建;刘冬培;张霞;李沛杰;董春雷;李智超;张丽 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2023-05-06 - 公布日： 2023-08-11 - 主分类号： H04L1/00 文献下载
摘要：本发明提供一种以太网链路级可靠传输的装置和方法。该装置在以太网控制器中设置有链路层可靠传输控制模块，包括Frame ID封装单元，用于从报文缓存中接收数据帧，在该数据帧中增加Frame ID字段；发送选择单元，用于根据控制选择发送封装后的数据帧、缓存中的数据帧或者LRTF至MAC数据通路；重传缓存单元，用于缓存封装后的数据帧；接收选择单元，用于从MAC数据通路中接收以太网帧进行解析：若为数据帧，则发送至Frame ID检查和删除单元；若为LRTF，则发送至LRTF处理与生成单元；LRTF处理与生成单元，用于解析接收的LRTF并根据控制生成相应的LRTF；Frame ID检查和删除单元，用于从接收的数据帧中提取出Frame ID，并在删除该数据帧中Frame ID字段后，将该数据帧发送至报文缓存。
一种以太网链路级可靠传输装置方法

[发明专利]避免交换芯片组播包队头阻塞的方法及系统-CN202210496095.5有效
发明人：董春雷;陈艇;张霞;刘勤让;张丽;沈剑良;宋克;李沛杰;汤先拓;张文建 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2022-04-24 - 公布日： 2023-07-11 - 主分类号： H04L49/90 文献下载
摘要：本发明公开一种避免交换芯片组播包队头阻塞的方法及系统，该方法包括：在交换芯片输入端口内部依据接收到的数据包的路由目的端口建立N+2个VOQ并共享Tag节点缓存，其中，包括N个单播队列和2个组播队列(组播队列1、组播队列2)；将新接收的组播包加入组播队列1，在组播队列1头部组播包的一个或多个目的端口发生堵塞之前，组播队列2始终为空，当组播队列1头部组播包的一个或多个目的端口发生堵塞时，将该发生堵塞的组播包从组播队列1中移出并放入组播队列2；调度处理逻辑按照调度算法从N+2个VOQ中选择满足调度条件且优先级最高的队列进行调度。本发明有效解决了组播包的队头阻塞问题，同时不影响队列节点缓存的共享使用。
避免交换芯片组播包队头阻塞方法系统

[发明专利]一种基于高阶密码算子在异构平台编译优化方法及系统-CN202310252188.8在审
发明人：裴雪;魏帅;宋克;沈剑良;吕平;于洪;陈艇;李沛杰;张文建;刘文斌 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2023-03-15 - 公布日： 2023-06-23 - 主分类号： G06F8/41 文献下载
摘要：本发明公开一种基于高阶密码算子在异构平台编译优化方法及系统，该方法包括：步骤1：根据领域专用语言，通过对加解密算法的分析，设计实现描述张量运算的领域专用语言，进行算子的提取和分析；步骤2：通过数据的张量化和并行化，重新组织计算高效利用内存层次结构和并行执行硬件；步骤3：通过端到端的编译框架进行高阶算子实现，并将高阶算子映射到异构硬件；步骤4：对映射到硬件的高阶算子进行编译优化，得到编译优化后的高阶算子；步骤5：根据编译优化后的高阶算子，编译得到硬件可执行代码。本发明解决了复杂算子的领域专用语言抽象，内存优化，编译映射，高效地构建高性能加解密领域算法及硬件部署。
一种基于密码算子平台编译优化方法系统

[实用新型]一种警示灯组-CN202222715492.5有效
发明人：陈艇;严黎明 -专利权人：陈艇
申请日： 2022-10-16 - 公布日： 2023-06-06 - 主分类号： F21S8/00 文献下载
摘要：本实用新型公开了一种警示灯组，包括收纳箱和灯框，所述灯框的内部固定安装有四根安装杆，所述灯框的底部通过四根所述安装杆固定安装有灯座，所述灯座的底部固定安装有灯泡，所述灯框底部的四侧均固定安装有一组第二轴座，每组所述轴座的个数均为两个，两个所述轴座之间固定安装有第二安装轴，四根所述第二安装轴上均活动套接安装有转筒，四根所述转筒的一侧均固定安装有调光板，所述收纳箱内部的两侧均开设有安装槽，其中一个所述安装槽的内部活动安装有第二螺纹转轴，另一个所述安装槽的内部固定安装有限位杆。本实用新型通过设置一系列的结构使得本装置具有便于对灯光亮度进行调节和对灯具组件进行保护的特点。
一种警示

[发明专利]SoC芯片时钟功能验证方法及系统-CN202110344051.6有效
发明人：刘冬培;刘勤让;宋克;沈剑良;吕平;李沛杰;陈艇;张文建;张霞;董春雷 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2021-03-31 - 公布日： 2023-04-25 - 主分类号： G06F30/331 文献下载
摘要：本发明涉及芯片时钟检测技术领域，特别涉及一种SoC芯片时钟功能验证方法及系统，从SoC芯片外部管脚中选取用于引出芯片内部待测时钟的测试管脚；利用时钟仿真验证平台并根据芯片内时钟网络分布级数，对内部各时钟频率进行遍历，依次选择待测时钟，并通过测试管脚输出对待测时钟频率进行验证确认。本发明将内部待测时钟频率经过一定系数的分频之后引出至外部管脚，在仿真验证平台中，根据芯片内部时钟网络分布的级数，通过对不同层级的寄存器配置操作，可完成对全芯片所有时钟的时钟频率进行遍历和自动比较，不会遗漏每一个时钟，具有实现简单、自动化验证效率高等特点，适合于时钟网络复杂、时钟频点较多的SoC芯片或大规模ASIC芯片，具有较好应用前景。
soc 芯片时钟功能验证方法系统

[发明专利]软件定义交换结构及基于该结构的数据交换方法-CN202110344052.0有效
发明人：董春雷;刘勤让;沈剑良;吕平;陈艇;李沛杰;刘冬培;张丽;张文建;虎艳宾 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2021-03-31 - 公布日： 2023-04-25 - 主分类号： G06F9/54 文献下载
摘要：本发明属于交换芯片技术领域，特别涉及一种软件定义交换结构及基于该结构的数据交换方法，用于适配信息系统中不同应用需求，该结构包含：通过共享缓存结构组成的第一级交换，与通过CrossBar矩阵组成的第二级交换，其中，第一级交换中的共享缓存结构设置有m*n个端口，该m*n个端口均分为n个端口组，每个端口组内共享输入缓存和输出缓存，端口组之间通过第二级交换中的CrossBar矩阵连接。本发明综合考虑共享缓存交换和CrossBar矩阵交换两种交换结构的优缺点，将二者优点结合起来，基于软件定义互连技术实现高吞吐低时延交换结构的可编程特性以及协议无关性，满足交换芯片在多种不同场景下的实际应用，具有较好的应用前景。
软件定义交换结构基于数据方法

[发明专利]一种基于ELS帧的时间同步装置与方法-CN202110865503.5有效
发明人：陈艇;刘勤让;刘东辉;吕平;沈剑良;李沛杰;刘冬培;汤先拓;刘宗海;张文建 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2021-07-29 - 公布日： 2023-04-25 - 主分类号： G06F1/12 文献下载
摘要：本发明公开一种基于ELS帧的时间同步装置与方法，该方法包括：定时器模块，CPU模块，处理器内部存储模块，DMA模块及FC端口模块；定时器模块根据用户设置的最大计数周期性的触发DMA模块向FC端口模块搬移CSU帧帧；CPU模块根据用户发送的CSR帧进行CSU帧的组装；处理器内部存储模块存储CPU模块组装后的CSU帧；DMA模块将处理器内部存储模块中的CSU帧搬移到FC端口模块上；FC端口模块在发送方向使用本地实时RTC值替换CSU帧内部的时间信息；或在接收方向解析CSU帧的时间信息并更新本地RTC值。本发明利用DMA模块将处理器内部存储模块中的CSU帧搬移到FC端口模块的发送缓冲中，无需CPU模块进行调度，工作效率高。
一种基于 els 时间同步装置方法

[发明专利]自动感知攻击行为方法、系统及以太网交换机-CN202010335962.8有效
发明人：赵博;宋克;刘勤让;沈剑良;张霞;陈艇;李沛杰;刘冬培;张文建;张丽 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2020-04-25 - 公布日： 2023-03-28 - 主分类号： G05B9/03 文献下载
摘要：本发明属于网络安全技术领域，特别涉及一种自动感知攻击行为方法、系统及以太网交换机，将交换机服务请求分发至响应模块，所述响应模块包含用于数据交互处理的主控制器和用于交互数据处理的辅助控制器，所述主控制器和辅助控制器两者采用软和/或硬件存在差异且功能等价的控制器结构；响应模块中两个控制器依据服务请求分别生成响应数据；对响应数据进行比对来判定交换机异常并通知管理员。本发明依据该两个控制器的响应结果自动感知识别交换机异常，方案简单，便于部署实施，通过对响应数据比对可以成功多种攻击方式并上报管理员，实现自动感知交换机控制器异常，且能够保证交换机的工作状态始终受控，进一步确保网络空间的安全性和稳定可靠性。
自动感知攻击行为方法系统以太网交换机

[发明专利]拟态判决方法、装置、电子设备及计算机可读存储介质-CN202010742143.5有效
发明人：贾广瑞;刘勤让;沈剑良;徐庆阳;吕平;朱珂;王盼;汪欣;陈艇;李沛杰;董春雷;汤先拓;李丹丹;姜海滨;李庆龙 -专利权人：天津芯海创科技有限公司;天津市滨海新区信息技术创新中心
申请日： 2020-07-29 - 公布日： 2023-03-24 - 主分类号： H04L9/40 文献下载
摘要：本公开提供了拟态判决方法、装置、电子设备及计算机可读存储介质。该方法的一具体实施方式包括：获取每个异构执行体输出的第一数据；基于预设的机器学习模型，确定每个第一数据对应的异常概率值，其中，异常概率值表示第一数据为异常的可能性大小；确定各异常概率值中的最小异常概率值；将最小异常概率值对应的第一数据确定为拟态防御系统的输出结果。该实施方式能够在较少的数据缓存下高效的完成拟态判决，减少了拟态判决所用时间和系统缓存容量，有效提升了处理效率和系统性能。
拟态判决方法装置电子设备计算机可读存储介质

[发明专利]一种优化格雷码编码方式实现跨时钟域的装置-CN201910784082.6有效
发明人：陶常勇;沈剑良;刘勤让;吕平;陈艇;汪欣;刘长江;林德伟;李沛杰;刘冬培;徐庆阳;王盼;王晓雪;王元磊;杨堃 -专利权人：天津芯海创科技有限公司;天津市滨海新区信息技术创新中心
申请日： 2019-08-23 - 公布日： 2023-03-10 - 主分类号： G06F1/04 文献下载
摘要：本发明提供了一种优化格雷码编码方式实现跨时钟域的装置，通过在原有格雷码转换电路基础上，通过增加2bit指示信号，实现了非2的n次幂地址编码转换逻辑时，在最大值与0地址之间的过渡期间，只根据新增的2bit指示信号进行判断，在其他情况下，仍然采用标准的格雷码转换逻辑。本发明从跨时钟处理的效果上看，编码后仍然可以保证有效的地址指示信号只发生一bit变化，原理上保证了时钟跨接处理的正确性，并与标准的格雷码转换效果相当。
一种优化格雷码编码方式实现时钟装置

[发明专利]一种自适应串行时钟序列检测装置及方法-CN201910150540.0有效
发明人：汪欣;刘勤让;沈剑良;杨堃;吕平;宋克;李沛杰;朱珂;陈艇;张丽;丁旭;赵博;张文建;汤先拓;徐庆阳 -专利权人：天津芯海创科技有限公司;天津市滨海新区信息技术创新中心
申请日： 2019-02-28 - 公布日： 2023-03-07 - 主分类号： G06F13/40 文献下载
摘要：本发明提供了一种自适应串行时钟序列检测装置及检测方法，装置包括时钟序列，时钟序列连接COM字符检测模块，COM字符检测模块连接PCIe时钟序列检测单元，PCIe时钟序列检测单元连接RapidIO时钟序列检测单元，RapidIO时钟序列检测单元输出检测结果。本发明能够实现串行检测RapidIO和PCIe两种协议时钟补偿序列，根据不同的时钟补偿序列自行选择检测模块串且同时关闭非当前协议检测模块，阻断非当前协议检测模块输入，避免数据流中出现另一协议时钟补偿序列的小概率事件造成的影响；本发明在检测出时钟补偿序列的同时，给出对应协议的指示，方便与之接口的模块向自适应硬件方向修改。
一种自适应串行时钟序列检测装置方法

[发明专利]一种实现任意深度低传输延时的异步FIFO的方法及装置-CN201910563113.5有效
发明人：陶常勇;刘勤让;沈剑良;朱珂;吕平;刘冬培;陈艇;汪欣;汤先拓;张世海;付豪;刘长江;张华;林德伟;何丽丽 -专利权人：天津芯海创科技有限公司;天津市滨海新区信息技术创新中心
申请日： 2019-06-26 - 公布日： 2023-03-07 - 主分类号： G06F5/06 文献下载
摘要：本发明提供了一种实现任意深度低传输延时的异步FIFO的方法及装置，应用本发明，将本时钟域内的读写地址的增量进行编码，编码信息具备bit间无关的特性，之后经过进行跨时钟域处理，在对方时钟域内再进行解码，得到地址增量信息。本发明设计了异步FIFO的读写地址跨时钟域同步方式为传递地址增量，不再需要传递完整的地址信息；本发明设计了地址增量编解码方式，使得亚稳态出现的状态不稳定问题对系统功能无害化，简化了跨时钟处理逻辑复杂度，降低了异步FIFO传输延时；本发明的FIFO的深度可以是任意值；本发明地址跨异步可以在2～3拍内完成，使得异步FIFO的传输处理延时可以缩短为3～4拍。
一种实现任意深度传输延时异步 fifo 方法装置

[发明专利]软件定义变结构计算架构及利用其实现的左右脑一体化资源联合分配方法-CN202110626788.7有效
发明人：刘勤让;高彦钊;虎艳宾;沈剑良;吕平;宋克;祁晓峰;张霞;刘冬培;陈艇 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2021-06-04 - 公布日： 2023-02-24 - 主分类号： G06F8/20 文献下载
摘要：本发明属于信号处理及深度学习技术领域，特别涉及一种软件定义变结构计算架构及利用其实现的左右脑一体化资源联合分配方法，基于拟态计算思想通过建立能够满足传统信号处理与深度学习全流程计算需求的左右脑一体化软件定义变结构计算实现左脑高精度信号处理与右脑低精度深度学习。本发明基于拟态计算思想通过建立混合颗粒度的异构构件化计算资源池、分布式层次化存储结构以及软件定义互连结构，根据任务计算需求与负载变化实现软件定义灵活变结构的左右脑计算方法，一方面解决传统信号处理与深度学习的高效衔接与一体化实现，另一方面通过软件定义变结构计算解决传统信号处理与深度学习的高性能、高效能以及高灵活实现问题，具有较好的应用前景。
软件定义结构计算架构利用实现右脑一体化资源联合分配方法

[发明专利]基于流量感知的网络交换频率动态调整方法、系统及网络交换芯片结构-CN202110344028.7有效
发明人：刘冬培;沈剑良;刘勤让;张霞;吕平;陈艇;李沛杰;张丽;刘宗海;李智超 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2021-03-31 - 公布日： 2023-02-14 - 主分类号： H04L49/10 文献下载
摘要：本发明属于网络交换功耗管理技术领域，特别涉及一种基于流量感知的网络交换频率动态调整方法、系统及网络交换芯片结构，用于网络交换芯片动态功耗管理，该方法包含：感知并监控网络交换端口流量，获取实时网络流量特性信息；通过实时网络流量特性信息提取实时网络流量特征，依据网络流量特征与时钟频率映射关系并根据实时网络流量特征置位相应调频标志信号，输出时钟频率控制信息；根据时钟频率控制信息产生相应用于网络交换数据通路时钟转换的工作时钟。本发明根据应用程序的实时通信需求和流量特性来对核心交换结构的功耗进行动态管理，方案实现方便、可靠，降低网络交换芯片功耗，具有较好应用前景。
基于流量感知网络交换频率动态调整方法系统芯片结构

[发明专利]一种数据包的转发装置及方法-CN202210962669.3在审
发明人：董春雷;陈艇;宋克;吕平;沈剑良;汤先拓;张文建;赵博;祁晓峰;高彦钊 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2022-08-11 - 公布日： 2022-12-02 - 主分类号： H04L1/18 文献下载
摘要：本发明提供一种数据包的转发装置及方法。该装置包括：包缓存RAM、缓存管理列表和标签查找表；所述包缓存RAM被以最大包长为单位划分为N个缓存块，所有缓存块均被进行编号，使得每个缓存块对应有唯一的Tag编号，每个缓存块用于存放一个数据包；所述缓存管理列表具有N个比特位，每个缓存块都对应有一个比特位，利用比特位来记录缓存块的占用状态；所述标签查找表用于记录输出的数据包对应的缓存块的Tag编号，采用ackid编号作为索引，以便基于ackid编号实现被确认包的缓存块的释放；其中，每个输出的数据包均携带有为其分配的唯一的ackid编号。本发明可以实现RapidIO协议数据包的确认。
一种数据包转发装置方法

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