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专利名称
农业 化学；冶金 建筑 机械工程 区域搜索
主分类
A 农业
B 作业；运输
C 化学；冶金
D 纺织；造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]多线程处理器、编译器装置及操作系统装置-CN201310647848.9无效
  • 古贺义宏;瓶子岳人 - 松下电器产业株式会社
  • 2010-03-18 - 2014-03-12 - G06F9/38
  • 种并行执行多个线程的命令的多线程处理器（1），具有：由分别执行命令的多个运算器构成的运算器组（119）；第1命令分组部（108）～第3命令分组部（110），按照每个线程，将该线程所包含的命令分组为由能够由上述多个运算器同时执行的命令构成的组；线程选择部（114），通过控制多个线程的命令的执行频度，从而按照多线程处理器（1）的每个执行周期，从多个线程中选择含有对多个运算器发行的命令的线程；以及命令发行部（115），按照多线程处理器（1）的每个执行周期，对多个运算器发行由线程选择部（114）选择的线程所包含的命令中、被分组后的组的命令。
  • 多线程处理器编译器装置操作系统
  • [发明专利]多线程处理器、编译器装置及操作系统装置-CN201080009472.3有效
  • 古贺义宏;瓶子岳人 - 松下电器产业株式会社
  • 2010-03-18 - 2012-01-25 - G06F9/38
  • 一种并行执行多个线程的命令的多线程处理器(1)，具有：由分别执行命令的多个运算器构成的运算器组(119)；第1命令分组部(108)～第3命令分组部(110)，按照每个线程，将该线程所包含的命令分组为由能够由上述多个运算器同时执行的命令构成的组；线程选择部(114)，通过控制多个线程的命令的执行频度，从而按照多线程处理器(1)的每个执行周期，从多个线程中选择含有对多个运算器发行的命令的线程；以及命令发行部(115)，按照多线程处理器(1)的每个执行周期，对多个运算器发行由线程选择部(114)选择的线程所包含的命令中、被分组后的组的命令。
  • 多线程处理器编译器装置操作系统
  • [发明专利]程序变换装置及程序变换方法-CN200980152097.5有效
  • 瓶子岳人;道本昌平;川端辉雄 - 松下电器产业株式会社
  • 2009-11-05 - 2011-11-30 - G06F9/45
  • 编译程序(1)能够适应近些年搭载了多线程功能的处理器，实施有效的指令调度以及控制由程序员做出的指令调度，其具备：指令调度指示输入部(2)，受理用来指定指令调度方法的程序员指示的输入；指令调度部(41)，有关对源程序所对应的中间代码进行排列的指令调度，能够实施基于多种指令调度方法的指令调度；指令调度部(41)根据由指令调度指示输入部(2)所受理的指示从多种指令调度方法之中选择任一个，执行与选择出的指令调度方法相应的指令调度。
  • 程序变换装置方法
  • [发明专利]程序重写装置-CN200810100529.5有效
  • 川端辉雄;大门正嗣;瓶子岳人;小川一 - 松下电器产业株式会社
  • 2008-05-20 - 2008-11-26 - G06F9/45
  • 一种程序重写方法，将输入程序重写为用于处理器的程序，该处理器根据执行可否标记来可以控制处理的执行可否，所述程序重写方法包括：比较处理插入步骤，将比较处理插入到输入程序中，所述比较处理所进行的处理是，对第一地址信息和第二地址信息进行比较，而将比较结果写入到执行可否标记中，所述第一地址信息是第一存储器存取处理所存取的存储器的地址信息，所述第二地址信息是第二存储器存取处理所存取的存储器的地址信息；以及逻辑保证处理插入步骤，将带有执行可否标记的逻辑保证处理插入到输入程序中，所述逻辑保证处理是，根据执行可否标记的值执行的处理、且是用于保证与输入程序的执行时相同的处理结果的处理。
  • 程序重写装置
  • [发明专利]代码转换装置-CN200810087281.3有效
  • 瓶子岳人;道本昌平;饭村幸男;山本康博 - 松下电器产业株式会社
  • 2008-03-26 - 2008-10-01 - G06F9/44
  • 提供一种编译系统，能够实现指令分解用的预备的寄存器的有效利用，并且，能够确保将预备的寄存器共享于多种用途时的检错性。指令定义资源设定部，作为由寄存器分配部处理的预处理，按每个指令在中间代码设定依据该指令来定义以及参照的寄存器等资源。指令定义资源设定部，检测各个指令被分解为多个指令的可能性，而对于有可能被分解的指令，视为存在用于分解的寄存器的定义以及参照，在中间代码设定该寄存器。寄存器分配部，在不跨越用于所述分解的寄存器的生存区间的范围内，将该寄存器在通用用途上使用。
  • 代码转换装置
  • [发明专利]处理器-CN200680011388.9无效
  • 田中哲也;桧垣信生;瓶子岳人 - 松下电器产业株式会社
  • 2006-03-07 - 2008-04-02 - G06F9/38
  • 本发明的处理器(100)包括：主指令缓冲器(122)，存储并提供从所述指令高速缓冲存储器(10)提取的一个以上的指令；TAR用指令缓冲器(123)，存储并辅助提供从所述指令高速缓冲存储器(10)提取的一个以上的指令；选择器(121)，将一般指令缓冲器(122)及TAR用指令缓冲器(123)中的任一个选择为指令提供源；以及指令获取控制部(102)，在执行TAR用充指令的情况下，提取由TAR用充指令确定的一个以上的指令并存储到TAR用指令缓冲器(123)，在反复提供所提取的指令时，控制选择器(121)从而选择TAR用指令缓冲器(123)，通过选择器(121)使TAR用指令缓冲器(123)提供指令。
  • 处理器
  • [发明专利]编译装置-CN200610093557.X无效
  • 道本昌平;瓶子岳人;小川一;川端辉雄 - 松下电器产业株式会社
  • 2006-06-06 - 2006-12-13 - G06F9/45
  • 本发明的目的为提供一种可以对循环处理实施利用软件流水线的优化处理的编译装置，该软件流水线的执行周期数削减的效果较大。该编译装置将源程序转换成可进行并行处理的处理器用机器语言程序；具备：语法分析部，对上述源程序进行语法分析，来转换成用中间语言所描述的程序即中间程序；优化部，对上述中间程序进行优化；转换部，将优化后的上述中间程序转换成机器语言程序；上述优化部在上述中间程序中包含的循环处理中，通过插入在操作数间传输数据的指令即传输指令，来变更数据依赖关系，进行软件流水线。
  • 编译装置
  • [发明专利]程序变换方法及程序变换系统-CN200610071807.X无效
  • 瓶子岳人;滨田智雄 - 松下电器产业株式会社
  • 2006-03-16 - 2006-09-20 - G06F9/45
  • 在系统软件的开发中，提高计算机整体的执行性能、且减少系统软件开发工时的程序开发系统，其具有编译系统等。编译系统是读入源程序及系统级提示信息并变换成机器语言程序的程序，生成机器语言程序，并且输出有关该程序信息的任务信息。系统级提示信息收集编译系统中的优化的提示的信息，由评测器的分析结果、程序员的指示、有关源程序的任务信息、及有关与源程序不同的其他源程序的任务信息构成。
  • 程序变换方法系统
  • [发明专利]程序处理装置-CN200510108608.7无效
  • 小川一;坂田俊幸;瓶子岳人 - 松下电器产业株式会社
  • 2005-10-08 - 2006-04-12 - G06F9/45
  • 提供一种程序处理装置，为了使编译器不会生成错误的机器语言程序，可以对编译指示所代表的提示信息进行检验。该程序处理装置具有：语法解析单元(104)，解析包含用户对编译器提供的提示信息的程序(101)的语法，生成解析信息(106)；和错误检验部(105)，基于上述解析信息(106)，检验包含上述提示信息的程序(101)中的上述提示信息的逻辑匹配性。
  • 程序处理装置
  • [发明专利]编译装置及编译方法-CN200510052131.5有效
  • 瓶子岳人;高山秀一;田中哲也;小川一;桧垣信生 - 松下电器产业株式会社
  • 2002-09-20 - 2005-07-27 - G06F9/45
  • 处理器在执行阶段以前，用指令发出控制部31对超过搭载的运算器个数的指令解码，进行执行条件的判定，对于条件为假的指令，使该指令自身无效化，进行分配，使后续的有效指令有效地使用运算器(硬件)。编译装置进行安排，使执行条件为真的指令的个数不超过硬件并行度的上限。在各周期中，并行配置的指令个数自身可以超过硬件并行度。克服了以下问题：在条件执行指令中，当条件不成立时，作为无动作指令执行，使硬件的利用率低，有效性能下降。
  • 编译装置方法
  • [发明专利]数据处理装置和编译装置-CN200410061588.8无效
  • 道本昌平;小川一;瓶子岳人;中岛圣志;冈林叶月;中西龙太 - 松下电器产业株式会社
  • 2004-12-27 - 2005-07-13 - G06F9/30
  • 本发明提供可以实现高速缓存的有效利用的数据处理装置，具有：高速缓存(28)和存储器(30)，在由物理地址确定的各个区域内存储指令或数据；运算处理部(22)，输出包含所述物理地址和表示预定处理的处理判定数据的逻辑地址，取得与该逻辑地址中包含的所述物理地址对应的所述指令或数据，并执行该指令；以及地址变换部(26)，将所述运算处理部(22)输出的逻辑地址变换成所述物理地址；所述高速缓存(28)和存储器(30)读取在由所述物理地址确定的区域内存储的所述指令或所述数据，并且执行根据所述处理判定数据规定的处理。
  • 数据处理装置编译
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