专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]存储数据删除管理系统及装置-CN202310310298.5在审
  • 友永和综;大场义洋;国松敦 - 铠侠股份有限公司
  • 2023-03-28 - 2023-10-17 - G06F3/06
  • 一种清理包括控制器和存储装置的介质的方法,该方法包括:由控制器执行擦除存储装置的数据区域和内部区域的命令,由控制器验证存储装置的数据区域的至少一部分和内部区域的至少一部分已经被擦除,由服务器生成介质的介质清理证书(CoS),并由服务器在分布式账本或数据库中注册表示介质的CoS的条目。在此,存储装置被配置为仅在数据区域中存储从存储装置外部的主机所接收的数据,并且存储装置被配置为在内部区域中存储用于存储装置的操作的操作数据。
  • 存储数据删除管理系统装置
  • [发明专利]信息处理装置-CN201210332970.2有效
  • 前田贤一;近藤伸宏;国松敦 - 株式会社东芝
  • 2012-09-10 - 2013-10-30 - G06F13/28
  • 为了尽可能有效地使用主存储器,本发明提供的信息处理装置包括主机装置和半导体存储装置。主机装置包括:主存储器,包括主机使用区域和写缓存区域;第1主机控制部;以及第2主机控制部。第1主机控制部在主机使用区域生成写数据,生成写入命令。第2主机控制部将所述写入命令移送到半导体存储装置,并且从主机使用区域读出写数据并移送到与写入命令所指定的逻辑地址相对应的写缓存区域的缓存行。半导体存储装置包括器件控制部,该器件控制部将在从主机装置接收的写入命令的执行时缓存到写缓存区域中的写数据移送到半导体存储装置,并写入到非易失性半导体存储器。
  • 信息处理装置
  • [发明专利]信息处理装置、半导体存储装置及半导体存储装置的控制方法-CN201210272624.X有效
  • 国松敦;前田贤一 - 株式会社东芝
  • 2012-08-01 - 2013-02-06 - G06F3/06
  • 本发明的实施方式的信息处理装置包括主机装置和半导体存储装置。上述主机装置包括主存储器。上述半导体存储装置包括非易失性半导体存储器、存储部和控制部。上述非易失性半导体存储器存储第1逻辑物理变换表及数据。上述存储部存储作为上述第1逻辑物理变换表的一部分的第2逻辑物理变换表。上述控制部参照上述第2逻辑物理变换表对上述非易失性半导体存储器进行访问。在上述主存储器上复制上述第1逻辑物理变换表的至少一部分。在上述第2逻辑物理变换表未登记通过上述控制部访问的逻辑地址或物理地址的情况下,将上述主存储器上的第3逻辑物理变换表的一部分复制到上述第2逻辑物理变换表。
  • 信息处理装置半导体存储控制方法
  • [发明专利]存储器管理装置及存储器管理方法-CN201180004861.1有效
  • 大沟孝;大轮勤;国松敦;中井弘人;宫川雅纪;西野玲奈;坂本广幸 - 株式会社东芝
  • 2011-01-18 - 2012-09-12 - G06F12/00
  • 在实施方式中,存储器管理装置(201)具备地址产生部(16)、顺序产生部(17)、写入控制部(18)。地址产生部(16)在从处理器(2)向非易失性半导体存储器(3)写入的数据是通常数据的情况下,以使已产生的地址所表示的位置与通常数据的写入位置不重叠的方式产生第一写入地址,在写入的数据是顺序数据的情况下,产生表示用于将顺序数据按顺序存放的写入位置的第二写入地址。顺序产生部(17)产生表示所产生的写入的先后的顺序信息。写入控制部(18)在产生了第一写入地址的情况下,对第一写入地址,与所产生的顺序信息建立对应地写入通常数据,在产生了第二写入地址的情况下,对第二写入地址,按顺序写入顺序数据。
  • 存储器管理装置方法
  • [发明专利]信息处理装置及信息处理方法-CN201110066858.4无效
  • 国松敦;上村刚;大轮勤 - 株式会社东芝
  • 2011-03-18 - 2012-02-08 - G06F9/455
  • 根据一种实施方式,提供信息处理装置及信息处理方法,信息处理装置具备:OS、第1及第2虚拟机、高速缓存未中检测部、高速缓存控制部和虚拟机控制部。OS访问包含用作主存储器的非易失性半导体存储器和用作非易失性半导体存储器的高速缓冲存储器的半导体存储器的硬件资源。第1及第2虚拟机由OS实现。高速缓存未中检测部在由第1及第2虚拟机执行的处理中检测发生了对半导体存储器的高速缓存未中的情况。高速缓存控制部,当高速缓存未中检测部检测到发生了高速缓存未中的情况下,对成为该高速缓存未中的原因的数据从非易失性半导体存储器向半导体存储器进行高速缓存处理。虚拟机切换部,当高速缓存未中检测部检测到高速缓存未中的情况下,在高速缓存控制部进行高速缓存处理的期间,从第1虚拟机切换到第2虚拟机。
  • 信息处理装置方法
  • [发明专利]图像处理装置-CN200410028696.5无效
  • 斋藤敬弘;森健一;国松敦 - 株式会社东芝
  • 2004-03-12 - 2004-09-22 - G06T1/20
  • 本发明能用单片的图像处理部,高效地进行利用图像处理装置的计算机图形、计算机视觉、图像滤波等图像处理。其特征在于,在同一块半导体芯片上形成图像处理部,该图像处理部包括以适当的像素数量组成的方框为单位处理画图的区域并对各方框代表点有关的信息进行展开计算的方框展开部32、以及多个像素处理部40,该像素处理部分别具有根据方框开部计算出的方框代表点信息至少对矩形区域内的像素单位作信息展开的像素展开部50和对根据像素展开部信息展开后的像素单位进行运算的运算部60,能有选择地执行方框展开部和像素处理部共同进行的图形处理和像素处理部和方框展开部独立进行的图像处理。
  • 图像处理装置

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