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[发明专利]一种多通道SAR ADC的电容阵列-CN202310564118.6在审
发明人：李渠;谭磊;韩雁;陈昌彦;程志渊 -专利权人：浙江大学;圣邦微电子（北京）股份有限公司
申请日： 2023-05-18 - 公布日： 2023-09-19 - 主分类号： H03M1/46 文献下载
摘要：本发明公开了一种多通道SAR ADC的电容阵列，包括K个最高位电容、N‑1个低位电容、采样保持电路、控制开关和比较器，各个通道均使用等同于DAC电容阵列最高位的权电容为跟踪保持电容，在实现各通道同步采样的同时减少了电容的总容值，从而减小了版图面积。工作时，先进入同步采样阶段和保持阶段，再把其中一个通道的跟踪保持电容与比较器相连接，经过开关控制进行电荷的重分配，完成一个通道上输入信号的模数转换；对于多个通道，把相应通道上的跟踪保持电容接入比较器并经历上述转换过程后，即可得到此通道的模数转换结果。本发明适用于多通道同步采样的SAR ADC设计，可以较大程度上减小电容面积。
一种通道 sar adc 电容阵列

[发明专利]一种减小SAR ADC电容失配的版图设计方法-CN202310563828.7在审
发明人：李渠;韩雁;程志渊 -专利权人：浙江大学
申请日： 2023-05-18 - 公布日： 2023-09-19 - 主分类号： G06F30/392 文献下载
摘要：本发明公开了一种减小SAR ADC电容失配的版图设计方法，包括以下步骤：根据电容阵列结构确定每一位电容所包含的单位电容个数，对电容阵列布局和走线，提取寄生电容并进行数据分析，根据数据分析的结果决定所设计的版图是否符合要求。该设计方法通过对寄生电容之间的关系进行数据化处理，能够直观地显示寄生电容对失配影响的大小，从而为版图的改善指明方向。与传统增大单位电容尺寸的方法相比，本发明设计得到的版图能够在不增加电容阵列面积的前提下，提高电容的匹配性，进而减小寄生电容对SAR ADC结果的影响，提高ADC系统的动态性能。
一种减小 sar adc 电容失配版图设计方法

[发明专利]一种快速锁定的宽可调范围高精度数字时间转换器-CN202310471264.4在审
发明人：梅雪笑;韩雁;陈江华;夏吉品 -专利权人：浙江大学;杭州长川科技股份有限公司
申请日： 2023-04-27 - 公布日： 2023-09-12 - 主分类号： G04F10/00 文献下载
摘要：本发明公开了一种快速锁定的宽可调范围高精度数字时间转换器，包括粗延时器、细延时器、时间数字转换器、查找表模块、延时控制电路；粗延时器用于按照参考时钟产生粗延时信号，该信号接入细延时器进行进一步的细延时；细延时器用于将粗延时信号进一步的延时，输出为细延时信号，该信号被分别接到时间数字转换器的待测信号输入端口和系统输出IO上。本发明可以用于ATE设备产生高精度相位可调节激励信号，也可用于其它适合的高精度数字时间转换应用。
一种快速锁定可调范围高精度数字时间转换器

[发明专利]基于高速异步逻辑的PVT自校准方法及其SAR ADC电路-CN202010020226.3有效
发明人：王思慧;韩雁;孙龙天;倪明;马孝宇;屠凡;孙恬静;陈鹏 -专利权人：浙江大学
申请日： 2020-01-09 - 公布日： 2023-08-22 - 主分类号： H03M1/10 文献下载
摘要：本发明公开了一种基于高速异步逻辑的PVT自校准方法及其SAR ADC电路。PVT自校准方法通过对高速异步延时链的选择，以较小的面积和功耗代价来量化当前电路处于的PVT状态信息，从系统量化的角度，根据量化得到的PVT量化码来校准芯片偏置电路产生恒定的电流、控制关键模拟电路的衬底电位来实现大带宽、低噪声和高速比较转换等，也可以利用该PVT量化码控制SoC上其他电路进行PVT校准。该方案在维持传统SAR ADC的架构的基础上，具有很强的抗PVT涨落的能力，且成本低，鲁棒性高。
基于高速异步逻辑 pvt 校准方法及其 sar adc 电路

[发明专利]一种无失配高精度的多通道时间数字转换器-CN202310471166.0在审
发明人：梅雪笑;陈江华;郎晨晨;韩雁 -专利权人：浙江大学;杭州长川科技股份有限公司
申请日： 2023-04-27 - 公布日： 2023-08-01 - 主分类号： G04F10/00 文献下载
摘要：本发明公开了一种无失配高精度的多通道时间数字转换器，包括独立时间信号测量通道、粗计数器、测量数据处理模块、数据通讯模块；所述的独立时间信号测量通道具有多条，每条通道均包含抽头延迟链（TDL）、细计数采样判断电路、转码模块、粗计数采样电路、码密度测试电路；所述的独立时间测量通道用于将连续的时间信号量化为数字信号，可测范围超过系统时钟周期，与粗计数器共同构成一个两步式时间数字转换器，实现宽范围的高精度时间信号测量。本发明结构简单，在保持高精度多通道测量能力的同时确保无失配。
一种失配高精度通道时间数字转换器

[发明专利]适用于宽电源电压范围的快速切换字线驱动电路-CN202211064463.5在审
发明人：周雪萌;韩雁;倪明 -专利权人：浙江大学
申请日： 2022-09-01 - 公布日： 2022-12-02 - 主分类号： G11C8/08 文献下载
摘要：本发明公开了一种适用于宽电源电压范围的快速切换字线驱动电路，包括工作模式和待机模式。工作模式包括工作模式电荷泵功率级、动态频率调制稳压电路、电源电压检测模块、快速切换预充模块以及两个电平移位电路和一个电平传输电路；待机模式包括待机模式电荷泵功率级和SKIP调制稳压电路。此外，一种超低功耗电压基准源在两种模式下持续提供基准电压。本发明在工作模式下增加的电源电压检测模块能在宽电源电压范围下减小输出字线电压过冲和纹波，避免了不必要的功耗损失；增加的快速切换预充模块针对NOR Flash快速随机读取的特殊要求，优化了从待机模式恢复到工作模式的切换时间。
适用于电源电压范围快速切换驱动电路

[发明专利]高速容性SAR型ADC的逻辑加速电路及逻辑加速的方法-CN202210252801.1在审
发明人：韩啸;韩雁;程志渊;谭磊;陈昌彦 -专利权人：浙江大学;圣邦微电子（北京）股份有限公司
申请日： 2022-03-15 - 公布日： 2022-11-01 - 主分类号： H03M1/46 文献下载
摘要：本发明公开了一种高速容性SAR型ADC的逻辑加速电路及逻辑加速的方法。逻辑加速电路，包括2路选择器、锁存器、比较器，和自适应异步时钟发生器；2路选择器，用于选择输出锁存器结果和比较器结果并连接到控制电容阵列模数转换器CDAC的开关中；锁存器，用于锁存比较器结果，并连接到2路选择器；比较器用于比较CDAC的输出值与参考电压Vref，并输出比较结果，比较结果输出给2路选择器，比较完成后产生一个比较完成的标志信号输出给自适应异步时钟发生器；自适应异步时钟发生器包括一个延时模块DELAY和若干个与非门、非门，用于控制逐次逼近步骤。本发明针对逻辑操作进行了加速，并且每位操作都可以进行加速。
高速 sar adc 逻辑加速电路方法

[发明专利]一种预制装配式涵洞结构及施工方法-CN202210730886.X在审
发明人：贾益;王武平;马永连;张星全;梁勇;史世友;惠琳;摄利军;陈冬冬;王建虹;韩雁;张轶群;段亚蕊 -专利权人：山西路桥第六工程有限公司;山西路桥建设集团有限公司
申请日： 2022-06-24 - 公布日： 2022-09-23 - 主分类号： E01F5/00 文献下载
摘要：本发明提出了一种预制装配式涵洞结构及施工方法，包括：弧形模板，所述弧形模板安装在涵洞安装地预开设的土坑内，所述弧形模板两端均固定连接有延伸板，两个所述延伸板相互平行，且相互隔离；管道初安装机构，所述管道安装机构包括水泥圆筒、第一安装板、圆筒，所述水泥圆筒靠近两端的外壁分别固定连接有第一安装板和第二安装板，所述第一安装板上安装有圆筒，所述第二安装板通过连接杆连接有圆台，所述圆台可插入另一个所述水泥圆筒的圆筒内，所述水泥圆筒安装在所述弧形模板内。本发明设置的管道初安装机构便于水泥圆筒的插入；设置的管道锁紧机构使得安装的相邻的水泥圆筒相互锁紧固定，且滑柱和圆筒的配合，防止水泄露。
一种预制装配式涵洞结构施工方法

[发明专利]一种能够实现快速频率锁定的环路系统-CN202110236459.1有效
发明人：程智杰;韩雁;魏翔野;白一鸣 -专利权人：浙江大学;京东方科技集团股份有限公司
申请日： 2021-03-03 - 公布日： 2022-08-23 - 主分类号： H03L7/18 文献下载
摘要：本发明公开了一种能够实现快速频率锁定的环路系统，包括压控振荡器、时间数字转换器、除法器、鉴频器、控制模块、数控振荡器、分频器。在鉴频器、控制模块、数控振荡器、分频器组成的全数字锁频环锁定前，先通过时间数字转换器和除法器，将锁频环调整至接近锁定的状态，大大缩短锁频环调整输出频率的时间，从而达到频率的快速锁定，且频率切换的过程中仍能产生稳定可用的时钟信号。
一种能够实现快速频率锁定环路系统

[发明专利]一种带双延迟线的主次延迟锁相环-CN202210229131.1在审
发明人：陈慧心;韩雁;杨建义;谭磊;陈昌彦 -专利权人：浙江大学;圣邦微电子（股份）有限公司
申请日： 2022-03-10 - 公布日： 2022-08-05 - 主分类号： H03L7/07 文献下载
摘要：本发明公开了一种带双延迟线的主次延迟锁相环，包括：上电复位模块POR、主级延迟锁相环DLL1、次级延迟锁相环DLL2和锁定指示模块LI；所述上电复位模块与主级延迟锁相环的复位控制模块相连，主级延迟锁相环的输出电压信号V1与次级双链压控延迟线的短链相连，外部输入时钟信号CLK接入主级延迟锁相环与次级延迟锁相环，主级延迟锁相环产生的总复位信号与次级延迟锁相环滤波器模块相连，鉴频鉴相器模块PFD1和鉴频鉴相器模块PFD2的输出信号分别接入锁定指示模块。本发明的DLL具有锁定准确，面积开销小等优点。
一种延迟线主次延迟锁相环

[发明专利]一种自动测试参数化单元功能的方法-CN202210276632.5在审
发明人：杨文浩;韩雁 -专利权人：浙江大学
申请日： 2022-03-21 - 公布日： 2022-06-24 - 主分类号： G06F11/36 文献下载
摘要：本发明公开了一种自动测试参数化单元功能的方法，而该方法包括：提供一种PDK库并设置路径；提供一种EDA工具并设置EDA工具环境变量；读取PDK库，获取器件名称列表；选定待测试的单个器件或多个器件，根据选定的器件读取CDF参数；根据用户的需要选择要进行测试的CDF参数；设置测试参数化单元的模式，生成CDF参数的测试值；调用EDA工具进行参数化单元的生成和排列，并抽取GDS文件，从而达到快速，自动的生成大量属性各异的参数化单元并从中提取参数化单元的信息，实现对参数化单元自动测试的功能。
一种自动测试参数单元功能方法

[发明专利]基于区间不确定的水资源承载力优化评估方法和装置-CN202210323901.9在审
发明人：韩雁 -专利权人：中国科学院地理科学与资源研究所
申请日： 2022-03-29 - 公布日： 2022-06-21 - 主分类号： G06F30/20 文献下载
摘要：本发明提出一种基于区间不确定的水资源承载力优化评估方法和装置，方法包括：建立区间不确定多目标水资源承载力优化评估模型，其中多目标水资源承载力优化评估模型以水资源可承载的人口数量、经济产值和粮食产量作为多目标函数，以可供水量、用水量、用水效率和福利水平作为约束条件；将多目标水资源承载力优化评估模型转化为与其等价的优化模型；采用区间多目标逐步宽容约束法对优化模型进行求解，以确定最优妥协解；根据最优妥协解，确定水资源所能承载的最大人口数量、最大经济产值和最大粮食产量的区间范围。通过该技术方案，可有效减少常规方法评估水资源承载力带来的不准确性。
基于区间不确定水资源承载力优化评估方法装置

[发明专利]一种高效多比特寄存器聚类合并方法-CN202011403040.2有效
发明人：陈鹏;韩雁 -专利权人：浙江大学
申请日： 2020-12-05 - 公布日： 2022-06-17 - 主分类号： G06F30/392 文献下载
摘要：本发明公开了一种高效多比特寄存器聚类合并方法，主要包括一种识别单比特寄存器可合并区域的算法，用于获取单比特寄存器可与其他单比特寄存器进行合并的区域；一种坐标映射算法，用于简化多比特寄存器合并区域和合并位数的计算，降低复杂度，进而提升运算效率；一种单比特寄存器合并成多比特寄存器的算法，用于获得整个芯片电路中所有多比特寄存器可合并区域与多比特寄存器可合并位数；一种获得最优合并序列的算法，用于获得代价最小，合并位数最多的合并序列。本发明可大大降低数字芯片中寄存器数量，减少芯片面积，降低成本，有利于优化时钟树结构，降低数字芯片功耗，具有较好的市场应用前景。
一种高效比特寄存器合并方法

[发明专利]应用于NOR Flash的快速低功耗字线驱动电路-CN202210166346.3在审
发明人：周雪萌;韩雁 -专利权人：浙江大学
申请日： 2022-02-23 - 公布日： 2022-06-03 - 主分类号： G11C16/08 文献下载
摘要：本发明公开了一种应用于NOR Flash的快速低功耗字线驱动电路，包括工作模式和待机模式。工作模式包括由交叉耦合电荷泵构成电荷泵功率级；由非交叠时钟产生电路、压控振荡器、误差放大器及电阻分压器构成动态频率调制稳压电路。待机模式包括由Dickson电荷泵构成电荷泵功率级；由非交叠时钟发生器、电流饥饿型振荡器、迟滞比较器、减法计数器、反相器、或非门、电容分压器和VD点刷新电路构成的SKIP调制稳压电路。此外，一种超低功耗电压基准源在两种模式下持续提供基准电压，以二极管方式连接的NMOS器件M5与输出负载电容Cout构成低通滤波器优化输出电压纹波。本发明能在工作模式下实现快速高效升压，且稳定低纹波地输出；同时在待机模式下低功耗地维持所需电压。
应用于 nor flash 快速功耗驱动电路

[发明专利]宽输出电压范围低电流失配的电荷泵电路设计方法及应用-CN202010935395.X有效
发明人：陈雅婷;韩雁;陈鹏 -专利权人：浙江大学
申请日： 2020-09-08 - 公布日： 2022-03-15 - 主分类号： H02M3/07 文献下载
摘要：本发明公开了宽输出电压范围低电流失配的电荷泵电路设计方法及应用。由MOS电流镜子电路和NMOS电流镜子电路组成的电流镜电路，通过镜像偏置电流源和电流槽的电流，为电荷泵输出端提供充放电电流；MOS控制开关用于控制充放电支路的导通断开；由电压缓冲器和反馈管组成的低电平输出范围的电流补偿模块，通过检测电流镜NMOS管的栅端和漏端，获取电流镜NMOS管的电流信息，并以电流的形式补偿到电流镜PMOS管，实现低电平输出范围时的PMOS管和NMOS管的电流匹配；由电压缓冲器和反馈管组成的高电平输出范围的电流补偿模块，通过检测电流镜PMOS管的栅端和漏端，获取电流镜PMOS管的电流信息，并以电流的形式补偿到电流镜NMOS管，实现低电平输出范围时的NMOS管和PMOS管的电流匹配。
输出电压范围电流失配电荷电路设计方法应用

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