专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]半导体结构和形成半导体结构的方法-CN202010268836.5有效
  • 程仲良;方子韦;吴俊毅;赵皇麟 - 台湾积体电路制造股份有限公司
  • 2020-04-08 - 2023-09-12 - H01L29/78
  • 本文所述的实施例针对用于制造具有与基于铝的n型功函层相反的无铝n型功函层的晶体管的方法。该方法包括:形成设置在间隔开的源极/漏极外延层之间的沟道部分,以及在沟道部分上形成栅极堆叠件,其中,形成栅极堆叠件包括在沟道部分上沉积高k介电层并在介电层上沉积p型功函层。在沉积p型功函层之后,在没有真空破坏的情况下,在p型功函层上形成无铝n型功函层,并且在无铝n型功函层上沉积金属。该方法还包括沉积围绕间隔开的源极/漏极外延层和栅极堆叠件的绝缘层。本发明的实施例还涉及半导体结构和形成半导体结构的方法。
  • 半导体结构形成方法
  • [发明专利]半导体装置的制造方法-CN202210881161.0在审
  • 张翔笔;程仲良;张毅敏;黄耀升;赵皇麟 - 台湾积体电路制造股份有限公司
  • 2022-07-26 - 2022-12-27 - H01L29/40
  • 公开了一种具有不同栅极结构配置的半导体装置及其制造方法。半导体装置的制造方法包含在基底上形成鳍结构,在鳍结构上形成栅极开口,在鳍结构上形成界面氧化物层,在界面氧化物层上形成第一介电层,在界面氧化物层和第一介电层之间形成偶极层,在第一介电层上形成第二介电层,在第二介电层上形成功函数金属(WFM)层,以及在WFM层上形成栅极金属填充层。偶极层包含彼此不同的第一和第二金属的离子。第一和第二金属的电负值大于第一介电层的金属或半导体的电负值。
  • 半导体装置制造方法
  • [发明专利]抛光方法-CN202210712713.5在审
  • 廖峻宏;吴振豪;李安璿;赵皇麟 - 台湾积体电路制造股份有限公司
  • 2022-06-22 - 2022-11-22 - B24B37/00
  • 本公开描述一种抛光方法和一种抛光设备,可增强用于化学机械抛光制程的研磨浆氧化性。抛光方法可包括将一基板固定至一抛光系统的一承载件之上。所述抛光方法可更包括借由抛光系统的一供料器分配一第一研磨浆至抛光系统的一抛光垫。所述抛光方法可更包括借由增强第一研磨浆的氧化性形成一第二研磨浆,以及使用第二研磨浆在基板上执行一抛光制程。
  • 抛光方法
  • [发明专利]晶体管及其制造方法-CN202210344583.4在审
  • 李欣怡;赵皇麟;徐志安 - 台湾积体电路制造股份有限公司
  • 2022-03-31 - 2022-09-13 - H01L29/06
  • 本文所述的一些实施例提供一种晶体管及其制造方法。此方法包含形成晶体管的通道结构。此方法包含形成包含铝和碳的功函数材料在通道结构周围。形成功函数材料在通道结构周围包含施加化学浸泡液,其中化学浸泡液的材料包含铝、碳及氢基材料。功函数材料包含的钛的浓度为功函数材料的0%至小于1.5%。本文所述的一些实施例提供一种晶体管。晶体管包含通道结构及设置在通道结构周围的碳化铝(AlC)基功函数材料。功函数材料包含的钛的浓度为功函数材料的0%至小于1.5%。
  • 晶体管及其制造方法
  • [发明专利]集成芯片及其形成方法-CN202110584600.7在审
  • 刘冠良;程仲良;陈升照;林勇志;蔡嘉雄;赵皇麟;林斌彦 - 台湾积体电路制造股份有限公司
  • 2021-05-27 - 2022-07-29 - H01L21/8234
  • 一种集成芯片,包含布置在衬底上方的第一晶体管和第二晶体管。第一晶体管包含在第一源极/漏极区与第二源极/漏极区之间延伸的多个第一沟道结构。第一栅极电极布置在第一沟道结构之间,且第一保护层布置在第一沟道结构中的最顶部第一沟道结构上方。第二晶体管包含在第二源极/漏极区与第三源极/漏极区之间延伸的多个第二沟道结构。第二栅极电极布置在第二沟道结构之间,且第二保护层布置在第二沟道结构中的最顶部第二沟道结构上方。集成芯片更包含布置在衬底与第一沟道结构和第二沟道结构之间的第一内连线结构以及耦合到第二源极/漏极区且布置在第一栅极电极和第二栅极电极上方的接触插塞结构。
  • 集成芯片及其形成方法

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