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专利名称

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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]相互节流的通信预取器-CN201510278099.6有效
发明人：罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2015-05-27 - 公布日： 2019-09-17 - 主分类号： G06F12/0862 文献下载
摘要：本发明涉及一种相互节流的通信预取器。一种微处理器包括根据第一算法将数据预取到微处理器的第一硬件数据预取器。该微处理器还包括根据第二算法将数据预取到微处理器的第二硬件数据预取器，其中第一算法与第二算法不同。第二预取器检测到其正在以超过第一预定速率的速率根据第二算法将数据预取到微处理器，并且作为响应，向第一预取器发送节流指示。第一预取器响应于从第二预取器接收到节流指示而以低于第二预定速率的速率根据第一算法将数据预取到微处理器。
相互节流通信预取器

[发明专利]预取单元和数据预取方法-CN201510494634.1有效
发明人：罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2011-03-29 - 公布日： 2018-11-27 - 主分类号： G06F12/0862 文献下载
摘要：一种预取单元，设置于一微处理器中，包括多个周期匹配计数器以及一控制逻辑。周期匹配计数器分别相应于不同的多个样态周期。控制逻辑用以响应于微处理器存取一存储器区块的动作，更新周期匹配计数器；根据周期匹配计数器的计数值，决定一明显的样态周期；以及根据由周期匹配计数器所决定的具有明显的样态周期的一样态，对存储器区块中的多个快取线中尚未被预取的快取线进行预取。
单元数据方法

[发明专利]数据预取方法以及微处理器-CN201510101351.6有效
发明人：罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2011-03-29 - 公布日： 2018-08-31 - 主分类号： G06F9/38 文献下载
摘要：一种数据预取方法以及微处理器。该微处理器包括：一第一级快取存储器；一第二级快取存储器；以及一预取单元，用以：检测出现在上述第二级快取存储器中的最近存取要求的一方向以及样态，以及根据上述方向以及样态，将多个快取线预取至上述第二级快取存储器中；从上述第一级快取存储器，接收上述第一级快取存储器所接收的一存取要求的一地址，其中上述地址与一快取线相关；决定在上述方向中所相关的快取线之后被上述样态所指出的一个或多个快取线；以及导致上述一个或多个快取线被预取至上述第一级快取存储器中。
数据方法以及微处理器

[发明专利]数据预取方法以及微处理器-CN201510101303.7有效
发明人：罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2011-03-29 - 公布日： 2018-01-26 - 主分类号： G06F12/0862 文献下载
摘要：一种数据预取方法以及微处理器。该微处理器包括一快取存储器；以及一预取单元，用以检测具有一第一存储器区块的多个存储器存取要求的一样态，并且根据上述样态从上述第一存储器区块预取多个快取线至上述快取存储器中；监视一第二存储器区块的一新的存储器存取要求；决定上述第一存储器区块是否虚拟邻近于上述第二存储器区块，并且当自上述第一存储器区块延续至上述第二存储器区块时，则决定上述样态是否预测到上述第二存储器区块的新的存储器存取要求所相关的一快取线在上述第二存储器区块中；以及根据上述样态，响应地从上述第二存储器区块将上述快取线预取至上述快取存储器中。
数据方法以及微处理器

[发明专利]微处理器以及预取数据至微处理器的方法-CN201410059110.5有效
发明人：罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2010-07-30 - 公布日： 2014-05-14 - 主分类号： G06F9/30 文献下载
摘要：本发明提供一种微处理器，包括一指令解码器用以解码一指令集中的多个指令，其中指令集包括一重复预取间接指令。重复预取间接指令包括多个地址操作数以及一计数值，微处理器使用地址操作数来计算一预取表中的一第一项目的一地址，其中预取表具有多个项目，并且预取表中的各个项目包括一预取地址。计数值用以指定欲被预取的多条快取线的数量，其中快取线的每一个的一存储器地址是由项目中的一个中的预取地址所指定。
微处理器以及数据方法

[发明专利]在微处理器中的通信预取器-CN201310264239.5有效
发明人：罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2013-06-28 - 公布日： 2013-11-20 - 主分类号： G06F9/38 文献下载
摘要：微处理器包括第一预取器和第二预取器，它们被配置为根据不同的第一算法和第二算法将数据分别预取到微处理器。第二预取器被配置为检测在存储区域内的存储器存取模式并根据第二算法从存储区域预取数据。第二预取器还被配置为将存储区域的描述符提供给第一预取器。当从第二预取器接收到存储区域的描述符时，第一预取器被配置为停止从存储区域预取数据。
微处理器中的通信预取器

[发明专利]数据预取器及预取数据至高速缓存存储器的方法-CN201210479571.9有效
发明人：密瑞.罗曼尼-奥古斯汀;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2012-11-22 - 公布日： 2013-02-20 - 主分类号： G06F12/08 文献下载
摘要：一种数据预取器及预取数据至高速缓存存储器的方法。该数据预取器，包括具有多已索引的储存元件的一序列，用以储存多个已排序的步幅，这些步幅相关于来自一相同存储器页面的多个暂时相邻的载入要求的一数据流；以及一逻辑单元，用以计算该数据流的一现行载入要求与一最新先前载入要求之间的一现行步幅。逻辑单元对比现行步幅以及序列中的一步幅M，并对比序列中的最新步幅以及已排序的一步幅M+1。当对比配对时，逻辑单元预取一高速缓存线，而该高速缓存线的偏移为该现行载入要求与该步幅M-1的总合。
数据预取器至高缓存存储器方法

[发明专利]预取单元、数据预取方法以及微处理器-CN201110077108.7有效
发明人：罗德尼.E.虎克;约翰.M.吉尔 -专利权人：威盛电子股份有限公司
申请日： 2011-03-29 - 公布日： 2011-08-31 - 主分类号： G06F9/38 文献下载
摘要：一种预取单元、数据预取方法以及微处理器。该预取单元用以接收对一存储器区块的多个地址的多个存取要求，每一存取要求对应存储器区块的地址中的一个，并且存取要求的地址随着时间函数非单调性地增加或减少。当接收到存取要求时，预取单元将维持储存装置中的存取要求的一最大地址以及一最小地址，以及最大地址以及最小地址的变化的计数值、维持存储器区块中最近被存取的快取线的一历史记录，其与最近被存取的快取线以存取要求的地址相关。预取单元亦依据计数值决定一存取方向、根据历史记录决定一存取样态、并且根据存取样态并沿着存取方向，将快取存储器内尚未被历史记录指示为已存取的快取线预取至存储器区块中。
单元数据方法以及微处理器

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