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[发明专利]实现快速锁相的锁相环、分频器和通信设备-CN202310694293.7在审
发明人：周艳平;陈俊杰;吴瑞砾 -专利权人：杭州地芯科技有限公司
申请日： 2023-06-12 - 公布日： 2023-10-24 - 主分类号： H03L7/199 文献下载
摘要：本发明提供了实现快速锁相的锁相环、分频器和通信设备，锁相环包括：鉴频鉴相器、电荷泵、环路滤波器、压控振荡器、快速锁相控制单元和分频器；其中，快速锁相控制单元被配置为当接收到锁相使能信号时，响应于参考时钟信号的上升沿输出高电平的复位信号；分频器包括级联的多级分频单元和复位/置位控制电路；复位/置位控制电路响应于从低电平跳变为高电平的复位信号，将各级分频单元的状态编码所构成的状态编码组合从第一状态转移为第二状态，以使分频器输出的反馈信号从低电平跳变为高电平；鉴频鉴相器被配置为响应于高电平的复位信号，输出参考时钟信号和反馈信号的相位误差。利用上述分频器及锁相环，能够实现支持快速锁相。
实现快速锁相环分频器通信设备

[发明专利]具有可变占空比的基准振荡器及其频率合成器和接收器-CN201910429601.7有效
发明人： A·卡萨格兰德 -专利权人：斯沃奇集团研究和开发有限公司
申请日： 2019-05-22 - 公布日： 2023-06-06 - 主分类号： H03L7/199 文献下载
摘要：本发明涉及一种用于电磁信号的发送器和/或接收器的基准振荡器(20)。基准振荡器(20)适于从由基准谐振器(22)提供的信号生成以预定义的占空比交替ON时间和OFF时间的改进的基准信号(50)。基准振荡器(20)还包括调节电路(30)，其适用于根据至少一个调节参数调节改进的基准信号(50)的占空比，所述调节参数取决于改进的基准信号(50)的至少一个谐波分量的等级，以便最小化改进的基准信号(50)的至少一个谐波分量。本发明还涉及包括根据本发明的基准振荡器(20)的频率合成器和射频信号接收器。
具有可变基准振荡器及其频率合成器接收器

[发明专利]适合在边沿式鉴相器组环锁相环中应用的二项信号处理技术-CN201910369525.5在审
发明人：张伟林 -专利权人：张伟林
申请日： 2019-05-06 - 公布日： 2020-11-06 - 主分类号： H03L7/199 文献下载
摘要：针对鉴相器输入信号所形成的一个前置式复位信号具有复位优先权，所需二个门电路的工作时间作为限制着鉴相器最高工作频率的构成要素。鉴相器/锁相环的输入输出信号经过短脉冲信号形成技术处理后，容易实现低噪声状态下的锁相环工作环境。
适合边沿式鉴相器组环锁相环中应用信号处理技术

[发明专利]一种时钟分配装置及PET系统-CN201810241103.5在审
发明人：奚道明;吴杰;刘苇;陈瑞;曾晨;张鹏飞;谢庆国 -专利权人：苏州瑞迈斯医疗科技有限公司
申请日： 2018-03-22 - 公布日： 2018-09-04 - 主分类号： H03L7/199 文献下载
摘要：本发明提供一种时钟分配装置及PET系统，其时钟模块的有源晶振产生第一时钟信号，FPGA芯片的锁相环接收并处理第一时钟信号以形成第二、第三时钟信号，时间测量模块与锁相环通信连接以接收第三时钟信号；时钟扇出缓冲器与锁相环连接并处理第二时钟信号以形成同步时钟信号；轻触开关与FPGA芯片连接以发送复位信号，输入连接器与生理信号探头、时间测量模块通信连接，生理信号探头经过输入连接器向时间测量模块发送触发信号，时间测量模块根据第二时钟信号和触发信号形成使能信号；输出连接器与时钟扇出缓冲器连接以接收同步时钟信号，输出连接器同时与FPGA芯片连接以接收同步复位信号、使能信号。本发明可输出多路同步复位信号、时钟信号并筛选成像数据。
时钟信号时间测量模块锁相环时钟分配装置扇出缓冲器输出连接器输入连接器复位信号接收同步生理信号使能信号通信连接探头同步复位信号同步时钟信号成像数据触发信号发送触发轻触开关时钟模块多路晶振发送筛选输出

[实用新型]数字辅助PLL锁相环电路-CN200820031287.4有效
发明人：冯开勇;丁国华 -专利权人：无锡硅动力微电子股份有限公司
申请日： 2008-01-22 - 公布日： 2008-12-31 - 主分类号： H03L7/199 文献下载
摘要：本实用新型涉及一种控制电路，尤其是指一种数字辅助PLL锁相环电路。该电路由鉴频鉴相器、低通滤波器、压控振荡器、递减计数器、窗口上下限、设定初始值部分组成。其中，递减计数器、窗口上下限、设定初始值三部分构成一个数字辅助功能，数字辅助单独提供一个控制，通过数字编码提供一个锁相窗口，使得VCO的频率落在锁相环的锁相窗口之内。这样既加快了锁定频率的速度，也避免了失锁的问题。
数字辅助 pll 锁相环电路

[发明专利]数字锁相环中计算分频比的方法和装置-CN96103913.2无效
发明人：小詹姆斯Ｗ·格登欧 -专利权人：摩托罗拉公司
申请日： 1996-03-05 - 公布日： 2001-07-18 - 主分类号： H03L7/199 文献下载
摘要：数字锁相环路（10）含有第一比较器（12）、第二比较器（14）、第三比较器（16）、调整器（18）、反馈分频器（20）、阈值单元（21）、数字振荡器（23）和环路滤波器（24）。第一比较器（12）、环路滤波器（24）数字振荡器（23）和反馈分频器（20）工作产生一个受控制的振荡。第二比较器（１4）、第三比较器（16）和调整器（18）工作向反馈分频器（20）提供一个除数，可使该锁相环路与具有各种频率的未知系统时钟（22）一起操作。
数字环中计算分频方法装置