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[发明专利]具有本地高速缓存的分布式存储器高速缓存系统-CN201580075743.8有效
发明人：吴向斌;吴甘沙 -专利权人：英特尔公司
申请日： 2015-03-09 - 公布日： 2022-01-18 - 主分类号： G06F12/0813 文献下载
摘要：本文公开了与memcached系统相关联的装置、方法和存储介质。在实施例中，服务器装置可以包括：存储器；一个或多个处理器；网络接口卡，其支持通过客户端设备利用作为具有键的值的存储器的存储位置的物理地址的变形地址的地址针对所述值对存储器进行的远程存储器直接存取；以及由一个或多个处理器操作的服务器侧memcached逻辑。可以描述和/或要求保护其他实施例。
具有本地高速缓存分布式存储器系统

[发明专利]一种根据出口类型自动分配缓存地址的装置-CN202111183721.7在审
发明人：朱修利 -专利权人：芯河半导体科技（无锡）有限公司
申请日： 2021-10-11 - 公布日： 2021-12-17 - 主分类号： G06F12/0813 文献下载
摘要：本发明涉及数据处理技术领域，尤其涉及一种根据出口类型自动分配缓存地址的装置，包括缓存地址调度装置、报文分发控制装置、多个AXI控制转发装置；缓存地址调度装置，根据出口类型和报文类型在DDR的缓存中划分地址区间，当本身地址区间的地址不足时，从DDR的缓存中取出相应的地址放入到本身内部的buffer中，供报文分发控制装置使用；报文分发控制装置，根据出口类型，向缓存地址调度装置申请对应的DDR的缓存的地址区间，并把对应的DDR的缓存的地址区间写入报文和数据的控制字段，分送给AXI控制转发装置。本发明通过对出口类型进行区分，使用不同的DDR地址空间和AXI控制转发装置，提高了访问时间和效率。
一种根据出口类型自动分配缓存地址装置

[发明专利]高性能互连相干协议-CN201710038234.9有效
发明人： R·G·布朗肯希普;B·法西姆;R·比尔斯;Y-C·刘;V·基塔;H·H·胡姆;J·维利 -专利权人：英特尔公司
申请日： 2013-03-15 - 公布日： 2021-04-20 - 主分类号： G06F12/0813 文献下载
摘要：本发明涉及高性能互连相干协议。接收一请求，该请求引用第一代理且请求特定存储器行在独占状态中被高速缓存。监听请求被发送指向一个或多个其他代理。接收到引用第二代理的监听响应，监听响应包括将对应于特定存储器行的已修改高速缓存行写回至存储器。发送完成以定址至第一代理，其中完成包括基于写回的特定存储器行的数据。
性能互连相干协议

[发明专利]高性能互连物理层-CN201710243776.X有效
发明人： V.艾尔;D.S.朱;J.维利;R.G.布兰肯施普 -专利权人：英特尔公司
申请日： 2013-03-27 - 公布日： 2021-03-12 - 主分类号： G06F12/0813 文献下载
摘要：本发明涉及高性能互连物理层。将同步计数器的复位与外部确定性信号同步。进一步将到链路传输状态中的进入与该确定性信号同步。针对串行数据链路标识目标延迟。与关联于数据链路的同步计数器相同步地接收数据序列。使用该数据序列来保持目标延迟。
性能互连物理层

[发明专利]用于大规模实体解析的两级计算备忘-CN201980048151.5在审
发明人：李旻;L·普帕;P·瑟恩 -专利权人：国际商业机器公司
申请日： 2019-07-18 - 公布日： 2021-02-26 - 主分类号： G06F12/0813 文献下载
摘要：一个实施例提供一种方法，该方法包括由处理器使用分布式计算备忘高速缓存来执行大规模实体解析的主动学习以消除冗余计算。确定用于所述大规模实体解析的所述主动学习的中间结果的链路特征向量表。通过两级高速缓存层级结构管理所述链路特征向量表。
用于大规模实体解析两级计算备忘

[发明专利]一种一写多读高并发无锁环形缓存及其实现方法-CN202011416055.2在审
发明人：刘士奇;蔡楚煌;黄欣;王中澎;魏胜男;高昀;朱贤;王鹏;张清;王嘉晨;张彧;童兰轩 -专利权人：上证所信息网络有限公司
申请日： 2020-12-08 - 公布日： 2021-02-26 - 主分类号： G06F12/0813 文献下载
摘要：本发明涉及软件系统缓存技术领域，具体来说是一种一写多读高并发无锁环形缓存及其实现方法，环形缓存由m个存储节点组成，m为正整数，每个存储节点由读写标记域、数据的实际长度域、节点的索引值域和数据域组成，节点数视为环形缓存的长度，长度需要满足2的n次幂,n为正整数，环形缓存会根据其长度对每个节点进行位置编号，编号是从0开始依次递增的自然数，直到环形缓存的长度减1，其优点在于：相比于单线程无缓存处理数据和多线程下通过锁机制来实现的缓存，使用高并发无锁环形缓存的方法大幅度提高了系统的处理性能，对低时延和高并发要求高的系统来说，高并发无锁环形缓存提供了一种解决方案。
一种一写多读高并发环形缓存及其实现方法

[发明专利]数据流图中的控制推测-CN202010230361.0在审
发明人： K·丘弗莱明 -专利权人：英特尔公司
申请日： 2020-03-27 - 公布日： 2020-12-29 - 主分类号： G06F12/0813 文献下载
摘要：本申请公开了数据流图中的控制推测。系统、装置和方法可提供确定控制循环要被执行达未指定次数的迭代并且自动地迫使控制循环除未指定次数的迭代之外还要被执行达固定次数的迭代的技术，其中，达固定次数的迭代的控制循环的执行并行地进行。在一个示例中，该技术还移除与达固定次数的迭代的控制循环的执行相关联的一个或多个数据流令牌。
数据流中的控制推测

[发明专利]高性能互连物理层-CN201710093224.5有效
发明人： V·伊耶;D·S·于;S·V·伊耶 -专利权人：英特尔公司
申请日： 2013-03-15 - 公布日： 2020-10-30 - 主分类号： G06F12/0813 文献下载
摘要：一种高性能互连物理层，其用于产生一组训练序列，每一个训练序列包括相应的训练序列头部，且训练序列头部在该组训练序列上是DC平衡的。该组训练序列可与电气有序集组合以形成超序列，用于在如下任务中使用：例如链路适应、链路状态转变、字节锁定、抗扭斜、以及其它任务。
性能互连物理层

[发明专利]用于高性能互连物理层的装置、方法和系统-CN202010633738.7在审
发明人： V·艾耶;D·S·尤;R·G·布朗肯希普;F·斯帕戈纳;A·古普塔 -专利权人：英特尔公司
申请日： 2013-03-15 - 公布日： 2020-10-02 - 主分类号： G06F12/0813 文献下载
摘要：本发明涉及用于高性能互连物理层的装置、方法和系统。链路的重新初始化可以不终止链路而发生，其中链路包括，发射机和接收机耦合至多个巷道中的每个巷道，链路的重新初始化包括在每一个巷道上发射预定义的序列。
用于性能互连物理层装置方法系统

[发明专利]一种数据处理方法、装置、计算设备及可读存储介质-CN202010291804.7在审
发明人：卢超辉 -专利权人：北京齐尔布莱特科技有限公司
申请日： 2020-04-14 - 公布日： 2020-09-11 - 主分类号： G06F12/0813 文献下载
摘要：本发明公开了一种数据处理方法，适于在数据缓存系统中执行，方法包括：在应用服务器处获取数据访问请求，并获取与要访问数据相对应的键值；在堆内缓存中查找该键值对应的数据，若查找到，则返回数据；若未查找到，则在堆外缓存中查找，若查找到，则返回数据；若未查找到，则在远程缓存服务器中查找，若查找到，则返回数据；若未查找到，则在数据服务器中获取与键值相对应的数据；更新数据的版本信息，将数据发送到调度单元，以便调度单元更新堆内缓存、堆外缓存和远程缓存服务器中的一个或者多个上存储的数据；以及返回数据。本发明还公开了相应的数据处理装置、计算设备和可读存储介质。
一种数据处理方法装置计算设备可读存储介质

[发明专利]高性能互连物理层-CN201710043763.8有效
发明人： V·艾耶;D·S·尤;R·C·沙哈;A·库玛 -专利权人：英特尔公司
申请日： 2013-03-15 - 公布日： 2020-09-01 - 主分类号： G06F12/0813 文献下载
摘要：本发明涉及高性能互连物理层。描述了一种在链路的初始化期间修改的串行数据链路。链路的修改包括从远程代理接收伪随机二进制序列(PRBS)，分析PRBS以便标识数据链路的特性，并产生描述特性的指标数据。
性能互连物理层

[发明专利]用于控制多时隙链路层微片中的消息收发的装置和系统-CN201710043551.X有效
发明人： J·维利;R·G·布朗肯希普;J·C·斯旺森 -专利权人：英特尔公司
申请日： 2013-03-15 - 公布日： 2020-08-18 - 主分类号： G06F12/0813 文献下载
摘要：本发明涉及控制多时隙链路层微片中的消息收发。产生链路层控制消息，并将其包括在要在串行数据链路上发送给设备的微片中。在数据链路上发送的微片包括多个时隙。在一些方面，控制消息可以包括病毒警报消息、毒害警报消息、信用返回消息和确认。
用于控制多时隙链路层微片中的消息收发装置系统

[发明专利]用于高性能互连物理层的装置、方法和系统-CN201710038141.6有效
发明人： V·艾耶;D·S·尤;R·G·布朗肯希普;F·斯帕戈纳;A·古普塔 -专利权人：英特尔公司
申请日： 2013-03-15 - 公布日： 2020-07-17 - 主分类号： G06F12/0813 文献下载
摘要：本发明涉及高性能互连物理层。链路的重新初始化可以不终止链路而发生，其中链路包括，发射机和接收机耦合至多个巷道中的每个巷道，链路的重新初始化包括在每一个巷道上发射预定义的序列。
用于性能互连物理层装置方法系统

[发明专利]高速缓冲存储器及其工作方法和处理器-CN201710068091.6有效
发明人：罗德尼·E·虎克;道格拉斯·R·瑞德 -专利权人：上海兆芯集成电路有限公司
申请日： 2017-02-06 - 公布日： 2020-02-07 - 主分类号： G06F12/0813 文献下载
摘要：本发明涉及高速缓冲存储器及其工作方法和处理器。一种集关联式高速缓冲存储器，包括：排列为M个集×N个通路的存储条目的M×N的存储器阵列，其中M和N两者都是大于1的整数。在所述M个集的相互独立的P个组中的各组内，所述N个通路能够单独供电。控制器针对所述P个组中的各组，监视该组的利用趋势，并且基于所述利用趋势来在不同的时间实例期间向该组的所述N个通路中的不同数量的通路动态地提供电力。
高速缓冲存储器及其工作方法处理器

[发明专利]数据处理系统的执行线程之间的基于缓存的通信-CN201880024102.3有效
发明人：乔纳森·柯蒂斯·比尔德;埃里克·范亨斯伯根 -专利权人： ARM有限公司
申请日： 2018-04-06 - 公布日： 2019-11-29 - 主分类号： G06F12/0813 文献下载
摘要：一种虚拟链路缓冲器提供处理线程或核心之间的通信。第一缓存能够由第一处理设备访问并且第二缓存能够由第二处理设备访问。互连结构耦合在所述第一缓存与所述第二缓存之间并包括链路控制器。所述第一缓存中的生产者缓存行存储由所述第一处理设备产生的数据，并且所述链路控制器将所述生产者缓存行中的数据转移到所述第二缓存中的消费者缓存行。每个新数据元素被存储在所述生产者缓存行中由存储位置或尾部指示符指示的位置处，所述存储位置或尾部指示符被存储在同一缓存行中的预定位置处。转移的数据是从所述消费者缓存行中由加载位置或头部指示符指示的位置加载的，所述加载位置或头部指示符被存储在同一消费者缓存行中的预定位置处。
缓存行缓存处理设备存储链路控制器预定位置处存储位置加载位置尾部指示缓冲器指示符指示处理线程互连结构数据转移虚拟链路耦合位置处新数据指示符加载访问通信