[发明专利]数据处理方法、数字信号处理器、处理芯片和终端设备在审

专利信息
申请号: 202211468991.7 申请日: 2022-11-22
公开(公告)号: CN115757257A 公开(公告)日: 2023-03-07
发明(设计)人: 王超;韩建强;陈波扬;朱磊光;殷存军 申请(专利权)人: 浙江大华技术股份有限公司
主分类号: G06F15/16 分类号: G06F15/16;G06F15/167
代理公司: 深圳市威世博知识产权代理事务所(普通合伙) 44280 代理人: 严翠霞
地址: 310051 浙江*** 国省代码: 浙江;33
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摘要:
搜索关键词: 数据处理 方法 数字信号 处理器 处理 芯片 终端设备
【说明书】:

本申请公开了一种数据处理方法、数字信号处理器、处理芯片和终端设备。数据处理方法包括在第二存储单元的第二加载缓存区加载外部存储器的第二数据时,利用处理单元处理第一存储单元的第一加载缓存区的第一数据;将第一数据的处理结果写入到第一存储单元的第一存储缓存区;将第一存储缓存区中的第一数据的处理结果传输到外部存储器,继续在第一存储单元的第一加载缓存区加载外部存储器的第三数据,以及利用处理单元处理第二数据。在将第一数据的处理结果传输到外部存储器的同时加载第三数据至第一加载缓存区以及处理第二数据,由此通过让多个步骤并行的方式,增加数字信号处理器对数据的处理速度,提高设备运算系统的工作性能。

技术领域

本申请涉及计算机及通信技术领域,特别是涉及一种数据处理方法、数字信号处理器、处理芯片和终端设备。

背景技术

随着科技的发展和进步,人工智能和计算机视觉也在日新月异的迭代更新,以满足更高的业务场景需求。主流的智能处理器算力是固定的,随着业务需求的增加,更高的图片分辨率和精度需求,必然带来更多的性能消耗,这对嵌入式智能芯片来说单位时间能处理的数据能力也有了更高的要求。

当前很多智能芯片都集成有专业的视觉DSP协处理器,借助其高效的计算性能,分担嵌入式设备CPU/NPU等数据处理单元的性能压力,提高整个设备运算系统的性能。

当在设备中集成有专业的DSP协处理器,如何利用DSP协处理器分担CPU/NPU等数据处理单元的性能压力,以提高整个设备运算系统的性能成为关注内容。

发明内容

为了解决现有技术中存在的上述技术问题,本申请提供一种数据处理方法、数字信号处理器、数据处理芯片和终端设备。

为解决上述问题,本申请提供了一种数字信号处理器的数据处理方法,所述数字信号处理器包括第一存储单元和第二存储单元和处理单元,所述数据处理方法包括:在所述第二存储单元的第二加载缓存区加载外部存储器的第二数据时,利用所述处理单元处理所述第一存储单元的第一加载缓存区的第一数据;将所述第一数据的处理结果写入到所述第一存储单元的第一存储缓存区;将所述第一存储缓存区中的第一数据的处理结果传输到所述外部存储器,继续在所述第一存储单元的第一加载缓存区加载外部存储器的第三数据,以及利用所述处理单元处理所述第二数据。

为解决上述问题,本申请提供了一种数字信号处理器,所述数字信号处理器包括第一存储单元和第二存储单元和处理单元,所述第一存储单元配置有第一加载缓存区和第一存储缓存区,所述第二存储单元配置有第二加载缓存区和第二存储缓存区,所述数字信号处理器用于实现上述的数据处理方法。

为解决上述问题,本申请提供了一种数据处理芯片,包括外部存储器和上述的数字信号处理器。

为解决上述问题,本申请提供了一种终端设备包括上述的数据处理芯片。

与现有技术相比,本申请的数据处理方法包括:在第二存储单元的第二加载缓存区加载外部存储器的第二数据时,利用处理单元处理第一存储单元的第一加载缓存区的第一数据;将第一数据的处理结果写入到第一存储单元的第一存储缓存区;将第一存储缓存区中的第一数据的处理结果传输到外部存储器,继续在第一存储单元的第一加载缓存区加载外部存储器的第三数据,以及利用处理单元处理第二数据。通过上述实施方式,在处理第一数据的同时加载第二数据,在将第一数据的处理结果传输到外部存储器的同时加载第三数据至第一加载缓存区以及处理第二数据,由此通过让多个步骤并行的方式,增加数字信号处理器对数据的处理速度,提高设备运算系统的工作性能。

应当理解的是,以上的一般描述和后文的细节描述仅是示例性和解释性的,而非限制本申请。

附图说明

为了更清楚地说明本申请实施例或现有技术中的技术方案,下面将对实施例中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本申请的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。

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