[发明专利]移位寄存单元及其驱动方法、栅极驱动电路、显示设备有效
申请号: | 202210334020.7 | 申请日: | 2022-03-30 |
公开(公告)号: | CN114677984B | 公开(公告)日: | 2023-08-25 |
发明(设计)人: | 付帮然;龚敬文;张松鹤;王英;谷晓俊 | 申请(专利权)人: | 海宁奕斯伟集成电路设计有限公司;北京奕斯伟计算技术股份有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36;G11C19/28 |
代理公司: | 北京市立方律师事务所 11330 | 代理人: | 张筱宁 |
地址: | 314400 浙江省嘉兴市海宁市海*** | 国省代码: | 浙江;33 |
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摘要: | |||
搜索关键词: | 移位 寄存 单元 及其 驱动 方法 栅极 电路 显示 设备 | ||
1.一种移位寄存单元,其特征在于,包括:
输入模块,包括第三晶体管,与输入端、上拉节点都电连接;
输出模块,包括第四晶体管,与时钟信号端、输出端、所述上拉节点都电连接;
储能模块,包括电容,两端分别与所述上拉节点、所述输出端电连接;
第一下拉模块,包括第一晶体管,与第一下拉节点、第一信号端、所述输出端都电连接;
第二下拉模块,包括第九晶体管,与所述上拉节点、所述第一下拉节点、所述第一信号端都电连接;
第五下拉模块,包括第二晶体管,与第二下拉节点、所述第一信号端、所述输出端都电连接;
第六下拉模块,包括第十晶体管,与所述上拉节点、所述第二下拉节点、所述第一信号端都电连接;
第三下拉模块,包括第五晶体管、第六晶体管、第七晶体管和第八晶体管,与第二信号端、所述上拉节点、所述第一下拉节点、所述第一信号端都电连接;
第四下拉模块,包括第十一晶体管,与所述第一下拉节点、所述输出端、所述第一信号端都电连接;
第七下拉模块,包括第十三晶体管、第十四晶体管、第十五晶体管和第十六晶体管,与第三信号端、所述上拉节点、所述第二下拉节点、所述第一信号端都电连接;
第八下拉模块,包括第十二晶体管,与所述第二下拉节点、所述输出端、所述第一信号端都电连接;
第九下拉模块,包括第十七晶体管,与所述上拉节点、所述第一信号端、复位信号端都电连接;
第十下拉模块,包括第十八晶体管,与所述输出端、所述第一信号端、使能信号端都电连接;
在第一阶段,所述输入模块导通,将所述输入端的第一电压传输至所述上拉节点,所述输出模块根据所述第一电压导通;
在第二阶段,所述输入模块关断,所述输出模块用于将所述时钟信号端的高电平的时钟信号输出至所述输出端;所述第一下拉模块用于根据所述高电平的时钟信号导通,将所述第一信号端的第三电压传输至所述第一下拉节点,所述第二下拉模块根据所述第三电压保持在关闭状态,使得所述储能模块根据所述高电平的时钟信号,将所述上拉节点从第一电压抬升至并保持在第二电压;所述第五下拉模块用于根据所述高电平的时钟信号导通,将所述第一信号端的第三电压传输至所述第二下拉节点,所述第六下拉模块根据所述第三电压保持在关闭状态。
2.根据权利要求1所述的移位寄存单元,其特征在于,
在第一阶段,所述第三下拉模块用于根据所述第一电压,将所述第一下拉节点与所述第一信号端导通,使得所述第一下拉节点的电压变为所述第三电压;所述第二下拉模块用于根据所述第三电压关闭。
3.根据权利要求2所述的移位寄存单元,其特征在于,
在第一阶段,所述第四下拉模块用于根据所述第一下拉节点的第三电压关闭;
在第二阶段,所述第四下拉模块用于根据所述第一下拉节点的第三电压保持关闭。
4.根据权利要求1所述的移位寄存单元,其特征在于,所述第一下拉模块包括:第一晶体管;
所述第一晶体管的栅极与所述输出端电连接,所述第一晶体管的漏极与所述第一下拉节点电连接,所述第一晶体管的源极与所述第一信号端电连接。
5.根据权利要求1所述的移位寄存单元,其特征在于,
在第一阶段,所述第八下拉模块用于根据所述第二下拉节点的第三电压关闭;
在第二阶段,所述第八下拉模块用于根据所述第二下拉节点的第三电压保持关闭。
6.根据权利要求1所述的移位寄存单元,其特征在于,所述第五下拉模块包括:第二晶体管;
所述第二晶体管的栅极与所述输出端电连接,所述第二晶体管的漏极与所述第二下拉节点电连接,所述第二晶体管的源极与所述第一信号端电连接。
7.一种栅极驱动电路,其特征在于,包括至少两个级联的如权利要求1至6任一所述的移位寄存单元;
每级所述移位寄存单元的输出端与下一级移位寄存单元的输入端电连接;
每级所述移位寄存单元的复位信号端与下一级移位寄存单元的输出端电连接。
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