[发明专利]降低RISC-V向量处理器访存延迟的方法、装置、设备及介质在审
| 申请号: | 202111434561.9 | 申请日: | 2021-11-29 |
| 公开(公告)号: | CN114265812A | 公开(公告)日: | 2022-04-01 |
| 发明(设计)人: | 张贞雷;李拓;满宏涛;刘同强;周玉龙;邹晓峰;王贤坤 | 申请(专利权)人: | 山东云海国创云计算装备产业创新中心有限公司 |
| 主分类号: | G06F15/80 | 分类号: | G06F15/80;G06F12/1027 |
| 代理公司: | 北京连和连知识产权代理有限公司 11278 | 代理人: | 朝鲁蒙;陈黎明 |
| 地址: | 250000 山东省济南市中国(山东)自由贸*** | 国省代码: | 山东;37 |
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| 摘要: | |||
| 搜索关键词: | 降低 risc 向量 处理器 延迟 方法 装置 设备 介质 | ||
1.一种降低RISC-V向量处理器访存延迟的方法,其特征在于,包括以下步骤:
修改RISC-V向量处理器的编译器以增加预存储指令;
响应于RISC-V向量处理器中有数据进行存储,经由预存储指令判断待存储数据的类型;
根据待存储数据的类型修改页表缓冲中的信息;
响应于接收到数据存储指令,基于修改后的页表缓冲中的信息将待存储的数据存储到对应的位置。
2.根据权利要求1所述的方法,其特征在于,响应于RISC-V向量处理器中有数据进行存储,经由预存储指令判断待存储数据的类型包括:
响应于RISC-V向量处理器中有数据进行存储,根据待存储数据的信息将待存储数据分为第一类型、第二类型和第三类型,其中,所述第一类型为待存储数据在第一预设时间内会被加载,所述第二类型为待存储数据在第二预设时间内不会被加载,所述第三类型为常规数据。
3.根据权利要求2所述的方法,其特征在于,根据待存储数据的类型修改页表缓冲中的信息包括:
响应于待存储数据的类型为所述第一类型,将页表缓冲中存储的虚拟地址和物理地址的映射修改为对应存储指令的地址,以使数据写入缓存中;
响应于待存储数据的类型为所述第二类型,将页表缓冲中存储的虚拟地址和物理地址的映射修改为不对应存储指令的地址,以使数据写入存储器中;
响应于待存储数据的类型为所述第三类型,不修改页表缓冲中的信息。
4.根据权利要求1所述的方法,其特征在于,所述预存储指令与存储指令具有相同的存储目的地址、存储长度和存储宽度。
5.一种降低RISC-V向量处理器访存延迟的装置,其特征在于,所述装置包括:
增加模块,所述增加模块配置为修改RISC-V向量处理器的编译器以增加预存储指令;
判断模块,所述判断模块配置为响应于RISC-V向量处理器中有数据进行存储,经由预存储指令判断待存储数据的类型;
修改模块,所述修改模块配置为根据待存储数据的类型修改页表缓冲中的信息;
存储模块,所述存储模块配置为响应于接收到数据存储指令,基于修改后的页表缓冲中的信息将待存储的数据存储到对应的位置。
6.根据权利要求5所述的装置,其特征在于,所述判断模块还配置为:
响应于RISC-V向量处理器中有数据进行存储,根据待存储数据的信息将待存储数据分为第一类型、第二类型和第三类型,其中,所述第一类型为待存储数据在第一预设时间内会被加载,所述第二类型为待存储数据在第二预设时间内不会被加载,所述第三类型为常规数据。
7.根据权利要求6所述的装置,其特征在于,所述修改模块还配置为:
响应于待存储数据的类型为所述第一类型,将页表缓冲中存储的虚拟地址和物理地址的映射修改为对应存储指令的地址,以使数据写入缓存中;
响应于待存储数据的类型为所述第二类型,将页表缓冲中存储的虚拟地址和物理地址的映射修改为不对应存储指令的地址,以使数据写入存储器中;
响应于待存储数据的类型为所述第三类型,不修改页表缓冲中的信息。
8.根据权利要求5所述的装置,其特征在于,所述预存储指令与存储指令具有相同的存储目的地址、存储长度和存储宽度。
9.一种计算机设备,其特征在于,包括:
至少一个处理器;以及
存储器,所述存储器存储有可在所述处理器上运行的计算机指令,所述指令由所述处理器执行时实现权利要求1-4任意一项所述方法的步骤。
10.一种计算机可读存储介质,所述计算机可读存储介质存储有计算机程序,其特征在于,所述计算机程序被处理器执行时实现权利要求1-4任意一项所述方法的步骤。
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