[发明专利]一种数据处理方法、装置及介质在审
| 申请号: | 202111425760.3 | 申请日: | 2021-11-26 |
| 公开(公告)号: | CN114138481A | 公开(公告)日: | 2022-03-04 |
| 发明(设计)人: | 刘钧锴;阚宏伟;王彦伟;张翔宇;韩海跃 | 申请(专利权)人: | 浪潮电子信息产业股份有限公司 |
| 主分类号: | G06F9/50 | 分类号: | G06F9/50;G06F15/78 |
| 代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 赵菲 |
| 地址: | 250101 山东*** | 国省代码: | 山东;37 |
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| 摘要: | |||
| 搜索关键词: | 一种 数据处理 方法 装置 介质 | ||
1.一种数据处理方法,其特征在于,应用于FPGA云平台,包括:
当第一目标FPGA加速卡获取到与自身连接的目标主机发送的计算开始命令,则对待处理数据进行计算,得到中间结果数据;
通过所述第一目标FPGA加速卡根据自身的配置信息将所述中间结果数据以及下一步计算的计算类型信息发送至下一个FPGA加速卡,以便下一个FPGA加速卡对所述中间结果数据进行计算,得到新的中间结果数据,并根据自身的配置信息将所述新的中间结果数据以及下一步计算的计算类型信息发送至下一个FPGA加速卡,直到最后一个参与计算的第二目标FPGA加速卡计算完成,得到最终结果数据;
通过所述第二目标FPGA加速卡将所述最终结果数据返回至所述第一目标FPGA加速卡;
通过第一目标FPGA加速卡将所述最终结果数据发送至所述目标主机,以完成针对所述待处理数据的分布式计算。
2.根据权利要求1所述的数据处理方法,其特征在于,在第一目标FPGA加速卡获取到与自身连接的目标主机发送的计算开始命令之前,还包括:
通过所述目标主机获取参与计算的全部FPGA加速卡的配置信息,并将所述第一目标FPGA加速卡对应的配置信息配置至所述第一目标FPGA加速卡;
通过所述目标主机与其他主机通信,分别向所述其他主机发送所述其他主机各自对应的配置信息,以便所述其他主机将相应的配置信息配置至与自身连接的FPGA加速卡;
其中,所述全部FPGA加速卡中的非第二目标FPGA加速卡的配置信息均包括预设地址映射关系、下一个参与计算的FPGA加速卡的网络地址信息、下一步计算的计算类型信息,并且,所述预设地址映射关系为中间结果数据在自身的内存存储物理地址范围以及下一个参与计算的FPGA加速卡的内存存储物理地址范围之间的映射关系;所述第二目标FPGA加速卡的配置信息包括所述第一目标FPGA加速卡的网络地址信息,最终结果数据在自身的内存存储物理地址范围以及在所述目标主机的内存存储物理地址。
3.根据权利要求2所述的数据处理方法,其特征在于,所述将所述第一目标FPGA加速卡对应的配置信息配置至所述第一目标FPGA加速卡,包括:
将所述第一目标FPGA加速卡对应的配置信息配置至所述第一目标FPGA加速卡的内部寄存器;
所述其他主机将相应的配置信息配置至与自身连接的FPGA加速卡,包括:
所述其他主机将相应的配置信息配置至与自身连接的FPGA加速卡的内部寄存器。
4.根据权利要求2所述的数据处理方法,其特征在于,所述对待处理数据进行计算,得到中间结果数据,包括:
调用所述第一目标FPGA加速卡自身的kernel对待处理数据进行计算,得到中间结果数据,以便该kernel将所述中间结果数据写入所述第一目标FPGA加速卡的内存。
5.根据权利要求4所述的数据处理方法,其特征在于,还包括:
在kernel向所述内存进行数据写入时,根据所述预设映射关系检测当前写入地址是否在所述中间结果数据在自身的内存存储物理地址范围内;
若是,则触发所述通过所述第一目标FPGA加速卡根据自身的配置信息将所述中间结果数据以及下一步计算的计算类型信息发送至下一个FPGA加速卡的步骤。
6.根据权利要求1至5任一项所述的数据处理方法,其特征在于,所述通过所述第一目标FPGA加速卡根据自身的配置信息将所述中间结果数据以及下一步计算的计算类型信息发送至下一个FPGA加速卡,以便下一个FPGA加速卡对所述中间结果数据进行计算,得到新的中间结果数据,包括:
通过所述第一目标FPGA加速卡将所述中间结果数据转为数据包,并根据自身的配置信息在所述中间结果数据的最后一个数据包中添加下一步计算的计算类型信息;
将所述数据包发送至下一个FPGA加速卡,以便下一个FPGA加速卡接收到最后一个数据包时,根据最后一个数据包中的计算类型信息生成kernel调用命令,并利用所述kernel调用命令调用自身的kernel对所述中间结果数据进行相应的计算,得到新的中间结果数据。
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