[发明专利]多片FPGA的收发同步方法、系统和超声控制设备在审
| 申请号： | 202110515804.5 | 申请日： | 2021-05-12 |
| 公开（公告）号： | CN113381831A | 公开（公告）日： | 2021-09-10 |
| 发明（设计）人： | 李因钊 | 申请（专利权）人： | 聚融医疗科技（杭州）有限公司 |
| 主分类号： | H04J3/06 | 分类号： | H04J3/06;H04B11/00 |
| 代理公司： | 浙江千克知识产权代理有限公司 33246 | 代理人： | 周希良 |
| 地址： | 311305 浙江省杭州市临安*** | 国省代码： | 浙江;33 |
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| 摘要： | |||
| 搜索关键词： | fpga 收发 同步 方法 系统 超声 控制 设备 | ||
1.一种多片FPGA的收发同步方法，其特征在于，包括如下步骤：
使用同源同频同相的参考时钟作为多片FPGA的输入参考时钟，所述多片FPGA包括一片发送端FPGA与多片接收端FPGA；
在全部FPGA中配置锁相环，所述输入参考时钟通过所述锁相环产生相同频率的工作时钟；
由发送端FPGA产生同步信号，由发送端和接收端FPGA通过所述锁相环产生相同频率的同步时钟，所述同步时钟脉宽与同步信号的脉宽相等；
由发送端FPGA使用工作时钟将所述同步信号的中心位置与所述同步时钟对齐后，将所述对齐后的同步信号发送至接收端FPGA；
所述接收端FPGA使用所述同步时钟采集所述同步信号。
2.如权利要求1所述的多片FPGA的收发同步方法，其特征在于，所述锁相环配置为相位补偿模式。
3.如权利要求1所述的多片FPGA的收发同步方法，其特征在于，所述同步时钟频率为1/4所述工作时钟的频率。
4.如权利要求1所述的多片FPGA的收发同步方法，其特征在于，所述发送端FPGA将所述同步信号的中心位置与所述同步时钟对齐时，将同步信号的中心位置对齐到同步时钟的上升沿处。
5.一种多片FPGA的收发同步系统，其特征在于，所述系统包括：
一片发送端FPGA和多片接收端FPGA，所述发送端FPGA和接收端FPGA被配置为具有锁相环；
参考时钟发送器，用于对发送端FPGA和接收端FPGA发送同源同频同相的输入参考时钟，输入参考时钟通过锁相环产生相同频率的工作时钟；
所述发送端FPGA还被配置为产生同步信号，且所述发送端和接收端FPGA还被配置为通过锁相环产生相同频率的同步时钟，发送端FPGA使用工作时钟将所述同步信号的中心位置与所述同步时钟对齐后，将所述对齐后的同步信号发送至接收端FPGA；所述接收端FPGA使用所述同步时钟采集所述同步信号。
6.如权利要求5所述的多片FPGA的收发同步系统，其特征在于，所述锁相环被配置为相位补偿模式。
7.一种多片FPGA收发同步的超声控制设备，包括如权利要求5-6任一项所述的系统，还包括发射与接收链路，其特征在于，所述设备以接收端FPGA采集的同步信号作为触发条件启动发射与接收链路。
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