[发明专利]三维NAND存储器件及其形成方法有效
申请号: | 202080001107.1 | 申请日: | 2020-05-15 |
公开(公告)号: | CN111758162B | 公开(公告)日: | 2021-03-12 |
发明(设计)人: | 张中;孙中旺;周文犀;夏志良 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/1157 | 分类号: | H01L27/1157;H01L27/11573;H01L27/11582 |
代理公司: | 北京永新同创知识产权代理有限公司 11376 | 代理人: | 林锦辉;刘景峰 |
地址: | 430223 湖北省武*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 三维 nand 存储 器件 及其 形成 方法 | ||
1.一种用于制造半导体器件的方法,包括:
形成交替地设置在衬底之上的牺牲层和绝缘层的初始堆叠体,所述初始堆叠体包括沿所述衬底的第一方向依次设置的第一连接区、第一阵列区和第二连接区;
在所述初始堆叠体的所述第一连接区中形成第一初始阶梯,所述第一初始阶梯形成在第一组所述牺牲层和所述绝缘层中;
在所述初始堆叠体的所述第二连接区中形成第一顶部选择栅(TSG)阶梯,所述第一TSG阶梯形成在第二组所述牺牲层和所述绝缘层中;以及
在所述第一连接区中执行蚀刻工艺,以使所述第一初始阶梯沿垂直于所述衬底的垂直方向朝所述衬底移动,从而形成第一底部选择栅(BSG)阶梯。
2.根据权利要求1所述的方法,还包括:
在所述初始堆叠体上形成至少一个停止层,所述至少一个停止层在所述初始堆叠体中限定所述第一连接区、所述第一阵列区和所述第二连接区;以及
基于所述至少一个停止层执行修整蚀刻工艺以形成多个壁结构以及所述第二连接区中的初始连接阶梯,所述壁结构被所述至少一个停止层覆盖,并且所述初始连接阶梯未被覆盖并沿所述衬底的垂直于所述第一方向的第二方向布置在所述壁结构之间。
3.根据权利要求2所述的方法,其中,执行所述蚀刻工艺包括:
在所述第一组所述牺牲层和所述绝缘层以及所述第二组所述牺牲层和所述绝缘层上执行所述蚀刻工艺,以将所述第一初始阶梯移动到一个或多个最底部牺牲层和最底部绝缘层,并使所述初始连接阶梯沿所述垂直方向朝所述衬底移动以形成连接阶梯,每个所述连接阶梯形成在所述初始堆叠体的相应的牺牲层和绝缘层中。
4.根据权利要求3所述的方法,其中,执行所述蚀刻工艺还包括:
依次执行多个切削工艺,以使所述第一连接区中的所述第一初始阶梯朝所述衬底移动,以形成所述第一BSG阶梯,其中:
所述切削工艺中的第一切削工艺使所述第一初始阶梯朝所述衬底移动第一数量的台阶;并且
所述切削工艺中的在所述第一切削工艺之后的第二切削工艺使所述第一初始阶梯移动第二数量的台阶,所述第二数量的台阶是所述第一数量的台阶的两倍。
5.根据权利要求4所述的方法,其中,将所述切削工艺进一步施加到所述第二连接区中的所述初始连接阶梯上,以使所述初始连接阶梯朝所述衬底移动,以便形成所述连接阶梯,每个所述初始连接阶梯接受相应数量的切削工艺,以使每个所述初始连接阶梯在相应的牺牲层和绝缘层中移动。
6.根据权利要求5所述的方法,还包括:
形成延伸穿过所述第一连接区、所述第一阵列区和所述第二连接区的第一分隔结构,所述第一分隔结构沿所述第一方向形成并延伸穿过所述初始堆叠体进入到所述衬底中。
7.根据权利要求6所述的方法,还包括:
在所述第一阵列区中形成第二分隔结构,所述第二分隔结构沿所述第一方向设置,并定位于所述第一分隔结构之间,所述第二分隔结构延伸穿过所述初始堆叠体进入到所述衬底中,并进一步延伸穿过所述第一BSG阶梯和所述第一TSG阶梯。
8.根据权利要求1所述的方法,还包括:
在所述初始堆叠体的所述第一阵列区中形成沟道结构,所述沟道结构沿所述垂直方向延伸穿过所述初始堆叠体进入到所述衬底中。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的