[发明专利]同步头位置检测方法及装置、计算机设备和可读存储介质在审
申请号: | 202011017966.8 | 申请日: | 2020-09-24 |
公开(公告)号: | CN114257482A | 公开(公告)日: | 2022-03-29 |
发明(设计)人: | 赵冬雪 | 申请(专利权)人: | 广州慧睿思通科技股份有限公司 |
主分类号: | H04L27/00 | 分类号: | H04L27/00;H04L27/12 |
代理公司: | 深圳智汇远见知识产权代理有限公司 44481 | 代理人: | 李雪鹃;李俊 |
地址: | 510000 广东省*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 同步 位置 检测 方法 装置 计算机 设备 可读 存储 介质 | ||
1.一种同步头位置检测方法,其特征在于,包括:
获取参考信号;
获取本地同步头序列和对准序列,调制所述本地同步头序列和所述对准序列,得到调制信号;
将所述调制信号与所述参考信号进行一次互相关,获取一次互相关后的峰值点对应的所述参考信号位置,从所述峰值点对应的所述参考信号位置开始解调所述参考信号,得到解调信号;
将所述本地同步头序列与所述解调信号进行二次互相关,获取所述解调信号的两个同步头位置。
2.根据权利要求1所述的同步头位置检测方法,其特征在于,所述两个同步头位置分别为第二次互相关的峰值位置,所述峰值位置对应有效信号的起始位置和结束位置。
3.根据权利要求1所述的同步头位置检测方法,其特征在于,所述参考信号为调制后的参考信号,所述本地头序列和所述对准序列的调制方式与所述参考信号的调制方式相同。
4.根据权利要求1所述的同步头位置检测方法,其特征在于,所述对准序列为24比特,且0、1交替设置的二进制序列。
5.根据权利要求1所述的同步头位置检测方法,其特征在于,所述本地同步头序列为八比特,首、末位相同,且与中间六位不同的二进制序列。
6.根据权利要求1所述的同步头位置检测方法,其特征在于,所述获取所述解调信号的两个同步头位置,包括:
获取所述二次互相关后的所述解调信号中与所述本地同步头序列相同的两个序列;其中,一个序列为所述解调信号中的有效信号的起始位置,另一个序列为所述解调信号中的有效信号的结束位置。
7.根据权利要求6所述的同步头位置检测方法,其特征在于,所述起始位置的序列末位的后一位为需要解码的所述有效信号的开始端,所述结束位置的序列首位的前一位为需要解码的所述有效信号的结束端。
8.一种同步头位置检测装置,其特征在于,包括:
参考信号模块,所述参考信号模块用于获取参考信号;
调制信号模块,所述调制信号模块用于获取本地同步头序列和对准序列,调制所述本地同步头序列和所述对准序列,得到调制信号;
一次互相关模块,所述一次互相关模块用于将所述调制信号与所述参考信号进行一次互相关,获取一次互相关后的峰值点对应的参考信号位置,从所述峰值点对应的参考信号位置开始解调所述参考信号,得到解调信号;
二次互相关模块,所述二次互相关模块用于将所述本地同步头序列与所述解调信号进行二次互相关,获取所述解调信号的两个同步头位置。
9.一种计算机设备,包括存储器、处理器及存储在存储器上并可在处理器上运行的计算机程序,其特征在于,所述处理器执行所述计算机程序时实现权利要求1至7中任一项所述方法的步骤。
10.一种计算机可读存储介质,其上存储有计算机程序,其特征在于,所述计算机程序被处理器执行时实现权利要求1至7中任一项所述的方法的步骤。
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