[发明专利]FPGA内嵌FLASH控制器及电子装置有效

专利信息
申请号: 202011012135.1 申请日: 2020-09-24
公开(公告)号: CN111931442B 公开(公告)日: 2021-07-02
发明(设计)人: 刘锴;宋宁;李秦飞;马得尧;杜金凤 申请(专利权)人: 广东高云半导体科技股份有限公司
主分类号: G06F30/34 分类号: G06F30/34
代理公司: 上海思捷知识产权代理有限公司 31295 代理人: 王宏婧
地址: 510000 广东省广*** 国省代码: 广东;44
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摘要:
搜索关键词: fpga flash 控制器 电子 装置
【权利要求书】:

1.一种FPGA内嵌FLASH控制器,其特征在于,所述FPGA内嵌FLASH控制器,包括:

接口模块,用于建立与主设备的通信连接,使主设备能够访问和控制FLASH逻辑控制模块;

多个FLASH功能模块,与不同类型的FLASH存储器一一对应设置并连接相应类型的FLASH存储器,用于实现对所连接的FLASH存储器进行相应的功能操作;

FLASH逻辑控制模块,连接所述接口模块和所述多个FLASH功能模块;

其中,所述FLASH逻辑控制模块包括至少一个通用寄存器组,每个所述通用寄存器组包括控制寄存器、状态寄存器、读写数据寄存器、擦除数据寄存器和FLASH类型选择寄存器,所述通用寄存器组中的各个寄存器连接各个所述FLASH功能模块的相应引脚,所述FLASH逻辑控制模块用于将所述主设备发送的操作指令映射为相应的寄存器的相关操作,并选择和匹配对应的所述FLASH功能模块,控制所选择的FLASH功能模块根据所述寄存器的相关操作,对所连接的FLASH存储器进行相应的功能操作,以实现不同类型的FLASH存储器的兼容。

2.如权利要求1所述的FPGA内嵌FLASH控制器,其特征在于,所述接口模块与所述主设备通过相应的通信协议总线通信连接,所述通信协议总线为AHB总线、APB总线、AXI总线、WISHBONE总线或Avalon总线;或者,所述接口模块与所述主设备的寄存器接口连接。

3.如权利要求1所述的FPGA内嵌FLASH控制器,其特征在于,所述接口模块还用于译码所述主设备的存储地址空间,解析所述FLASH逻辑控制模块中的各个寄存器,并将各个所述寄存器映射到所述主设备的存储地址空间的不同地址区域中。

4.如权利要求1所述的FPGA内嵌FLASH控制器,其特征在于,所述接口模块包括:

地址判断模块,连接所述主设备,并用于判断所述主设备发送的地址信号是否有效,若否,则所述接口模块不使能,与所述FPGA内嵌FLASH控制器连接的FLASH存储器维持原状,若是,则所述接口模块使能,继续后续操作;

操作判断模块,连接所述地址判断模块,用于对所述主设备发送的操作指令进行判断,并输出相应的判断结果;

信息传输模块,连接所述操作判断模块,用于根据所述操作判断模块的判断结果,将所述主设备所发出的数据信号和操作信号传输至FLASH信号生成模块;

FLASH信号生成模块,连接所述信息传输模块和所述FLASH逻辑控制模块,用于在所述信息传输模块的控制下使能,并将所述信息传输模块所传输的操作信号转换成操作所述FLASH逻辑控制模块所需的标准操作信号,将所述信息传输模块传输的数据信号转换成所述FLASH逻辑控制模块所需的标准数据信号。

5.如权利要求4所述的FPGA内嵌FLASH控制器,其特征在于,当所述主设备与所述接口模块通过AHB总线连接时,所述操作判断模块还用于对所述主设备发送的操作指令进行操作模式判断,所述信息传输模块包括基础模式传输模块、Burst模式传输模块和先进先出队列缓存器;当所述操作判断模块判断操作模式为基础传输模式时,使能所述基础模式传输模块,所述基础模式传输模块用于根据AHB通信协议规定的基础传输模式,对将所述主设备所发出的数据信号和操作信号进行解析,生成所述FLASH逻辑控制模块所需的操作信号和数据信号;当所述操作判断模块判断操作模式为Burst传输模式时,使能所述Burst模式传输模块,所述Burst模式传输模块用于根据AHB通信协议所规定的Burst传输模式,对将所述主设备所发出的数据信号和操作信号进行解析,生成所述FLASH逻辑控制模块所需的操作信号和数据信号。

6.如权利要求4所述的FPGA内嵌FLASH控制器,其特征在于,当所述主设备与所述接口模块通过WISHBONE总线连接时,所述操作判断模块还用于对所述主设备发送的操作指令进行判断,同时将判断的结果传输至FLASH信号生成模块,以生成相应的操作信号;所述信息传输模块包括数据传输模块,用于在所述操作判断模块的控制下使能,用于根据WISHBONE通信协议,对将所述主设备所发出的数据信号进行解析,生成所述FLASH逻辑控制模块所需的数据信号。

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