[发明专利]基于低频参考时钟的通道失配校准方法及其电路在审

专利信息
申请号: 202010809080.0 申请日: 2020-08-12
公开(公告)号: CN114079463A 公开(公告)日: 2022-02-22
发明(设计)人: 王浩南;葛云龙;蔡敏卿;钟英权;李承哲 申请(专利权)人: 杭州集益威半导体有限公司
主分类号: H03M1/10 分类号: H03M1/10
代理公司: 上海一平知识产权代理有限公司 31266 代理人: 吴珊;成春荣
地址: 310012 浙江省杭州市西湖区西*** 国省代码: 浙江;33
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摘要:
搜索关键词: 基于 低频 参考 时钟 通道 失配 校准 方法 及其 电路
【权利要求书】:

1.一种基于低频参考时钟的通道失配校准电路,其特征在于,包括:

时钟生成电路,用于生成低频参考时钟信号和多路采样时钟,所述低频参考时钟信号的频率低于所述多路采样时钟;

多个采样电路,分别接收所述低频参考时钟信号和多路采样时钟中的一路,所述多个采样电路以采样速率分别对所述低频参考时钟信号进行采样,其中,所述低频参考时钟信号的频率与所述采样速率之间的比例设置为相对于所述多路采样时钟的数目的质数;

多个子ADC电路,每个所述采样电路分别对应连接一个或多个子ADC电路并输出采样信号到相连的所述一个或多个子ADC电路,所述相连的一个或多个子ADC电路对采样的低频参考时钟信号进行模数转换,并且将采样的信号的电压值与阈值电压进行比较判断该电压值对应的数字信号是否为边沿信号,同时输出边沿检测值;

多个偏斜校准电路,分别连接到所述相连的一个或多个子ADC电路,用于接收转换的数字信号并根据所述边沿信号和所述边沿检测值分别对所述多路采样时钟的相位进行校准。

2.根据权利要求1所述的基于低频参考时钟的通道失配校准电路,其特征在于,还包括:微扰注入电路,连接所述时钟生成电路并用于在所述低频参考时钟信号中加入伪随机噪声。

3.根据权利要求1所述的基于低频参考时钟的通道失配校准电路,其特征在于,当所述采样的低频参考时钟信号的电压值在阈值范围Vth~-Vth内时,所述边沿检测值为0,当所述低频参考时钟信号的电压值大于阈值Vth时,所述边沿检测值为1,当所述低频参考时钟信号的电压值小于阈值-Vth时,所述边沿检测值为-1;所述通道失配校准电路还包括:阈值电压调整电路,连接所述多个子ADC电路并接收所述边沿检测值,当所述边沿检测值依次为-1、1时,增加所述阈值电压;当所述边沿检测值依次0、0时,减小所述阈值电压。

4.根据权利要求1所述的基于低频参考时钟的通道失配校准电路,其特征在于,还包括:参考时钟调整电路,用于接收所述多个子ADC电路的边沿信号并依次计算所述低频参考时钟信号若干个时钟周期范围内各个边沿信号的绝对值,选取各个绝对值中最大的一个,调整所述低频参考时钟信号的相位,直至所述绝对值达到最小值。

5.根据权利要求1所述的基于低频参考时钟的通道失配校准电路,其特征在于,所述多路采样时钟的数目为2n,所述低频参考时钟信号的频率与所述采样速率之间的比例设置为任意奇数。

6.根据权利要求1所述的基于低频参考时钟的通道失配校准电路,其特征在于,还包括:多个增益校准电路,分别连接一个子ADC电路并根据所述子ADC电路的输出的数字信号调整增益。

7.根据权利要求1所述的基于低频参考时钟的通道失配校准电路,其特征在于,还包括:多个失调校准电路,分别连接一个子ADC电路并根据所述子ADC电路的输出的数字信号调整失调。

8.一种基于低频参考时钟的通道失配校准方法,其特征在于,包括:

生成多路采样时钟和低频参考时钟信号,所述低频参考时钟信号的频率低于所述多路采样时钟;

以采样速率对所述低频参考时钟信号进行采样,其中,所述低频参考时钟信号的频率与所述采样速率之间的比例设置为相对于所述多路采样时钟的数目的质数;

对采样的低频参考时钟信号进行模数转换,并且将采样的信号的电压值与阈值电压进行比较判断该电压值对应的数字信号是否为边沿信号,同时输出边沿检测值;

根据所述边沿信号和所述边沿检测值分别对所述多路采样时钟的相位进行校准。

9.根据权利要求8所述的基于低频参考时钟的通道失配校准方法,其特征在于,在所述低频参考时钟信号加入伪随机噪声。

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