[发明专利]一种基于ZYNQ的多节点SRIO通信设计方法及装置在审
| 申请号: | 202010223318.1 | 申请日: | 2020-03-26 |
| 公开(公告)号: | CN111274173A | 公开(公告)日: | 2020-06-12 |
| 发明(设计)人: | 陈晓红;李建军 | 申请(专利权)人: | 四川鸿创电子科技有限公司 |
| 主分类号: | G06F13/16 | 分类号: | G06F13/16;G06F13/28;G06F12/0866;G06F15/78 |
| 代理公司: | 成都行之专利代理事务所(普通合伙) 51220 | 代理人: | 张超 |
| 地址: | 610000 四川省成都市中国(四川)自*** | 国省代码: | 四川;51 |
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| 摘要: | |||
| 搜索关键词: | 一种 基于 zynq 节点 srio 通信 设计 方法 装置 | ||
1.一种基于ZYNQ的多节点SRIO通信设计方法,其特征在于,包括:
S1:PL处理response、request协议包得到数据的协议类型,并给出指示标志;
S2:根据指示标志将用户接口数据进行分类缓存,将每一个完整帧放入缓存队列,并判断队列空间;
S3:PS接收数据和发送数据;
S4:PS在进行接收数据和发送数据操作的过程中,PL进行多节点数据处理得到不同的数据发送完成中断或接收完成中断并发送至PS,并向PS提供多种数据查询寄存器;
S5:PS根据接收到的数据发送完成中断或接收完成中断读取相应的数据,在完成读取操作后清除中断,查询是否还有剩余指令执行,并返回S1。
2.根据权利要求1所述的一种基于ZYNQ的多节点SRIO通信设计方法,其特征在于,PS接收数据:将缓存数据发送至DMA外挂的FIFO,同时使用PL控制DMA控制器,将相关数据发送至PS的DDR3中。
3.根据权利要求1所述的一种基于ZYNQ的多节点SRIO通信设计方法,其特征在于,PS发送数据:PL根据需要发送的数据取数的地址、长度进行控制DMA,将数据读取至PL的FIFO中,再发送。
4.根据权利要求1所述的一种基于ZYNQ的多节点SRIO通信设计方法,其特征在于,所述PL处理response、request协议包得到数据的协议类型包括:Doorbell、Message和DIO,其中DIO包括Nwrite和Nread。
5.根据权利要求1所述的一种基于ZYNQ的多节点SRIO通信设计方法,其特征在于,当队列空间存储渐满时给出数据满标志,并通过底层协议包反馈数据不能接收的包头,从而不再接收数据。
6.根据权利要求1所述的一种基于ZYNQ的多节点SRIO通信设计方法,其特征在于,所述多种数据查询寄存器包括:源ID、Doorbell数据、Nwrite写入DDR3的地址、写入长度和邮箱号。
7.根据权利要求1所述的一种基于ZYNQ的多节点SRIO通信设计方法,其特征在于,所述PS接收数据的类型包括:PL被动接收Nwrite、PL被动接收Message和PS主动调用Nread。
8.根据权利要求1所述的一种基于ZYNQ的多节点SRIO通信设计方法,其特征在于,所述PS发送数据的类型包括:PL被动发送Nread、PS主动调用Message和PS主动调用Nwrite。
9.一种基于ZYNQ的多节点SRIO通信装置,其特征在于,包括Serial RapidIO交换机和ZYNQ模块;
所述ZYNQ模块包括Serial RapidIO Gen2 IP核模块、PL模块和PS模块;
所述Serial RapidIO交换机与所述Serial RapidIO Gen2 IP核模块进行数据交互从而产生response、request协议包;
所述Serial RapidIO Gen2 IP核模块传输所述response、request给所述PL模块;
所述PL模块处理response、request协议包得到数据的协议类型,并给出指示标志;
根据指示标志将用户接口数据进行分类缓存,将每一个完整帧放入缓存队列,并判断队列空间;
所述PS模块进行接收数据和发送数据操作,并根据接收到的所述PL模块传输的数据发送完成中断或接收完成中断读取相应的数据,在完成读取操作后清除中断,查询是否还有剩余指令执行。
10.根据权利要求9所述的一种基于ZYNQ的多节点SRIO通信装置,其特征在于,还包括DDR3模块;
所述PL模块包括response处理模块、request处理模块和DMA控制器;
所述PS模块包括函数处理模块、DDR3控制器和PSDDR3模块。
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