[发明专利]一种用于图像目标检测的可扩展协处理器架构有效
申请号: | 201911057406.2 | 申请日: | 2019-10-31 |
公开(公告)号: | CN112750066B | 公开(公告)日: | 2023-04-07 |
发明(设计)人: | 桑红石;姜庆峰;李双;刘羽丰;付宏明;姜鹏 | 申请(专利权)人: | 华中科技大学 |
主分类号: | G06T1/20 | 分类号: | G06T1/20;G06T1/60;G06F15/78;G06F9/30;G06F9/38 |
代理公司: | 华中科技大学专利中心 42201 | 代理人: | 李智 |
地址: | 430074 湖北*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 一种 用于 图像 目标 检测 扩展 处理器 架构 | ||
1.一种用于图像目标检测的可扩展协处理器架构,其特征在于,所述架构包括:数据存储结构、控制部件和运算部件;
所述数据存储结构用于存放运算部件工作所需的输入数据和输出结果;所述数据存储结构采用多层次的存储结构,其包含:片外存储器、片上存储器、功能IP模块内部的局部存储器;
所述运算部件用于根据系统设计需要配置不同数量和种类的满足标准IP接口的功能IP模块,所述功能IP模块对以帧或图像块为单位的图像数据进行处理后,将运算结果送回标准IP接口;
所述控制部件包括:
用户接口模块,用于可扩展协处理器与用户端之间的图像数据传输和命令交互;
控制模块,用于对用户端送入的命令进行解析以及相关的资源调度;
传输模块,用于根据控制模块的解析和调度结果,将图像数据和参数数据传输给运算部件或用户端,将运算结果写入用户端或者存储器;
标准IP接口,用于将不同的功能IP模块接入;
所述控制部件还包括:统一存储器接口,用于访问采用统一的地址空间和寻址方式的片上存储器和片外存储器。
2.如权利要求1所述的可扩展协处理器架构,其特征在于,所述控制部件,对于用户端的命令采用顺序发射,运算结果乱序回收。
3.如权利要求1所述的可扩展协处理器架构,其特征在于,所述控制部件具有用于多IP功能模块的相关性检测并行工作机制以及相应的同步机制和检错与纠错机制。
4.如权利要求3所述的可扩展协处理器架构,其特征在于,控制部件的IP模块相关性检测并行工作机制是利用用户端在调用的命令中指定即将工作的IP模块编号和前序IP模块编号完成的。
5.如权利要求3所述的可扩展协处理器架构,其特征在于,控制部件的同步机制,用于用户端与可扩展协处理器之间的数据同步和可扩展协处理器内部的数据同步。
6.如权利要求3所述的可扩展协处理器架构,其特征在于,控制模块的检错与纠错机制,用于对用户端与可扩展协处理器同步机制、可扩展协处理器内部同步机制以及可扩展协处理器中的其他错误进行检测,防止有效的状态和数据被破坏。
7.如权利要求1所述的可扩展协处理器架构,其特征在于,所述用户接口模块包括:命令接口、状态指示接口、输入输出数据接口。
8.如权利要求1所述的可扩展协处理器架构,其特征在于,所述统一存储器接口采用如下地址计算方式,对二维存储器进行访问:
通过对存储器要读写的数据块的首地址add_sta、同一行内相邻数据的地址间隔数add_interval和前一行最后一个数据与后一行第一个数据的地址跳转数add_jump进行配置,可实现对多帧数据按帧连续写入存储器、多帧数据按像素连续写入存储器、存储器中多帧连续数据按帧读取、存储器中的数据间隔读取和存储器中一帧数据的某一块读取五种访问方式灵活访问。
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