[发明专利]一种主从MCU内外多重监视定时器协同复位的系统及方法有效

专利信息
申请号: 201910838778.2 申请日: 2019-09-05
公开(公告)号: CN110543224B 公开(公告)日: 2023-06-20
发明(设计)人: 高连鹏;王诗涵 申请(专利权)人: 大连久鹏电子系统工程有限公司
主分类号: G06F1/24 分类号: G06F1/24;G06F11/14
代理公司: 大连东方专利代理有限责任公司 21212 代理人: 姜玉蓉;李洪福
地址: 116000 辽宁省大连*** 国省代码: 辽宁;21
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摘要:
搜索关键词: 一种 主从 mcu 内外 多重 监视 定时器 协同 复位 系统 方法
【说明书】:

发明提供一种主从MCU内外多重监视定时器协同复位的系统,包括:主MCU芯片、从MCU芯片、监视定时器复位电路和电源电路。主MCU芯片采用Cortex‑M4架构的STM32F407ZGT6芯片;Cortex‑M4架构的STM32F407ZGT6芯片通用GPIO口线与从MCU的通用GPIO口线1连接,向从MCU发送固定频率的脉冲信号;芯片的nRST引脚为低电平复位引脚,与从MCU的通用GPIO口线2连接,接收从MCU的复位控制信号并与从MCU通过SPI接口进行通信。本发明在主从MCU协同工作的系统下,主从内外4重监视定时器协同工作,分别对主从MCU进行监视,在MCU工作异常时及时进行复位。其中由从MCU对主MCU进行外部复位控制,可灵活调整监视定时器溢出时间,有效解决了执行复杂任务的主MCU从上电到可以启动内置监视定时器期间发生工作异常导致系统无法复位的问题。

技术领域

本发明涉及多重监视定时器协同复位的技术领域,具体而言,尤其涉及一种主从MCU内外多重监视定时器协同复位的系统及方法。

背景技术

现阶段的技术中对微处理器的内部复位过程一般为:微处理器在正常工作时,根据所设定时间间隔清除内置监视定时器,若监视定时器在溢出时间内没有被清除,则微处理器自动复位。但是该方式的缺点为:执行复杂任务的微处理器从上电到可以启动内置监视定时器并输出清监视定时器信号所需时间较长,若在此期间发生程序跑死等工作异常情况,微处理器将不能及时进行复位,导致系统瘫痪。

同时现阶段的技术中对微处理器的外部复位过程一般为:微处理器正常工作时向外部监视定时器复位电路发送固定频率的清监视定时器信号,若外部监视定时器复位电路在溢出时间内没有接收到清监视定时器信号,则判定微处理器工作异常,对其进行复位控制。该方式的缺点为:监视定时器溢出时间不可调整,灵活性低,并且在多个微处理器协同工作的系统需要相同数量的监视定时器复位电路,占用印刷电路板面积资源,增加布线难度和系统成本。

发明内容

根据上述提出的技术问题,而提供一种主从MCU内外多重监视定时器协同复位的系统及方法。本发明主要利用一种主从MCU内外多重监视定时器协同复位的系统,其特征在于,包括:主MCU芯片、从MCU芯片、监视定时器复位电路和电源电路。

进一步地,所述主MCU芯片采用Cortex-M4架构的STM32F407ZGT6芯片;所述Cortex-M4架构的STM32F407ZGT6芯片通用GPIO口线与所述从MCU的通用GPIO口线1连接,向所述从MCU发送固定频率的脉冲信号;所述芯片的nRST引脚为低电平复位引脚,与所述从MCU的通用GPIO口线2连接,接收从MCU的复位控制信号并与所述从MCU通过SPI接口进行通信。

更进一步地,所述从MCU芯片采用Cortex-M3架构的STM32F103RCT6芯片;所述Cortex-M3架构的STM32F103RCT6芯片通用GPIO口线3与所述监视定时器复位电路的WDI引脚连接,向所述监视定时器复位电路发送固定频率的脉冲信号,nRST引脚为低电平复位引脚,与所述监视定时器复位电路的引脚连接,接收所述监视定时器复位电路的复位控制信号。

进一步地,所述监视定时器复位电路采用TPS3828监视定时器复位芯片,向所述从MCU提供溢出时间为1.6s的定时监控和复位控制。

更进一步地,所述电源电路包括2片SPX5205线性稳压芯片,将5.0V电压转换为3.3V电压为所述主/从MCU芯片和所述监视定时器复位电路提供工作电源。

本发明还包含一种主从MCU内外多重监视定时器协同复位的方法,其特征在于,包括以下步骤:

步骤S1:设置四重监视定时器,并对所述主/从MCU芯片和所述监视定时器复位电路进行实时监测;

步骤S2:通过所述四重监视定时器判断所述主/从MCU芯片是否需要进行复位;

步骤S3:对所述主/从MCU芯片进行复位。

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