[发明专利]存储器内处理有效

专利信息
申请号: 201880055104.9 申请日: 2018-08-21
公开(公告)号: CN111052099B 公开(公告)日: 2021-04-27
发明(设计)人: P·V·莱亚;T·P·芬克拜纳 申请(专利权)人: 美光科技公司
主分类号: G06F13/16 分类号: G06F13/16;G06F3/06;G11C7/06;G11C7/22;G11C11/4091;G11C11/4076
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 王龙
地址: 美国爱*** 国省代码: 暂无信息
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摘要:
搜索关键词: 存储器 处理
【权利要求书】:

1.一种设备,其包括:

主机;和

具存储器内处理PIM能力的装置,其经由接口耦合到所述主机,所述接口包括:

旁带通道;及

控制总线,所述控制总线与所述旁带通道分离且存储器命令经由所述控制总线从所述主机提供到所述具PIM能力的装置,

其中所述具PIM能力的装置包括耦合到感测电路的存储器单元阵列,且配置成对存储在所述阵列中的数据执行位向量运算;且

其中所述主机包括PIM控制组件,以在经由所述旁带通道提供数个对应位向量运算到所述具PIM能力的装置之前为PIM操作执行虚拟地址解析。

2.根据权利要求1所述的设备,其中所述感测电路包括多个感测组件,所述多个感测组件用于对存储在所述阵列中的数据执行所述位向量运算。

3.根据权利要求1所述的设备,其中所述PIM控制组件耦合到所述主机的存储器管理单元以通过将所述主机的虚拟地址转换成所述阵列的物理地址来执行所述虚拟地址解析。

4.根据权利要求1所述的设备,其中所述位向量运算中的至少一个包括待在存储在所述阵列中的第一操作数与第二操作数之间执行的布尔运算。

5.根据权利要求1所述的设备,其中所述PIM控制组件包括定序器,所述定序器经配置以接收复合运算,并将组成的位向量运算发送到所述具PIM能力的装置上的位向量运算电路。

6.根据权利要求5所述的设备,其中所述主机和定序器定位成物理上与所述阵列和感测电路分离。

7.根据权利要求1所述的设备,其中所述主机配置成除了发送逻辑运算命令之外,还发送执行动态随机存取存储器DRAM操作的命令。

8.根据权利要求1所述的设备,其中所述主机进一步包括控制逻辑,所述控制逻辑包含配置成生成逻辑运算命令的精简指令集计算机RISC类型控制器。

9.根据权利要求8所述的设备,其中所述逻辑运算命令包括与双数据速率DDR命令不同的命令。

10.一种设备,其包括:

存储器单元阵列;

耦合到所述阵列的感测电路,所述感测电路包含感测放大器和计算组件;和

存储器内处理PIM控制组件,其包括耦合到所述阵列和感测电路的定时电路和时序管理电路,其中所述PIM控制组件配置成:

控制所述阵列的操作的时序;以及

经由包括旁带通道的接口接收逻辑运算命令和复合运算命令中的至少一个以能够执行使用所述感测电路执行的位向量运算,

其中在由所述PIM控制组件接收所述逻辑运算命令和所述复合运算命令中的所述至少一个之前,与所述逻辑运算命令和所述复合运算命令中的所述至少一个相关联的虚拟地址已解析为物理地址。

11.根据权利要求10所述的设备,其中所述PIM控制组件进一步配置成在执行所述位向量运算之前对存储在所述阵列中的数据执行数据对齐操作。

12.根据权利要求10所述的设备,其中所述PIM控制组件存在于存储器装置的控制器上,且其中所述控制器进一步配置成除了控制所述至少一个逻辑运算命令和所述复合运算命令之外还控制动态随机存取存储器DRAM命令的执行,经由控制总线接收的所述DRAM命令与所述旁带通道分离。

13.根据权利要求12所述的设备,其中所述控制总线对应于双数据速率DDR接口。

14.根据权利要求10所述的设备,其进一步包括耦合到所述阵列和所述PIM控制组件的主机,其中所述主机包含电路以为所述逻辑运算命令和所述复合运算命令中的所述至少一个执行逻辑到物理地址解析。

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