[发明专利]一种基于二级查表的64B/66B编码器及编码方法有效

专利信息
申请号: 201811307961.1 申请日: 2018-11-05
公开(公告)号: CN109347484B 公开(公告)日: 2022-07-12
发明(设计)人: 哈云雪;徐丹妮;唐金锋;刑宗歧 申请(专利权)人: 西安微电子技术研究所
主分类号: H03M13/00 分类号: H03M13/00
代理公司: 西安通大专利代理有限责任公司 61200 代理人: 徐文权
地址: 710065 陕西*** 国省代码: 陕西;61
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摘要:
搜索关键词: 一种 基于 二级 64 66 编码器 编码 方法
【说明书】:

发明公开了一种基于二级查表的64B/66B编码器及编码方法,对大小为272的表格进行关键位置的特征量提取,据此将表格拆解成第一级大小为28的表格,在此基础上以XGMII输入的8bit控制信息xgmii_txc[7:0]进行第一级映射,同时进行特征量的二次提取,第二次提取的特征量为64bit数据信息xgmii_txd[63:0]中的xgmii_txd[63:56]和xgmii_txd[31:24],产生第二级大小为21的表格,并进行第二级映射,从而得到编码结果。不需要庞大的查找表即可完成编码。节约资源。且编码过程为纯硬件编码,切换效率高,几十纳秒即可完成编码。

技术领域

本发明属于编解码技术领域,具体涉及一种基于二级查表的64B/66B编码器及编码方法。

背景技术

64B/66B编码模块是按照编码规则将XGMII输入的64bit数据信息xgmii_txd[63:0]、和8bit 控制信息xgmii_txc[7:0]编码成66bit的数据信息,66bit的数据信息包括2bit同步头,8bit块类 型及56bit有效负载。,加入2bit的冗余以达到0、1均衡的目的。现有的编码实现方式有两种: 查表法和逻辑运算法。查表法是将编码过程抽象成一次查找表映射的过程,该方法电路面积庞 大,使用大量的ROM资源;逻辑运算法是将64bit数据划分成8个8bit的窄通道,每个窄通 道分别进行译码,该方法是将方法1中272的表格拆分成8个28大小的表格,进行并行译码, 该方法相对于查表法来讲查找表小了很多,但是8个大小为256的查找表同时译码对于硬件实 现而言仍然很耗费资源。

发明内容

本发明针对64B/66B编解码实现过程中,硬件开销大、效率低的特点,提出一种关键位 置的特征量提取的方法,该方法利用码字的自身特点进行特征量提取,将庞大的查找表缩小成 硬件可实现的小的查找表。

为达到上述目的,本发明所述一种基于二级查表的64B/66B编码装置包括前后两级查找 表,第一个查找表根据发送控制字得到一个初步的结果,第二级查找表根据第一个查找表的结 果和部分码字的规律进行二级映射,最终得到编码结果。

一种基于二级查表的64B/66B编码器,包括第一锁存器模块,一级编码模块,通道划分 模块,第二锁存器模块,二级编码模块,数据选择模块和状态机控制模块;

其中,第一锁存器模块用于对输入的64bit数据进行缓存,并将缓存的64bit数据发送给 第二锁存器模块;

一级编码模块用于根据输入的8bit控制信息xgmii_txc译出部分块类型,并产生同步头, 将同步头发送给第二锁存器模块,将接收的8bit控制信息txc[7:0]和一级编码结果发送给二级 编码模块;

通道划分模块用于将输入并行的64bit分成第0至第7共8个通道,每个通道一个字节, 并将划分后的8个字节发送给二级编码模块;

第二锁存器模块用于时序匹配以及数据缓存,缓存接收到的第一锁存器模块发送的64bit 数据以及一级编码模块发送的同步头,并使得第二锁存器模块的输出和二级编码模块的输出同 一时刻到达数据选择模块;

二级编码模块用于根据一级编码模块的结果block_type,结合通道划分模块输出的第0通 道和第3通道的原始码字lane_0[7:0]、lane_3[7:0],得到全部的块类型BlockType Field,并将 通道划分模块输出的8个通道的值根据XGMII控制符映射表进行字节映射,得到编码数据 encode;将8bit块类型Block Type Field、通道0至通道7的编码数据encode和8bit控制信息 xgmii_txc发送至数据选择模块;同时将用Block Type Field产生的块结构字t_blk_type输出至 状态机控制模块;

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