[发明专利]阵列基板和显示面板有效
申请号: | 201810700168.1 | 申请日: | 2018-06-29 |
公开(公告)号: | CN110658657B | 公开(公告)日: | 2021-10-01 |
发明(设计)人: | 严允晟;贾玉娥;廖峰;张慧;张舜航;王洪润;刘立伟;侯凯;林允植 | 申请(专利权)人: | 京东方科技集团股份有限公司 |
主分类号: | G02F1/1362 | 分类号: | G02F1/1362;G02F1/1343 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 焦玉恒 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 阵列 显示 面板 | ||
本公开提供一种阵列基板和显示装置。该阵列基板包括:沿行方向和列方向排布的多个子像素,相邻的四列子像素列或者六列子像素列组成子像素列组;多条数据线,沿列方向延伸,数据线包括第一数据线和第二数据线,其中,沿行方向,子像素列组的两侧分别设置有第一数据线和第二数据线,且相邻的子像素列组之间包括第一数据线和第二数据线组成的数据线对。本公开实施例提供的阵列基板可以提高开口率。
技术领域
本公开至少一个实施例涉及一种阵列基板和显示装置。
背景技术
双栅线(dual gate)技术是将显示装置中的数据线的数量减少一半,栅线的数量增加一倍的驱动技术,即,将与数据线连接的源极驱动集成电路 (integrated circuit,IC)的数量减半,将与栅线连接的栅极驱动集成电路的数量加倍。由于栅极驱动集成电路的单价比源极驱动集成电路的单价便宜,从而实现成本的降低。
发明内容
本公开的至少一实施例提供一种阵列基板和显示装置。本公开实施例提供的阵列基板可以提高开口率。
本公开的至少一实施例提供一种阵列基板,包括:沿行方向和列方向排布的多个子像素,相邻的四列子像素列或六列子像素列组成子像素列组;多条数据线,沿所述列方向延伸,所述数据线包括第一数据线和第二数据线,其中,沿所述行方向,所述子像素列组的两侧分别设置有所述第一数据线和所述第二数据线,且相邻的所述子像素列组之间包括所述第一数据线和所述第二数据线组成的数据线对。
在一些示例中,阵列基板还包括:多条栅线,沿所述行方向延伸,所述栅线包括第一栅线和第二栅线,其中,所述子像素列组包括多行子像素行,且沿所述列方向,每个所述子像素行的两侧分别设置所述第一栅线和所述第二栅线,且相邻的所述子像素行之间包括所述第一栅线和所述第二栅线组成的栅线对。
在一些示例中,相邻的六列子像素列组成所述子像素列组,所述子像素列组包括沿所述行方向依次排列的第一子像素列、第二子像素列、第三子像素列、第四子像素列、第五子像素列以及第六子像素列;所述多条数据线还包括第三数据线,所述第三数据线设置在所述第三子像素列与所述第四子像素列之间;其中,所述第一数据线与所述第一子像素列和所述第二子像素列连接,所述第三数据线与所述第三子像素列和所述第四子像素列连接,所述第二数据线与所述第五子像素列和所述第六子像素列连接。
在一些示例中,所述第一栅线与所述第一子像素列和所述第二子像素列之一连接,所述第二栅线与所述第一子像素列和所述第二子像素列的另一个连接;所述第一栅线与所述第三子像素列和所述第四子像素列之一连接,所述第二栅线与所述第三子像素列和所述第四子像素列的另一个连接;所述第一栅线与所述第五子像素列和所述第六子像素列之一连接,所述第二栅线与所述第五子像素列和所述第六子像素列的另一个连接。
在一些示例中,所述子像素列组中的一行所述子像素行中的位于所述第三数据线一侧的三个所述子像素具有不同的颜色,且位于所述第三数据线另一侧的三个所述子像素也具有不同的颜色。
在一些示例中,所述子像素列组中的一行所述子像素行中的位于所述第三数据线一侧的三个所述子像素包括红色子像素、绿色子像素以及蓝色子像素,且位于所述第三数据线另一侧的三个所述子像素也包括红色子像素、绿色子像素以及蓝色子像素。
在一些示例中,所述子像素列组中的各所述子像素列中的子像素具有相同的颜色。
在一些示例中,阵列基板还包括:多条公共电极线,其中,所述第一子像素列与所述第二子像素列之间、所述第二子像素列与所述第三子像素列之间、所述第四子像素列与所述第五子像素列之间,以及所述第五子像素列与所述第六子像素列之间的至少之一设置有所述公共电极线。
在一些示例中,所述公共电极线包括沿所述列方向延伸的且经过多行所述子像素行的第一公共电极线,所述第一公共电极线位于所述第二子像素列与所述第三子像素列之间,和所述第四子像素列与所述第五子像素列之间的至少之一。
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