[发明专利]基于FPGA暂存纸币装置调速方法、系统和金融设备有效

专利信息
申请号: 201810062364.0 申请日: 2018-01-23
公开(公告)号: CN108257291B 公开(公告)日: 2020-04-07
发明(设计)人: 莫良雄 申请(专利权)人: 深圳怡化电脑股份有限公司;深圳市怡化时代科技有限公司;深圳市怡化金融智能研究院
主分类号: G07D11/16 分类号: G07D11/16;G07D11/20
代理公司: 深圳中一专利商标事务所 44237 代理人: 官建红
地址: 518000 广东省深圳市南山*** 国省代码: 广东;44
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摘要:
搜索关键词: 基于 fpga 暂存 纸币 装置 调速 方法 系统 金融设备
【权利要求书】:

1.一种基于FPGA的暂存纸币装置调速方法,其特征在于,包括:

设备启动,读取暂存纸币装置的预设参数和上一次运行结束时的存储参数,所述存储参数包括暂存卷筒上的暂存纸币数量n;

以所述预设参数和所述存储参数计算该暂存纸币装置此次启动时驱动所述暂存卷筒的驱动电机的初始转速N0;

若需要收纳纸币或分出纸币,则控制所述驱动电机以所述初始转速转动,并在收纳纸币或分出纸币的过程中以暂存纸币数量n的变化实时调节所述驱动电机的转速,以使所述暂存卷筒线速度恒定;

所述初始转速N0=60*V*I/(PI*(D0+n*d));

其中,PI为圆周率,D0、d、V、I分别为所述预设参数的暂存卷筒初始直径、每张纸币使暂存卷筒直径变化的尺寸、暂存卷筒线速度、所述驱动电机与所述暂存卷筒的传动比。

2.如权利要求1所述的基于FPGA的暂存纸币装置调速方法,其特征在于,还包括:

当收纳纸币或分出纸币结束后,根据此次收纳纸币或分出纸币的数量更新所述暂存纸币数量n。

3.如权利要求1所述的基于FPGA的暂存纸币装置调速方法,其特征在于,所述在收纳纸币或分出纸币的过程中以暂存纸币数量n的变化实时调节所述驱动电机的转速的过程中,所述暂存纸币装置每收一张纸币或每分一张纸币调节一次所述驱动电机的转速。

4.一种基于FPGA的暂存纸币装置调速系统,其特征在于,包括:传感器、寄存器、状态控制单元、公式计算单元及驱动单元,其中:

所述状态控制单元用于在设备启动时读取暂存纸币装置的预设参数和上一次运行结束时存储于所述寄存器的存储参数,所述存储参数包括暂存卷筒上的暂存纸币数量n;

所述公式计算单元以所述预设参数和所述存储参数计算该暂存纸币装置此次启动时驱动所述暂存卷筒的驱动电机的初始转速N0;

若所述传感器检测到需要收纳纸币或分出纸币,则所述状态控制单元控制所述驱动单元驱动所述驱动电机以所述初始转速转动,并所述公式计算单元在收纳纸币或分出纸币的过程中以暂存纸币数量n的变化实时调节所述驱动电机的转速,以使所述暂存卷筒线速度恒定;

所述初始转速N0=60*V*I/(PI*(D0+n*d));

其中,PI为圆周率,D0、d、V、I分别为所述预设参数的暂存卷筒初始直径、每张纸币使暂存卷筒直径变化的尺寸、暂存卷筒线速度、所述驱动电机与所述暂存卷筒的传动比。

5.如权利要求4所述的基于FPGA的暂存纸币装置调速系统,其特征在于,所述寄存器还用于:

当收纳纸币或分出纸币结束后,根据此次收纳纸币或分出纸币的数量更新所述暂存纸币数量n。

6.如权利要求4所述的基于FPGA的暂存纸币装置调速系统,其特征在于,所述公式计算单元在实时调节所述驱动电机的转速的过程中,所述暂存纸币装置每收纳一张纸币或每分出一张纸币调节一次所述驱动电机的转速。

7.一种金融设备,包括FPGA以及存储在所述FPGA中并可运行的计算机程序,其特征在于,所述FPGA执行所述计算机程序时实现如权利要求1至3任一项所述基于FPGA的暂存纸币装置调速方法的步骤。

8.一种金融设备,包括FPGA,其特征在于,包括权利要求4至6任一项所述的基于FPGA的暂存纸币装置调速系统。

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