[发明专利]用于三维存储器的晶圆三维集成引线工艺及其结构有效
| 申请号: | 201710774763.5 | 申请日: | 2017-08-31 |
| 公开(公告)号: | CN107644837B | 公开(公告)日: | 2019-01-01 |
| 发明(设计)人: | 朱继锋;陈俊;胡思平;吕震宇 | 申请(专利权)人: | 长江存储科技有限责任公司 |
| 主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L23/48 |
| 代理公司: | 北京辰权知识产权代理有限公司 11619 | 代理人: | 刘广达 |
| 地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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| 摘要: | |||
| 搜索关键词: | 用于 三维 存储器 集成 引线 工艺 及其 结构 | ||
1.一种晶圆三维集成引线工艺,其特征在于,包括以下步骤:
提供一第一晶圆,该第一晶圆具有相对设置的正面和背面,该第一晶圆的正面至少部分区域上设置有接触孔区域;
在该接触孔区域中形成介质层,该介质层具有相对设置的顶面和底面,其中该顶面为朝向该第一晶圆正面的一侧,该底面为朝向该第一晶圆背面的一侧;
在该第一晶圆的正面至少包含介质层的区域上制造半导体器件,该半导体器件包括接触孔,该接触孔的一端与该介质层接触,且在所述一端沿接触孔的轴向延伸至所述介质层内并介于所述介质层的底面和顶面之间;
将包括该半导体器件的第一晶圆的半导体器件一侧与第二晶圆键合,并将该第一晶圆的背面进行减薄;
在减薄后的该第一晶圆的背面表面上沉积第一保护层;
在该第一晶圆的背面与该接触孔对应的位置形成通孔,该通孔与对应的该接触孔连通;
在该通孔内形成金属连接结构;
在该第一晶圆的背面沉积引线金属层,并对该引线金属层利用微影和刻蚀工艺定义引线结构,该引线结构与该通孔内的该金属连接结构电连接。
2.如权利要求1所述的晶圆三维集成引线工艺,其特征在于,该介质层的底面位于该第一晶圆内部,该介质层的顶面与该第一晶圆的正面齐平。
3.如权利要求1所述的晶圆三维集成引线工艺,其特征在于,该介质层的底面位于该第一晶圆内部,该介质层的顶面高于该第一晶圆的正面。
4.如权利要求1所述的晶圆三维集成引线工艺,其特征在于,该介质层的底面与该第一晶圆的正面水平接触,该介质层的顶面高于该第一晶圆的正面。
5.如权利要求1至4任意一项所述的晶圆三维集成引线工艺,其特征在于,在该接触孔区域中形成介质层的工艺包括微影,刻蚀,沉积,填充和研磨之一或其任意组合。
6.如权利要求1至4任意一项所述的晶圆三维集成引线工艺,其特征在于,该半导体器件为三维存储器,该三维存储器包括顺序远离该第一晶圆正面的三维存储器件层和第一金属层,该接触孔位于该三维存储器件层内,该接触孔的一端与该介质层接触,该接触孔的另一端与该第一金属层接触。
7.如权利要求1所述的晶圆三维集成引线工艺,其特征在于,在该第一晶圆的背面与该接触孔对应的位置形成通孔的工艺包括微影,刻蚀,覆盖绝缘层之一或其任意组合。
8.如权利要求1所述的晶圆三维集成引线工艺,其特征在于,在形成引线结构之后,在该第一晶圆的背面沉积第二保护层,并通过微影和刻蚀工艺形成第二保护层结构。
9.如权利要求1所述的晶圆三维集成引线工艺,其特征在于,
在该第一晶圆的背面与该接触孔对应的位置形成通孔的工艺包括微影,刻蚀,覆盖绝缘层之一或其任意组合;
在形成引线结构之后,在该第一晶圆的背面沉积第二保护层,并通过微影和刻蚀工艺形成第二保护层结构;
该绝缘层、该第一保护层和/或该第二保护层的材质为氧化物或氮化物或氮氧化物。
10.如权利要求1至4任意一项所述的晶圆三维集成引线工艺,其特征在于,该接触孔中填充金属材料。
11.如权利要求10所述的晶圆三维集成引线工艺,其特征在于,该金属材料包括铜、铝、锡或钨之一或其任意组合。
12.如权利要求1至4任意一项所述的晶圆三维集成引线工艺,其特征在于,该介质层为氧化物介质层或氮化物介质层。
13.如权利要求1至4任意一项所述的晶圆三维集成引线工艺,其特征在于,该第一晶圆和/或该第二晶圆的材质为硅、锗、三五族半导体化合物、碳化硅或绝缘衬底上的硅之一或其任意组合。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





