[发明专利]一种系统级封装多芯片互联测试方法及装置在审

专利信息
申请号: 201511020240.9 申请日: 2015-12-30
公开(公告)号: CN106932705A 公开(公告)日: 2017-07-07
发明(设计)人: 刘军强 申请(专利权)人: 深圳市中兴微电子技术有限公司
主分类号: G01R31/28 分类号: G01R31/28
代理公司: 北京派特恩知识产权代理有限公司11270 代理人: 王花丽,张颖玲
地址: 518085 广*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 系统 封装 芯片 联测 方法 装置
【说明书】:

技术领域

发明涉及集成电路领域的芯片测试技术,尤其涉及一种系统级封装多芯片互联测试方法及装置。

背景技术

随着集成电路的发展,芯片的封装技术越来越追求小型化、多功能和低成本,因此SiP(System in Package,系统级封装)应运而生。

所述SiP是将多种功能的芯片,包括处理器、存储器等芯片集成在一个封装内,实现一个基本完整的功能。与传统独立封装相比,SiP能最大限度地提高硅片的集成度,并以最低的成本利用硅片的有效面积;还可以减小芯片间的电学路径长度,从而提高器件的性能;另外,SiP还容许异构的集成,能够将模拟电路、数字电路、RF和存储器集成到一起。

但是,SIP芯片内部集成了多个裸片,各个裸片之间相互连接。传统的芯片测试方法在对SiP芯片进行测试时,仅能够对每个裸片进行独立测试,保证每个裸片的测试结果,无法对各个裸片之间的互联进行测试,影响了SIP芯片的准确率。

发明内容

为解决上述技术问题,本发明实施例期望提供一种系统级封装多芯片互联测试方法及装置,能够提高系统级封装多芯片互联时测试的准确性。

本发明的技术方案是这样实现的:

一方面,本发明实施例提供一种系统级封装多芯片互联测试方法,用于系统级封装芯片,所述系统级封装芯片至少包括第一裸片和与所述第一裸片互联的第二裸片,所述第一裸片与所述第二裸片均包括联合测试工作组JTAG接口, 且所述第一裸片与所述第二裸片形成串联的JTAG结构;包括:

将所述第一裸片的端口设置为输出,所述第二裸片的端口设置为输入;

将第一测量向量通过所述第二裸片的端口输入,采集所述第一裸片的端口输出的第一输出向量;

根据所述第一输出向量与预设的第一对比向量,确定所述系统级封装芯片是否出现故障。

可选的,所述根据所述第一输出向量与预设的第一对比向量,确定所述系统级封装芯片是否出现故障包括:

若所述第一输出向量与所述第一对比向量相同,确定所述系统级封装芯片未出现故障;

若所述第一输出向量与所述第一对比向量不同,确定所述系统级封装芯片出现故障。

可选的,在所述根据所述第一输出向量与预设的第一对比向量,确定所述系统级封装芯片是否出现故障之后,所述方法还包括:

将所述第一裸片的端口设置为输入,所述第二裸片的端口设置为输出;

将第二测量向量通过所述第一裸片的端口输入,采集所述第二裸片的端口输出的第二输出向量;

根据所述第二输出向量与预设的第二对比向量,确定所述系统级封装芯片是否出现故障。

可选的,所述根据所述第二输出向量与预设的第二对比向量,确定所述系统级封装芯片是否出现故障包括:

若所述第二输出向量与所述第二对比向量相同,确定所述系统级封装芯片未出现故障;

若所述第二输出向量与所述第二对比向量不同,确定所述系统级封装芯片出现故障。

另一方面,本发明实施例提供一种系统级封装多芯片互联测试装置,用于测试系统级封装芯片,所述系统级封装芯片至少包括第一裸片和与所述第一裸 片互联的第二裸片,所述第一裸片与所述第二裸片均包括联合测试工作组JTAG接口,且所述第一裸片与所述第二裸片形成串联的JTAG结构;所述装置包括:

设置单元,用于将所述第一裸片的端口设置为输出,所述第二裸片的端口设置为输入;

采集单元,用于将第一测量向量通过所述第二裸片的端口输入,采集所述第一裸片的端口输出的第一输出向量;

确定单元,用于根据所述第一输出向量与预设的第一对比向量,确定所述系统级封装芯片是否出现故障。

可选的,所述确定单元具体用于:

若所述第一输出向量与所述第一对比向量相同,确定所述系统级封装芯片未出现故障;

若所述第一输出向量与所述第一对比向量不同,确定所述系统级封装芯片出现故障。

可选的,所述设置单元还用于将所述第一裸片的端口设置为输入,所述第二裸片的端口设置为输出;

所述采集单元还用于将第二测量向量通过所述第一裸片的端口输入,采集所述第二裸片的端口输出的第二输出向量;

所述确定单元还用于根据所述第二输出向量与预设的第二对比向量,确定所述系统级封装芯片是否出现故障。

可选的,所述确定单元具体用于:

若所述第二输出向量与所述第二对比向量相同,确定所述系统级封装芯片未出现故障;

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