[发明专利]控制信号处理方法及装置、可变存储器在审
申请号: | 201410050666.8 | 申请日: | 2014-02-13 |
公开(公告)号: | CN104851454A | 公开(公告)日: | 2015-08-19 |
发明(设计)人: | 肖世海;杨伟;徐荣刚 | 申请(专利权)人: | 华为技术有限公司 |
主分类号: | G11C11/56 | 分类号: | G11C11/56;G11C16/10 |
代理公司: | 北京同立钧成知识产权代理有限公司 11205 | 代理人: | 刘芳 |
地址: | 518129 广东*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 控制 信号 处理 方法 装置 可变 存储器 | ||
1.一种控制信号处理方法,其特征在于,包括:
接收控制总线信号,所述控制总线信号中包括内存标识和内存芯片组标识;
根据所述内存芯片组标识,确定与所述内存芯片组标识对应的内存芯片组;
将所述控制总线信号发送给所述确定的内存芯片组;以使所述确定的内存芯片组根据所述控制总线信号中包括的内存标识,将所述控制总线信号发送给所述内存芯片组中与所述内存标识对应的内存芯片。
2.根据权利要求1所述的方法,其特征在于,所述接收控制总线信号之后,包括:
将所述控制总线信号分成不同时钟域的多个控制总线信号,所述不同时钟域的多个控制总线信号中分别包括各自对应的内存标识和内存芯片组标识;
根据所述不同时钟域的多个控制总线信号中分别包括的各自对应的内存标识和内存芯片组标识,分别确定与所述各自对应的内存标识和内存芯片组标识对应的内存芯片组;
将所述不同时钟域的多个控制总线信号分别发送给与所述各自对应的内存标识和内存芯片组标识对应的内存芯片组。
3.根据权利要求2所述的方法,其特征在于,所述将所述控制总线信号分成不同时钟域的多个控制总线信号之后,包括:
将所述不同时钟域的多个控制总线信号转换为同一个时钟域的多个控制总线信号,所述同一个时钟域的多个控制总线信号中分别包括的各自对应的内存标识和内存芯片组标识;
根据所述同一个时钟域的多个控制总线信号中分别包括的各自对应的内存标识和内存芯片组标识,分别确定与所述各自对应的内存标识和内存芯片组标识对应的内存芯片组;
将所述同一个时钟域的多个控制总线信号分别发送给与所述各自对应的内存标识和内存芯片组标识对应的内存芯片组。
4.一种控制信号处理装置,其特征在于,包括:
接收模块,用于接收控制总线信号,所述控制总线信号中包括内存标识和内存芯片组标识;
确定模块,用于根据所述内存芯片组标识,确定与所述内存芯片组标识对应的内存芯片组;
发送模块,用于将所述控制总线信号发送给所述确定的内存芯片组;以使所述确定的内存芯片组根据所述控制总线信号中包括的内存标识,将所述控制总线信号发送给所述内存芯片组中与所述内存标识对应的内存芯片。
5.根据权利要求4所述的装置,其特征在于,还包括:
时分模块,用于将所述接收模块接收的控制总线信号分成不同时钟域的多个控制总线信号,所述不同时钟域的多个控制总线信号中分别包括各自对应的内存标识和内存芯片组标识;
所述确定模块,还用于根据所述不同时钟域的多个控制总线信号中分别包括的各自对应的内存标识和内存芯片组标识,分别确定与所述各自对应的内存标识和内存芯片组标识对应的内存芯片组;
所述发送模块,还用于将所述不同时钟域的多个控制总线信号分别发送给与所述各自对应的内存标识和内存芯片组标识对应的内存芯片组。
6.根据权利要求5所述的装置,其特征在于,还包括:
同步模块,用于将所述时分模块分成的不同时钟域的多个控制总线信号转换为同一个时钟域的多个控制总线信号,所述同一个时钟域的多个控制总线信号中分别包括的各自对应的内存标识和内存芯片组标识;
所述确定模块,还用于根据所述同一个时钟域的多个控制总线信号中分别包括的各自对应的内存标识和内存芯片组标识,分别确定与所述各自对应的内存标识和内存芯片组标识对应的内存芯片组;
所述发送模块,还用于将所述同一个时钟域的多个控制总线信号分别发送给与所述各自对应的内存标识和内存芯片组标识对应的内存芯片组。
7.一种可变存储器,其特征在于,包括:处理器和多个内存芯片组;
所述处理器包括如权利要求4-6任一项所述的控制信号处理装置;
所述多个内存芯片组中的每个内存芯片组包括多个内存芯片,所述多个内存芯片中的每个内存芯片的标识信息包括所述内存芯片所属内存的内存标识和所属的内存芯片组的内存芯片组标识;
所述内存芯片组,用于在接收到控制总线信号时,若确定所述控制总线信号中包括的内存芯片组标识为所述内存芯片组的内存芯片组标识时,则根据所述控制总线信号中包括的内存标识,将所述控制总线信号发送给所述内存芯片组中与所述内存标识对应的内存芯片。
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