[发明专利]存储系统以及存储控制方法在审
申请号: | 201380072208.8 | 申请日: | 2013-09-05 |
公开(公告)号: | CN104969204A | 公开(公告)日: | 2015-10-07 |
发明(设计)人: | 鹫谷幸司;新田敏裕 | 申请(专利权)人: | 株式会社日立制作所 |
主分类号: | G06F13/14 | 分类号: | G06F13/14;G06F3/06;G06F12/00;G06F13/10;G06F13/16;G06F13/36;H04L12/727;H04L12/733 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 陈伟 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 存储系统 以及 存储 控制 方法 | ||
技术领域
本发明大体涉及存储控制,例如,涉及经由多个SAS(Serial Attached SCSI:串行SCSI)扩展器(expander)向目标设备(target device)发送指令的技术。
背景技术
已知一种具有多个SAS扩展器(以下称为扩展器)的存储系统。在这种存储系统中,存储设备与扩展器连接,从启动设备(initiator device)向存储设备的指令经由多个扩展器。
例如专利文献1公开了这种存储系统。根据专利文献1,在串联地连接的多个扩展器的两端连接启动设备(例如参照图10)。
在先技术文献
专利文献
专利文献1:美国专利第8321596号说明书
发明内容
发明要解决的课题
当存储系统的大容量化发展时,存储设备的数量增加,因此,也需要增加串联地连接的扩展器的数量。另外,还开发出了具有更高速的响应速度的存储设备。以下,方便起见,将串联地连接的多个扩展器称为“扩展器列”。
在扩展器的数量多的扩展器列中,即使响应速度较慢的存储设备(SATA(Serial ATA:串行ATA)-HDD(Hard Disk Drive:硬盘驱动器))与较后级的扩展器相连接,对指令发出侧(例如,发出指令的微处理器)的影响也较小。这是由于,与这种存储设备的响应速度相比,基于向该存储设备发出的指令所经过的扩展器的数量的延迟(latency)的影响更小。即,无论响应速度较慢的存储设备是与较前级的扩展器连接还是与较后级的扩展器相连接,对于指令发出侧而言的响应时间均为基于存储设备的响应速度的响应时间。
但是,在扩展器的数量多的扩展器列中,当响应速度较快的存储设备(例如SSD(Solid State Drive:固态驱动器))与较后级的扩展器连接时,对指令发出侧的影响较大。具体地说,在指令发出侧,存储设备的性能看起来劣化。这是由于,与这种存储设备的响应速度相比,基于向该存储设备发出的指令所经过的扩展器的数量的延迟的影响更大。
用于解决课题的手段
存储系统具有:串联地连接的多个扩展器即扩展器列;多个存储设备,其与扩展器列连接;第一启动设备和第二启动设备,其与扩展器列连接;以及处理器。处理器针对多个存储设备和所述多个扩展器中的、指令的发送目的地设备,在与发送目的地设备之间的扩展器更少的启动设备即最佳路径以及与发送目的地设备之间的扩展器更多的启动设备即落后路径中,选择最佳路径,经由所选择出的最佳路径,将指令发送到发送目的地设备。
发明效果
能够减少由扩展器列的长度引起的延迟。
附图说明
图1表示实施例1的概要。
图2表示实施例1的计算机系统的构成。
图3表示实施例1的存储控制器的存储器所存储的多个表。
图4表示实施例1的目标管理表的构成。
图5A表示实施例1的访问路径管理表的构成。
图5B表示将图5A示出的表的记录(record)按照目标设备的响应速度从快到慢的顺序排序的结果。
图6表示实施例1的主机I/O管理表的构成。
图7表示实施例1的扩展器的构成。
图8表示实施例1的目标管理表制作处理的流程。
图9表示实施例1的访问路径管理表制作处理的流程。
图10表示实施例1的主机I/O管理表制作处理的流程。
图11表示实施例1的I/O指令发送处理的流程。
图12表示实施例1的内部处理指令发送处理的流程。
图13表示实施例2的概要。
图14表示实施例2的MP、控制器和扩展器分别进行管理的信息的概要。
图15表示实施例2的区域权限表(zone permission table)的构成。
图16表示实施例2的内部处理指令发送处理的流程。
图17A表示实施例2的在线时设定处理的整体流程。
图17B表示实施例2的离线时设定处理的整体流程。
图18表示实施例3的概要。
图19表示实施例3的分区表(zoning table)的构成。
图20表示实施例3的区域权限表的构成。
图21表示实施例1的计算机系统的构成的第一变形例。
图22表示实施例1的计算机系统的构成的第二变形例。
图23表示实施例2与实施例3的组合的一例。
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