[实用新型]具有数据存储功能的移动多媒体设备有效
| 申请号: | 201320053725.8 | 申请日: | 2013-01-30 |
| 公开(公告)号: | CN203133829U | 公开(公告)日: | 2013-08-14 |
| 发明(设计)人: | 张军辉 | 申请(专利权)人: | 北京三星通信技术研究有限公司;三星电子株式会社 |
| 主分类号: | G06F13/38 | 分类号: | G06F13/38 |
| 代理公司: | 北京德琦知识产权代理有限公司 11018 | 代理人: | 王一斌;王琦 |
| 地址: | 100125 北京市*** | 国省代码: | 北京;11 |
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| 摘要: | |||
| 搜索关键词: | 具有 数据 存储 功能 移动 多媒体设备 | ||
技术领域
本实用新型涉及移动多媒体设备的存储技术,特别涉及用于提高数据存取速度的一种具有数据存储功能的移动多媒体设备。
背景技术
在例如手机等具有多媒体功能的移动多媒体设备中,数据的存储通常是基于内置存储器或外接存储器来实现的。当需要存入数据时,移动多媒体设备的主控芯片会向移动多媒体设备中指定的一个内置存储器、或指定的一个外接存储器顺序写入数据;当需要取出数据时,移动多媒体设备的主控芯片会从移动多媒体设备中指定的一个内置存储器、或指定的一个外接存储器顺序读出数据。
然而,受限于半导体工艺的限制,内置存储器和外接存储器所能够支持的传输速率均远远低于主控芯片能够实现的最大传输速率,从而,主控芯片对单个内置存储器或外接存储器的顺序读写就成为了移动多媒体设备的数据存取性能的瓶颈。
实用新型内容
有鉴于此,本实用新型提供了一种具有数据存储功能的移动多媒体设备。
本实用新型提供的一种具有数据存储功能的移动多媒体设备,该移动多媒体设备包括:
主控芯片;
存储阵列;
可将主控芯片的数据以分包数据的形式在存储阵列并行存取的存储控制芯片;
其中,主控芯片与存储控制芯片之间连接有用于传输数据的第一总线,存储控制芯片与存储阵列中的每一存储器之间连接有用于传输分包数据的第二总线;
以及,第一总线的传输速率高于第二总线。
可选地,在上述移动多媒体设备中,第一总线为DDR总线,第二总线为SDIO接口总线或USB接口总线。
可选地,在上述移动多媒体设备中,存储阵列中的各存储器为移动多媒体设备的内置存储器。
可选地,在上述移动多媒体设备中,存储阵列中的各存储器为移动多媒体设备的外接存储器。
可选地,在上述移动多媒体设备中,存储阵列中的各存储器包括移动多媒体设备的内置存储器和外接存储器。
可选地,在上述移动多媒体设备中,进一步包括备份存储器,其中,存储控制芯片与备份存储器之间连接有用于传输数据的第三总线,且第一总线的传输速率高于第三总线。
可选地,在上述移动多媒体设备中,第一总线为DDR总线,第二总线为接口SDIO总线或接口USB总线,第三总线为SDIO接口总线或USB接口总线。
可选地,在上述移动多媒体设备中,备份存储器为移动多媒体设备的内置存储器。
可选地,在上述移动多媒体设备中,主控芯片与存储控制芯片之间进一步连接有可使存储控制芯片受控于主控芯片的控制总线。
可选地,在上述移动多媒体设备中,存储控制芯片内集成有:
可实现存储控制器内部的数据交换的内部总线;
可与主控芯片交互数据、并实现数据的分解以及分包数据的合并的DDR控制器,该DDR控制器与第一总线和内部总线相连;
可在DDR控制器分解数据以及合并分包数据实现临时缓存的缓存模组,该缓存模组与DDR控制器相连;
可与存储阵列交互分包数据的接口控制器,该接口控制器与第二总线和内部总线相连;
可与备份存储器交互数据的备份控制器,该备份控制器与第三总线和内部总线相连;
可依据主控芯片发送的指令来控制DDR控制器和备份控制器的GPIO控制器,该GPIO控制器与控制总线、以及DDR控制器和备份控制器相连。
由此可见,在本实用新型提供的移动多媒体设备中,并不是由主控芯片对单个内置存储器或外接存储器实现顺序的读写,而是由存储控制芯片将主控芯片的数据以分包数据的形式在存储阵列并行读写。从而,就能够使移动多媒体设备的数据存取性能得到提升。
附图说明
图1为本实用新型中具有数据存储功能的移动多媒体设备的示例性结构示意图;
图2a和图2b为本实用新型中的移动多媒体设备的数据存取时序图;
图3a至图3c分别为本实用新型中具有数据存储功能的移动多媒体设备的三种具体结构示意图;
图4为本实用新型中具有数据存储功能的移动多媒体设备所包含的存储控制器的内部框架示意图。
具体实施方式
为使本实用新型的目的、技术方案及优点更加清楚明白,以下参照附图并举实施例,对本实用新型进一步详细说明。
参见图1,在本实施例中,具有数据存储功能的移动多媒体设备包括:
主控芯片10;
存储阵列20;
可将主控芯片10的数据以分包数据的形式在存储阵列20并行存取的存储控制芯片30;
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