[发明专利]一种多模基站及其实现方法有效
| 申请号: | 201210218385.X | 申请日: | 2012-06-28 |
| 公开(公告)号: | CN102781090A | 公开(公告)日: | 2012-11-14 |
| 发明(设计)人: | 余卫东 | 申请(专利权)人: | 华为技术有限公司 |
| 主分类号: | H04W56/00 | 分类号: | H04W56/00;H04W88/10 |
| 代理公司: | 广州三环专利代理有限公司 44202 | 代理人: | 郝传鑫;熊永强 |
| 地址: | 518129 广东*** | 国省代码: | 广东;44 |
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| 摘要: | |||
| 搜索关键词: | 一种 基站 及其 实现 方法 | ||
技术领域
本发明涉及通信技术领域,尤其涉及一种多模基站及其实现方法。
背景技术
多模基站是指能同时支持多种无线制式的基站,常见的能同时支持全球移动通信系统(Global System ofMobile communication,GSM)制式和通用移动通信系统(Universal Mobile Telecommunications System,UMTS)制式的基站称为GU双模基站,能同时支持GSM制式和长期演进(Long Term Evolution,LTE)制式的基站称为GL双模基站,以及能同时支持UMTS制式和LTE制式的基站称为UL双模基站。
实际应用中,通常在一个基带单元(Base Band Unit,BBU)上叠加不同制式的主控板来形成多模基站。以图1所示的一种GU双模宏基站为例,在单个BBU上可以叠加GSM制式的单板和UMTS制式的单板,其中,GSM制式的单板和UMTS制式的单板分别通过公共通用无线接口(Common Public RadioInterface,CPRI)与共模的射频模块连接,从而形成GU双模基站。
实践中发现,由于单个BBU所支持的槽位有限,因此单个BBU支持的制式有限,一般地单个BBU只能支持2个单板,从而使得多模基站支持的制式就比较少。
发明内容
本发明实施例提供了一种多模基站及其实现方法,可以使多模基站支持更多的制式。
本发明实施例一方面提供的一种多模基站的实现方法,其中,所述多模基站至少集成有第一基带单元BBU0和第二基站单元BBU1,其中,所述BBU0、BBU1内各叠加有至少一种制式的单板;所述BBU0内的单板、BBU1内的单板分别通过公共通用无线接口与共模的射频模块连接,所述方法包括:
所述BBU1内的单板利用所述BBU0的单板输出的同步以太网时钟,实现 所述BBU1内的单板的系统时钟和所述BBU0内的单板的系统时钟的频率同步;
所述BBU1内的单板利用所述BBU0的单板输出的IEEE1588时钟,实现所述BBU1内的单板的系统时钟和所述BBU0内的单板的系统时钟的时间同步。
本发明实施例另一方面提供的一种多模基站,所述多模基站至少集成有第一基带单元BBU0和第二基站单元BBU1,其中,所述BBU0、BBU1内各叠加有至少一种制式的单板;所述BBU0内的单板、BBU1内的单板分别通过公共通用无线接口与共模的射频模块连接,其中:
所述BBU0内的单板,用于输出同步以太网时钟和IEEE1588时钟给所述BBU1内的单板;
所述BBU1内的单板,用于利用所述BBU0的单板输出的同步以太网时钟,实现所述BBU1内的单板的系统时钟和所述BBU0内的单板的系统时钟的频率同步;以及利用所述BBU0的单板输出的IEEE1588时钟,实现所述BBU1内的单板的系统时钟和所述BBU0内的单板的系统时钟的时间同步。
本发明实施例中,多模基站至少集成有第一基带单元BBU0和第二基站单元BBU1,由于BBU0内的单板、BBU1内的单板分别通过CPRI与共模的射频模块连接,因此BBU1内的单板可以利用BBU0的单板输出的同步以太网时钟,实现BBU1内的单板的系统时钟和BBU0内的单板的系统时钟的频率同步,以及BBU1内的单板可以利用BBU0的单板输出的IEEE1588时钟,实现BBU1内的单板的系统时钟和BBU0内的单板的系统时钟的时间同步,从而实现了BBU0内的单板的系统时钟和BBU1内的单板的系统时钟保持严格的同步,使得多模基站可以支持更多的制式。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1是现有的一种GU双模宏基站的结构示意图;
图2是本发明第一实施例提供的多模基站的实现方法的流程示意图;
图3是本发明第一实施例提供的GUL三模宏基站的结构示意图;
图4是本发明第一实施例提供的分布式GUL三模基站的结构示意图;
图5是本发明第二实施例提供的BBU0内的单板和BBU1内的单板互联的结构示意图。
具体实施方式
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