[发明专利]具有扫描功能的有限翻转动态逻辑电路无效
| 申请号： | 201210012477.2 | 申请日： | 2012-01-16 |
| 公开（公告）号： | CN102571075A | 公开（公告）日： | 2012-07-11 |
| 发明（设计）人： | 李振涛;郭阳;宋芳芳;刘蓬侠;陈书明;刘祥远;唐涛;胡春媚;张子杰;付志刚;王丽娟;冯国柱;邢冬生;高维娜;唐茜茜 | 申请（专利权）人： | 中国人民解放军国防科学技术大学 |
| 主分类号： | H03K19/20 | 分类号： | H03K19/20 |
| 代理公司： | 湖南兆弘专利事务所 43008 | 代理人： | 周长清 |
| 地址： | 410073 湖南省长沙市砚瓦池正街4*** | 国省代码： | 湖南;43 |
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| 摘要： | |||
| 搜索关键词： | 具有 扫描 功能 有限 翻转 动态 逻辑电路 | ||
1.一种具有扫描功能的有限翻转动态逻辑电路，其特征在于：它包括外围模块和至少一个LSDL核心单元（8），所述LSDL核心单元（8）包括动态门电路（1）、N-C2MOS锁存器（2）、扫描使能输入端口、扫描输入端口、扫描输出端口、用于在所述扫描使能输入端输入信号有效时将扫描输入端口的信号送至扫描输出端口输出的扫描输入逻辑（3），所述外围模块包括用于在所述扫描使能输入端输入有效信号时关闭所述动态门电路（1）中下拉逻辑网络（11）的使能控制模块（4），所述扫描输入逻辑（3）的输入端分别与扫描使能输入端、扫描输入端口以及时钟信号相连，所述扫描输入逻辑（3）的输出端与N-C2MOS锁存器（2）的输入端相连，所述扫描输出端口与所述N-C2MOS锁存器（2）的输出端相连；所述使能控制模块（4）的输入端与所述扫描使能输入端相连，所述使能控制模块（4）的输出端与下拉逻辑网络（11）的控制端相连。
2.根据权利要求1所述的具有扫描功能的有限翻转动态逻辑电路，其特征在于：所述扫描输入逻辑（3）包括依次串联的第一NMOS管和第二NMOS管，所述第一NMOS管位于靠N-C2MOS锁存器（2）输入端的一侧，所述扫描使能输入端与第一NMOS管的栅极相连，所述扫描输入端口与第二NMOS管的栅极相连。
3.根据权利要求1或2所述的具有扫描功能的有限翻转动态逻辑电路，其特征在于：所述LSDL核心单元（8）还包括用于将N-C2MOS锁存器（2）的输出信号延时输出的扫描输出逻辑（5），所述扫描输出逻辑（5）包括延时电路（51），所述扫描输出端口通过延时电路（51）与所述N-C2MOS锁存器（2）的输出端相连。
4.根据权利要求3所述的具有扫描功能的有限翻转动态逻辑电路，其特征在于：所述外围模块还包括用于产生窄脉冲信号的时钟产生模块（6），所述时钟产生模块（6）的输入端与标准时钟信号相连，所述时钟产生模块（6）的输出端分别与动态门电路（1）、N-C2MOS锁存器（2）以及扫描输入逻辑（3）相连。
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