[实用新型]通讯设备的中断扩展电路有效

专利信息
申请号: 201120362661.0 申请日: 2011-09-23
公开(公告)号: CN202267957U 公开(公告)日: 2012-06-06
发明(设计)人: 刘建文;赵生全 申请(专利权)人: 福建星网锐捷通讯股份有限公司
主分类号: G06F13/24 分类号: G06F13/24
代理公司: 福州市鼓楼区京华专利事务所(普通合伙) 35212 代理人: 宋连梅
地址: 350000 福建省福州市仓山区金*** 国省代码: 福建;35
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摘要:
搜索关键词: 通讯设备 中断 扩展 电路
【说明书】:

【技术领域】

本实用新型涉及通讯设备技术领域,特别涉及一种通讯设备的中断扩展电路。

【背景技术】

在通讯设备技术领域中由于成本的压力,通讯设备的CPU接口资源有限,中断接口资源尤其紧张,实际设计应用中往往出现中断资源不够用的情况,这就需要对中断接口进行扩展。通讯设备的CPU的中断扩展,主要有两种方式,一种是使用专用的中断扩展芯片;其运用中断扩展芯片的成本比较高。另一种是用普通的GPIO(通用输入/输出接口)软件模拟中断,通过软件不间断实时查询通讯设备GPIO接口状态的方式实现信号侦听,从而实现中断功能;其该种通过软件不间断实时轮询GPIO接口状态来判断中断是否触发,这样做大大占用了软件和系统资源,造成系统效率低,并且受轮询周期长短的影响,还可能存在中断触发信号无法捕捉的风险,影响系统的可靠性。

发明内容】

本实用新型要解决的技术问题,在于提供一种低成本高效率的通讯设备的中断扩展电路。

本实用新型是这样实现的:一种通讯设备的中断扩展电路,包括中断触发电路、上下拉电阻、通讯设备的CPU中断输入接口IRQ(中断请求)以及通讯设备的GPIO接口;所述中断触发电路与所述上下拉电阻连接;所述中断触发电路的输出端与所述通讯设备的CPU中断输入接口IRQ连接;所述中断触发电路的输入端与所述通讯设备的GPIO接口连接。

进一步地,所述中断触发电路是带有两输入端、一输出端的“与”功能逻辑电路。所述上下拉电阻包括电阻R1、电阻R2、电阻R3;所述电阻R1的一端与所述“与”功能逻辑电路的一输入端连接,所述电阻R1的另一端与电源电压供电端连接;所述电阻R2的一端与所述“与”功能逻辑电路的另一输入端连接,所述电阻R2的另一端与电源电压供电端连接;所述电阻R3的一端与所述“与”功能逻辑电路的输出端连接;所述电阻R3的另一端与电源电压供电端连接;所述“与”功能逻辑电路的另一输入端与所述通讯设备的GPIO接口连接。

进一步地,所述中断触发电路是带有两输入端、一输出端的“或”功能逻辑电路。所述上下拉电阻包括电阻R4、电阻R5、电阻R6;所述电阻R4的一端与所述“或”功能逻辑电路的一输入端连接,所述电阻R4的另一端与电源接地点连接;所述电阻R5的一端与所述“或”功能逻辑电路的另一输入端连接,所述电阻R5的另一端与电源接地点连接;所述电阻R6的一端与所述或”功能逻辑电路的输出端连接;所述电阻R6的另一端与电源接地点连接;所述或”功能逻辑电路的另一输入端与所述通讯设备的GPIO接口连接。

本实用新型的优点在于:本实用新型利用能够实现“与”功能(低电平触发的中断触发电路)或者“或”功能(高电平触发的中断触发电路)的简单逻辑电路向通讯设备的系统发送中断请求,其用上下拉电阻来确认其简单逻辑电路的默认电平;并用通讯设备的GPIO接口或者其他能够识别信号变化的端口做辅助,实现通讯设备的系统中断扩展。本实用新型可以大大节省通讯设备系统的资源,是一种低成本高效率的中断扩展电路。

【附图说明】

图1是本实用新型的结构示意图。

图2是本实用新型第一实施例的结构示意图。

图3是本实用新型第二实施例的结构示意图。

【具体实施方式】

请参阅图1所示,本实用新型的通讯设备的中断扩展电路,包括中断触发电路、上下拉电阻、通讯设备的CPU中断输入接口IRQ以及通讯设备的GPIO接口;所述中断触发电路与所述上下拉电阻连接;其用上下拉电阻来确认其简单逻辑电路的默认电平;所述中断触发电路的输出端与所述通讯设备的CPU中断输入接口IRQ连接;所述中断触发电路的输入端与所述通讯设备的GPIO接口连接。

如图2所示,是本实用新型的第一实施例的结构示意图。所述中断触发电路是带有两输入端、一输出端的“与”功能逻辑电路(其“与”功能逻辑电路可以是集成IC实现;也可以用分立元件实现如二极管、三极管等的组合电路;也可以是与门逻辑电路实现等)。所述上下拉电阻包括电阻R1、电阻R2、电阻R3;所述电阻R1的一端与所述“与”功能逻辑电路的一输入端连接,所述电阻R1的另一端与电源电压供电端(VCC)连接;所述电阻R2的一端与所述“与”功能逻辑电路的另一输入端连接,所述电阻R2的另一端与电源电压供电端连接;所述电阻R3的一端与所述“与”功能逻辑电路的输出端连接;所述电阻R3的另一端与电源电压供电端连接;所述“与”功能逻辑电路逻辑电路的另一输入端与所述通讯设备的GPIO接口连接。

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